📄 iolpc2148.h
字号:
__REG16 P0_4 : 1;
__REG16 P0_5 : 1;
__REG16 P0_6 : 1;
__REG16 P0_7 : 1;
__REG16 P0_8 : 1;
__REG16 P0_9 : 1;
__REG16 P0_10 : 1;
__REG16 P0_11 : 1;
__REG16 P0_12 : 1;
__REG16 P0_13 : 1;
__REG16 P0_14 : 1;
__REG16 P0_15 : 1;
} __shortu_bit;
__REG16 __shortu;
};
};
} __fgpio0_bits;
/* GPIO 1 Registers */
typedef struct {
__REG32 P1_0 : 1;
__REG32 P1_1 : 1;
__REG32 P1_2 : 1;
__REG32 P1_3 : 1;
__REG32 P1_4 : 1;
__REG32 P1_5 : 1;
__REG32 P1_6 : 1;
__REG32 P1_7 : 1;
__REG32 P1_8 : 1;
__REG32 P1_9 : 1;
__REG32 P1_10 : 1;
__REG32 P1_11 : 1;
__REG32 P1_12 : 1;
__REG32 P1_13 : 1;
__REG32 P1_14 : 1;
__REG32 P1_15 : 1;
__REG32 P1_16 : 1;
__REG32 P1_17 : 1;
__REG32 P1_18 : 1;
__REG32 P1_19 : 1;
__REG32 P1_20 : 1;
__REG32 P1_21 : 1;
__REG32 P1_22 : 1;
__REG32 P1_23 : 1;
__REG32 P1_24 : 1;
__REG32 P1_25 : 1;
__REG32 P1_26 : 1;
__REG32 P1_27 : 1;
__REG32 P1_28 : 1;
__REG32 P1_29 : 1;
__REG32 P1_30 : 1;
__REG32 P1_31 : 1;
} __gpio1_bits;
/* FGPIO 1 Registers*/
typedef union{
struct {
__REG32 P1_0 : 1;
__REG32 P1_1 : 1;
__REG32 P1_2 : 1;
__REG32 P1_3 : 1;
__REG32 P1_4 : 1;
__REG32 P1_5 : 1;
__REG32 P1_6 : 1;
__REG32 P1_7 : 1;
__REG32 P1_8 : 1;
__REG32 P1_9 : 1;
__REG32 P1_10 : 1;
__REG32 P1_11 : 1;
__REG32 P1_12 : 1;
__REG32 P1_13 : 1;
__REG32 P1_14 : 1;
__REG32 P1_15 : 1;
__REG32 P1_16 : 1;
__REG32 P1_17 : 1;
__REG32 P1_18 : 1;
__REG32 P1_19 : 1;
__REG32 P1_20 : 1;
__REG32 P1_21 : 1;
__REG32 P1_22 : 1;
__REG32 P1_23 : 1;
__REG32 P1_24 : 1;
__REG32 P1_25 : 1;
__REG32 P1_26 : 1;
__REG32 P1_27 : 1;
__REG32 P1_28 : 1;
__REG32 P1_29 : 1;
__REG32 P1_30 : 1;
__REG32 P1_31 : 1;
};
struct
{
union
{
struct{
__REG8 P1_0 : 1;
__REG8 P1_1 : 1;
__REG8 P1_2 : 1;
__REG8 P1_3 : 1;
__REG8 P1_4 : 1;
__REG8 P1_5 : 1;
__REG8 P1_6 : 1;
__REG8 P1_7 : 1;
} __byte0_bit;
__REG8 __byte0;
};
union
{
struct{
__REG8 P1_0 : 1;
__REG8 P1_1 : 1;
__REG8 P1_2 : 1;
__REG8 P1_3 : 1;
__REG8 P1_4 : 1;
__REG8 P1_5 : 1;
__REG8 P1_6 : 1;
__REG8 P1_7 : 1;
} __byte1_bit;
__REG8 __byte1;
};
union
{
struct{
__REG8 P1_0 : 1;
__REG8 P1_1 : 1;
__REG8 P1_2 : 1;
__REG8 P1_3 : 1;
__REG8 P1_4 : 1;
__REG8 P1_5 : 1;
__REG8 P1_6 : 1;
__REG8 P1_7 : 1;
} __byte2_bit;
__REG8 __byte2;
};
union
{
struct{
__REG8 P1_0 : 1;
__REG8 P1_1 : 1;
__REG8 P1_2 : 1;
__REG8 P1_3 : 1;
__REG8 P1_4 : 1;
__REG8 P1_5 : 1;
__REG8 P1_6 : 1;
__REG8 P1_7 : 1;
} __byte3_bit;
__REG8 __byte3;
};
};
struct
{
union
{
struct{
__REG16 P1_0 : 1;
__REG16 P1_1 : 1;
__REG16 P1_2 : 1;
__REG16 P1_3 : 1;
__REG16 P1_4 : 1;
__REG16 P1_5 : 1;
__REG16 P1_6 : 1;
__REG16 P1_7 : 1;
__REG16 P1_8 : 1;
__REG16 P1_9 : 1;
__REG16 P1_10 : 1;
__REG16 P1_11 : 1;
__REG16 P1_12 : 1;
__REG16 P1_13 : 1;
__REG16 P1_14 : 1;
__REG16 P1_15 : 1;
} __shortl_bit;
__REG16 __shortl;
};
union
{
struct{
__REG16 P1_0 : 1;
__REG16 P1_1 : 1;
__REG16 P1_2 : 1;
__REG16 P1_3 : 1;
__REG16 P1_4 : 1;
__REG16 P1_5 : 1;
__REG16 P1_6 : 1;
__REG16 P1_7 : 1;
__REG16 P1_8 : 1;
__REG16 P1_9 : 1;
__REG16 P1_10 : 1;
__REG16 P1_11 : 1;
__REG16 P1_12 : 1;
__REG16 P1_13 : 1;
__REG16 P1_14 : 1;
__REG16 P1_15 : 1;
} __shortu_bit;
__REG16 __shortu;
};
};
} __fgpio1_bits;
/* UART interrupt enable register */
typedef struct{
__REG32 RDAIE : 1;
__REG32 THREIE : 1;
__REG32 RXLSIE : 1;
__REG32 : 5;
__REG32 ABTOINTEN : 1;
__REG32 ABEOINTEN : 1;
__REG32 :22;
} __uartier0_bits;
/* UART Fractional Divider Register */
typedef struct{
__REG8 DIVADDVAL : 4;
__REG8 MULVAL : 4;
} __uartfdr_bits;
/* UART Transmit Enable Register */
typedef struct{
__REG8 : 7;
__REG8 TxEn : 1;
} __uartter_bits;
/* UART line status register */
typedef struct{
__REG8 DR : 1;
__REG8 OE : 1;
__REG8 PE : 1;
__REG8 FE : 1;
__REG8 BI : 1;
__REG8 THRE : 1;
__REG8 TEMT : 1;
__REG8 RXFE : 1;
} __uartlsr_bits;
/* UART line control register */
typedef struct{
__REG8 WLS : 2;
__REG8 SBS : 1;
__REG8 PE : 1;
__REG8 PS : 2;
__REG8 BC : 1;
__REG8 DLAB : 1;
} __uartlcr_bits;
/* UART interrupt identification register and fifo control register */
typedef union {
//UxIIR
struct {
__REG32 IP : 1;
__REG32 IID : 3;
__REG32 : 2;
__REG32 IIRFE : 2;
__REG32 ABEOINT: 1;
__REG32 ABTOINT: 1;
__REG32 :22;
};
//UxFCR
struct {
__REG32 FCRFE : 1;
__REG32 RFR : 1;
__REG32 TFR : 1;
__REG32 : 3;
__REG32 RTLS : 2;
__REG32 :24;
};
} __uartfcriir_bits;
/* UART interrupt enable register */
typedef struct{
__REG32 RDAIE : 1;
__REG32 THREIE : 1;
__REG32 RXLSIE : 1;
__REG32 MSIE : 1;
__REG32 : 3;
__REG32 CTSIE : 1;
__REG32 ABTOINTEN : 1;
__REG32 ABEOINTEN : 1;
__REG32 :22;
} __uartier1_bits;
/* UART modem control register */
typedef struct{
__REG8 DTR : 1;
__REG8 RTS : 1;
__REG8 : 2;
__REG8 LMS : 1;
__REG8 : 1;
__REG8 RTSEN : 1;
__REG8 CTSEN : 1;
} __uartmcr_bits;
/* UART modem status register */
typedef union{
//UxMSR
struct {
__REG8 DCTS : 1;
__REG8 DDSR : 1;
__REG8 TERI : 1;
__REG8 DDCD : 1;
__REG8 CTS : 1;
__REG8 DSR : 1;
__REG8 RI : 1;
__REG8 DCD : 1;
};
//UxMSR
struct {
__REG8 MSR0 : 1;
__REG8 MSR1 : 1;
__REG8 MSR2 : 1;
__REG8 MSR3 : 1;
__REG8 MSR4 : 1;
__REG8 MSR5 : 1;
__REG8 MSR6 : 1;
__REG8 MSR7 : 1;
};
} __uartmsr_bits;
/* UART1 Auto-baud Control Register */
typedef struct{
__REG32 START : 1;
__REG32 MODE : 1;
__REG32 AUTORESTART : 1;
__REG32 : 5;
__REG32 ABEOINTCLR : 1;
__REG32 ABTOINTCLR : 1;
__REG32 :22;
} __uartacr_bits;
/* I2C control set register */
typedef struct{
__REG32 : 2;
__REG32 AA : 1;
__REG32 SI : 1;
__REG32 STO : 1;
__REG32 STA : 1;
__REG32 I2EN : 1;
__REG32 :25;
} __i2conset_bits;
/* I2C control clear register */
typedef struct{
__REG32 : 2;
__REG32 AAC : 1;
__REG32 SIC : 1;
__REG32 : 1;
__REG32 STAC : 1;
__REG32 I2ENC : 1;
__REG32 :25;
} __i2conclr_bits;
/* I2C status register */
typedef struct{
__REG32 STATUS : 8;
__REG32 :24;
} __i2stat_bits;
/* I2C data register */
typedef struct{
__REG32 DATA : 8;
__REG32 :24;
} __i2dat_bits;
/* I2C slave address register */
typedef struct{
__REG32 GC : 1;
__REG32 ADDR : 7;
__REG32 :24;
} __i2adr_bits;
/* I2C scl duty cycle register */
typedef struct{
__REG32 COUNT :16;
__REG32 :16;
} __i2scl_bits;
/* SPI control register */
typedef struct{
__REG32 : 2;
__REG32 BITENABLE : 1;
__REG32 CPHA : 1;
__REG32 CPOL : 1;
__REG32 MSTR : 1;
__REG32 LSBF : 1;
__REG32 SPIE : 1;
__REG32 BITS : 4;
__REG32 :20;
} __spcr_bits;
/* SPI status register */
typedef struct{
__REG32 : 3;
__REG32 ABRT : 1;
__REG32 MODF : 1;
__REG32 ROVR : 1;
__REG32 WCOL : 1;
__REG32 SPIF : 1;
__REG32 :24;
} __spsr_bits;
/* SPI data register */
typedef struct{
__REG32 DATA :16;
__REG32 :16;
} __spdr_bits;
/* SPI clock counter register */
typedef struct{
__REG32 COUNTER : 8;
__REG32 :24;
} __spccr_bits;
/* SPI interrupt register */
typedef struct{
__REG32 SPIINT : 1;
__REG32 :31;
} __spint_bits;
/* SSP Control Register 0 */
typedef struct{
__REG32 DSS : 4;
__REG32 FRF : 2;
__REG32 CPOL : 1;
__REG32 CPHA : 1;
__REG32 SCR : 8;
__REG32 :16;
} __sspcr0_bits;
/* SSP Control Register 1 */
typedef struct{
__REG32 LBM : 1;
__REG32 SSE : 1;
__REG32 MS : 1;
__REG32 SOD : 1;
__REG32 :28;
} __sspcr1_bits;
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