clock.pin

数字电子钟的Verilog HDL语言描述。

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out_data[6]                  : 133       : output : LVTTL             :         : 2         : Y              
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GNDIO                        : 135       : gnd    :                   :         :           :                
VCCIO2                       : 136       : power  :                   : 3.3V    : 2         :                
RESERVED_INPUT               : 137       :        :                   :         : 2         :                
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RESERVED_INPUT               : 140       :        :                   :         : 2         :                
out_sel[3]                   : 141       : output : LVTTL             :         : 2         : Y              
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out_sel[0]                   : 144       : output : LVTTL             :         : 2         : Y