📄 cyc2.pin
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-- programming logic devices manufactured by Altera and sold by
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--
-- This is a Quartus II output file. It is for reporting purposes only, and is
-- not intended for use as a Quartus II input file. This file cannot be used
-- to make Quartus II pin assignments - for instructions on how to make pin
-- assignments, please see Quartus II help.
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-- NC : No Connect. This pin has no internal connection to the device.
-- DNU : Do Not Use. This pin MUST NOT be connected.
-- VCCPGM : Dedicated power pin for configuration, which MUST be connected to 1.8V, 2.5V or 3.0V depending on the needs of the configuration device.
-- VCCINT : Dedicated power pin, which MUST be connected to VCC (1.2V).
-- VCCIO : Dedicated power pin, which MUST be connected to VCC
-- of its bank.
-- Bank 1: 3.3V
-- Bank 2: 3.3V
-- Bank 3: 3.3V
-- Bank 4: 3.3V
-- Bank 5: 3.3V
-- Bank 6: 3.3V
-- Bank 7: 3.3V
-- Bank 8: 3.3V
-- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND.
-- It can also be used to report unused dedicated pins. The connection
-- on the board for unused dedicated pins depends on whether this will
-- be used in a future design. One example is device migration. When
-- using device migration, refer to the device pin-tables. If it is a
-- GND pin in the pin table or if it will not be used in a future design
-- for another purpose the it MUST be connected to GND. If it is an unused
-- dedicated pin, then it can be connected to a valid signal on the board
-- (low, high, or toggling) if that signal is required for a different
-- revision of the design.
-- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins.
-- This pin should be connected to GND. It may also be connected to a
-- valid signal on the board (low, high, or toggling) if that signal
-- is required for a different revision of the design.
-- GND* : Unused I/O pin. For transceiver I/O banks (Bank 13, 14, 15, 16 and 17),
-- connect each pin marked GND* either individually through a 10 kohm resistor
-- to GND or tie all pins together and connect through a single 10 kohm resistor
-- to GND.
-- For non-transceiver I/O banks, connect each pin marked GND* directly to GND
-- or leave it unconnected.
-- RESERVED : Unused I/O pin, which MUST be left unconnected.
-- RESERVED_INPUT : Pin is tri-stated and should be connected to the board.
-- RESERVED_INPUT_WITH_WEAK_PULLUP : Pin is tri-stated with internal weak pull-up resistor.
-- RESERVED_INPUT_WITH_BUS_HOLD : Pin is tri-stated with bus-hold circuitry.
-- RESERVED_OUTPUT_DRIVEN_HIGH : Pin is output driven high.
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-- Pin directions (input, output or bidir) are based on device operating in user mode.
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Quartus II Version 7.2 Build 203 02/05/2008 Service Pack 2 SJ Web Edition
CHIP "cyc2" ASSIGNED TO AN: EP2C20F484C7
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
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GND : A1 : gnd : : : :
VCCIO3 : A2 : power : : 3.3V : 3 :
i2c_scl : A3 : output : 3.3-V LVTTL : : 3 : Y
ac_bclk : A4 : output : 3.3-V LVTTL : : 3 : Y
ac_dalrck : A5 : output : 3.3-V LVTTL : : 3 : Y
ac_adlrck : A6 : output : 3.3-V LVTTL : : 3 : Y
vga_r[2] : A7 : output : 3.3-V LVTTL : : 3 : Y
vga_g[3] : A8 : output : 3.3-V LVTTL : : 3 : Y
vga_b[0] : A9 : output : 3.3-V LVTTL : : 3 : Y
vga_b[2] : A10 : output : 3.3-V LVTTL : : 3 : Y
vga_hsync : A11 : output : 3.3-V LVTTL : : 3 : Y
clk24_0 : A12 : input : 3.3-V LVTTL : : 4 : Y
gpio0[0] : A13 : bidir : 3.3-V LVTTL : : 4 : Y
gpio0[2] : A14 : bidir : 3.3-V LVTTL : : 4 : Y
gpio0[4] : A15 : bidir : 3.3-V LVTTL : : 4 : Y
gpio0[6] : A16 : bidir : 3.3-V LVTTL : : 4 : Y
gpio0[8] : A17 : bidir : 3.3-V LVTTL : : 4 : Y
gpio0[10] : A18 : bidir : 3.3-V LVTTL : : 4 : Y
gpio0[12] : A19 : bidir : 3.3-V LVTTL : : 4 : Y
gpio0[14] : A20 : bidir : 3.3-V LVTTL : : 4 : Y
VCCIO4 : A21 : power : : 3.3V : 4 :
GND : A22 : gnd : : : :
VCCIO1 : AA1 : power : : 3.3V : 1 :
GND : AA2 : gnd : : : :
sram_addr[0] : AA3 : output : 3.3-V LVTTL : : 8 : Y
sram_addr[2] : AA4 : output : 3.3-V LVTTL : : 8 : Y
sram_addr[4] : AA5 : output : 3.3-V LVTTL : : 8 : Y
sram_data[0] : AA6 : bidir : 3.3-V LVTTL : : 8 : Y
sram_data[2] : AA7 : bidir : 3.3-V LVTTL : : 8 : Y
sram_data[4] : AA8 : bidir : 3.3-V LVTTL : : 8 : Y
sram_data[6] : AA9 : bidir : 3.3-V LVTTL : : 8 : Y
sram_we : AA10 : output : 3.3-V LVTTL : : 8 : Y
sram_addr[6] : AA11 : output : 3.3-V LVTTL : : 8 : Y
flash_addr[15] : AA12 : output : 3.3-V LVTTL : : 7 : Y
flash_addr[13] : AA13 : output : 3.3-V LVTTL : : 7 : Y
flash_addr[1] : AA14 : output : 3.3-V LVTTL : : 7 : Y
flash_oe : AA15 : output : 3.3-V LVTTL : : 7 : Y
flash_data[1] : AA16 : bidir : 3.3-V LVTTL : : 7 : Y
flash_data[3] : AA17 : bidir : 3.3-V LVTTL : : 7 : Y
flash_data[5] : AA18 : bidir : 3.3-V LVTTL : : 7 : Y
flash_data[7] : AA19 : bidir : 3.3-V LVTTL : : 7 : Y
flash_addr[17] : AA20 : output : 3.3-V LVTTL : : 7 : Y
GND : AA21 : gnd : : : :
VCCIO6 : AA22 : power : : 3.3V : 6 :
GND : AB1 : gnd : : : :
VCCIO8 : AB2 : power : : 3.3V : 8 :
sram_addr[1] : AB3 : output : 3.3-V LVTTL : : 8 : Y
sram_addr[3] : AB4 : output : 3.3-V LVTTL : : 8 : Y
sram_ce : AB5 : output : 3.3-V LVTTL : : 8 : Y
sram_data[1] : AB6 : bidir : 3.3-V LVTTL : : 8 : Y
sram_data[3] : AB7 : bidir : 3.3-V LVTTL : : 8 : Y
sram_data[5] : AB8 : bidir : 3.3-V LVTTL : : 8 : Y
sram_data[7] : AB9 : bidir : 3.3-V LVTTL : : 8 : Y
sram_addr[5] : AB10 : output : 3.3-V LVTTL : : 8 : Y
sram_addr[7] : AB11 : output : 3.3-V LVTTL : : 8 : Y
flash_addr[16] : AB12 : output : 3.3-V LVTTL : : 7 : Y
flash_addr[14] : AB13 : output : 3.3-V LVTTL : : 7 : Y
flash_addr[12] : AB14 : output : 3.3-V LVTTL : : 7 : Y
sd_dat3 : AB15 : bidir : 3.3-V LVTTL : : 7 : Y
flash_data[0] : AB16 : bidir : 3.3-V LVTTL : : 7 : Y
flash_data[2] : AB17 : bidir : 3.3-V LVTTL : : 7 : Y
flash_data[4] : AB18 : bidir : 3.3-V LVTTL : : 7 : Y
flash_data[6] : AB19 : bidir : 3.3-V LVTTL : : 7 : Y
flash_addr[0] : AB20 : output : 3.3-V LVTTL : : 7 : Y
VCCIO7 : AB21 : power : : 3.3V : 7 :
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