📄 uart.tan.rpt
字号:
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; Clock Settings Summary ;
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; Clock Node Name ; Clock Setting Name ; Type ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; clk ; ; User Pin ; NONE ; 0.000 ns ; 0.000 ns ; NONE ; N/A ; N/A ; N/A ; ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'clk' ;
+-----------------------------------------+-----------------------------------------------------+------------------+----------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+------------------+----------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A ; 111.07 MHz ( period = 9.003 ns ) ; cnt_delay[15] ; start_delaycnt ; clk ; clk ; None ; None ; 8.294 ns ;
; N/A ; 112.88 MHz ( period = 8.859 ns ) ; key_entry2 ; key_entry1 ; clk ; clk ; None ; None ; 3.022 ns ;
; N/A ; 112.89 MHz ( period = 8.858 ns ) ; cnt_delay[16] ; start_delaycnt ; clk ; clk ; None ; None ; 8.149 ns ;
; N/A ; 113.79 MHz ( period = 8.788 ns ) ; cnt_delay[2] ; start_delaycnt ; clk ; clk ; None ; None ; 8.079 ns ;
; N/A ; 116.04 MHz ( period = 8.618 ns ) ; cnt_delay[4] ; start_delaycnt ; clk ; clk ; None ; None ; 7.909 ns ;
; N/A ; 117.01 MHz ( period = 8.546 ns ) ; cnt_delay[0] ; cnt_delay[9] ; clk ; clk ; None ; None ; 7.837 ns ;
; N/A ; 117.18 MHz ( period = 8.534 ns ) ; cnt_delay[15] ; cnt_delay[19] ; clk ; clk ; None ; None ; 7.825 ns ;
; N/A ; 117.65 MHz ( period = 8.500 ns ) ; cnt_delay[15] ; cnt_delay[8] ; clk ; clk ; None ; None ; 7.791 ns ;
; N/A ; 119.20 MHz ( period = 8.389 ns ) ; div8_tras_reg[1] ; txd_buf[6] ; clk ; clk ; None ; None ; 7.680 ns ;
; N/A ; 119.20 MHz ( period = 8.389 ns ) ; div8_tras_reg[1] ; txd_buf[5] ; clk ; clk ; None ; None ; 7.680 ns ;
; N/A ; 119.20 MHz ( period = 8.389 ns ) ; cnt_delay[1] ; cnt_delay[9] ; clk ; clk ; None ; None ; 7.680 ns ;
; N/A ; 119.20 MHz ( period = 8.389 ns ) ; cnt_delay[16] ; cnt_delay[19] ; clk ; clk ; None ; None ; 7.680 ns ;
; N/A ; 119.20 MHz ( period = 8.389 ns ) ; div8_tras_reg[1] ; txd_buf[1] ; clk ; clk ; None ; None ; 7.680 ns ;
; N/A ; 119.69 MHz ( period = 8.355 ns ) ; cnt_delay[16] ; cnt_delay[8] ; clk ; clk ; None ; None ; 7.646 ns ;
; N/A ; 120.06 MHz ( period = 8.329 ns ) ; cnt_delay[2] ; cnt_delay[9] ; clk ; clk ; None ; None ; 7.620 ns ;
; N/A ; 120.21 MHz ( period = 8.319 ns ) ; cnt_delay[2] ; cnt_delay[19] ; clk ; clk ; None ; None ; 7.610 ns ;
; N/A ; 120.25 MHz ( period = 8.316 ns ) ; cnt_delay[14] ; start_delaycnt ; clk ; clk ; None ; None ; 7.607 ns ;
; N/A ; 120.42 MHz ( period = 8.304 ns ) ; cnt_delay[0] ; cnt_delay[17] ; clk ; clk ; None ; None ; 7.595 ns ;
; N/A ; 120.51 MHz ( period = 8.298 ns ) ; cnt_delay[3] ; cnt_delay[9] ; clk ; clk ; None ; None ; 7.589 ns ;
; N/A ; 120.70 MHz ( period = 8.285 ns ) ; cnt_delay[6] ; cnt_delay[9] ; clk ; clk ; None ; None ; 7.576 ns ;
; N/A ; 120.70 MHz ( period = 8.285 ns ) ; cnt_delay[2] ; cnt_delay[8] ; clk ; clk ; None ; None ; 7.576 ns ;
; N/A ; 121.17 MHz ( period = 8.253 ns ) ; cnt_delay[6] ; cnt_delay[17] ; clk ; clk ; None ; None ; 7.544 ns ;
; N/A ; 121.73 MHz ( period = 8.215 ns ) ; state_rec[2] ; rxd_buf[1] ; clk ; clk ; None ; None ; 7.506 ns ;
; N/A ; 122.23 MHz ( period = 8.181 ns ) ; cnt_delay[5] ; cnt_delay[9] ; clk ; clk ; None ; None ; 7.472 ns ;
; N/A ; 122.29 MHz ( period = 8.177 ns ) ; cnt_delay[0] ; cnt_delay[12] ; clk ; clk ; None ; None ; 7.468 ns ;
; N/A ; 122.71 MHz ( period = 8.149 ns ) ; cnt_delay[5] ; cnt_delay[17] ; clk ; clk ; None ; None ; 7.440 ns ;
; N/A ; 122.71 MHz ( period = 8.149 ns ) ; cnt_delay[4] ; cnt_delay[19] ; clk ; clk ; None ; None ; 7.440 ns ;
; N/A ; 122.74 MHz ( period = 8.147 ns ) ; cnt_delay[1] ; cnt_delay[17] ; clk ; clk ; None ; None ; 7.438 ns ;
; N/A ; 122.79 MHz ( period = 8.144 ns ) ; cnt_delay[0] ; cnt_delay[18] ; clk ; clk ; None ; None ; 7.435 ns ;
; N/A ; 122.88 MHz ( period = 8.138 ns ) ; cnt_delay[4] ; cnt_delay[9] ; clk ; clk ; None ; None ; 7.429 ns ;
; N/A ; 122.91 MHz ( period = 8.136 ns ) ; cnt_delay[0] ; cnt_delay[13] ; clk ; clk ; None ; None ; 7.427 ns ;
; N/A ; 123.06 MHz ( period = 8.126 ns ) ; cnt_delay[6] ; cnt_delay[12] ; clk ; clk ; None ; None ; 7.417 ns ;
; N/A ; 123.23 MHz ( period = 8.115 ns ) ; cnt_delay[4] ; cnt_delay[8] ; clk ; clk ; None ; None ; 7.406 ns ;
; N/A ; 123.56 MHz ( period = 8.093 ns ) ; cnt_delay[6] ; cnt_delay[18] ; clk ; clk ; None ; None ; 7.384 ns ;
; N/A ; 123.59 MHz ( period = 8.091 ns ) ; div8_tras_reg[2] ; txd_buf[6] ; clk ; clk ; None ; None ; 7.382 ns ;
; N/A ; 123.59 MHz ( period = 8.091 ns ) ; div8_tras_reg[2] ; txd_buf[5] ; clk ; clk ; None ; None ; 7.382 ns ;
; N/A ; 123.59 MHz ( period = 8.091 ns ) ; div8_tras_reg[2] ; txd_buf[1] ; clk ; clk ; None ; None ; 7.382 ns ;
; N/A ; 123.61 MHz ( period = 8.090 ns ) ; cnt_delay[3] ; start_delaycnt ; clk ; clk ; None ; None ; 7.381 ns ;
; N/A ; 123.66 MHz ( period = 8.087 ns ) ; cnt_delay[2] ; cnt_delay[17] ; clk ; clk ; None ; None ; 7.378 ns ;
; N/A ; 123.69 MHz ( period = 8.085 ns ) ; cnt_delay[6] ; cnt_delay[13] ; clk ; clk ; None ; None ; 7.376 ns ;
; N/A ; 123.82 MHz ( period = 8.076 ns ) ; div8_rec_reg[2] ; rxd_buf[1] ; clk ; clk ; None ; None ; 7.367 ns ;
; N/A ; 124.13 MHz ( period = 8.056 ns ) ; cnt_delay[3] ; cnt_delay[17] ; clk ; clk ; None ; None ; 7.347 ns ;
; N/A ; 124.66 MHz ( period = 8.022 ns ) ; cnt_delay[5] ; cnt_delay[12] ; clk ; clk ; None ; None ; 7.313 ns ;
; N/A ; 124.69 MHz ( period = 8.020 ns ) ; cnt_delay[1] ; cnt_delay[12] ; clk ; clk ; None ; None ; 7.311 ns ;
; N/A ; 124.89 MHz ( period = 8.007 ns ) ; cnt_delay[15] ; cnt_delay[0] ; clk ; clk ; None ; None ; 7.298 ns ;
; N/A ; 124.91 MHz ( period = 8.006 ns ) ; cnt_delay[0] ; cnt_delay[10] ; clk ; clk ; None ; None ; 7.297 ns ;
; N/A ; 125.16 MHz ( period = 7.990 ns ) ; div8_tras_reg[0] ; txd_buf[6] ; clk ; clk ; None ; None ; 7.281 ns ;
; N/A ; 125.16 MHz ( period = 7.990 ns ) ; div8_tras_reg[0] ; txd_buf[5] ; clk ; clk ; None ; None ; 7.281 ns ;
; N/A ; 125.16 MHz ( period = 7.990 ns ) ; div8_tras_reg[0] ; txd_buf[1] ; clk ; clk ; None ; None ; 7.281 ns ;
; N/A ; 125.17 MHz ( period = 7.989 ns ) ; cnt_delay[5] ; cnt_delay[18] ; clk ; clk ; None ; None ; 7.280 ns ;
; N/A ; 125.20 MHz ( period = 7.987 ns ) ; cnt_delay[1] ; cnt_delay[18] ; clk ; clk ; None ; None ; 7.278 ns ;
; N/A ; 125.30 MHz ( period = 7.981 ns ) ; cnt_delay[5] ; cnt_delay[13] ; clk ; clk ; None ; None ; 7.272 ns ;
; N/A ; 125.33 MHz ( period = 7.979 ns ) ; cnt_delay[1] ; cnt_delay[13] ; clk ; clk ; None ; None ; 7.270 ns ;
; N/A ; 125.63 MHz ( period = 7.960 ns ) ; cnt_delay[2] ; cnt_delay[12] ; clk ; clk ; None ; None ; 7.251 ns ;
; N/A ; 125.71 MHz ( period = 7.955 ns ) ; cnt_delay[6] ; cnt_delay[10] ; clk ; clk ; None ; None ; 7.246 ns ;
; N/A ; 126.10 MHz ( period = 7.930 ns ) ; cnt_delay[15] ; key_entry1 ; clk ; clk ; None ; None ; 7.221 ns ;
; N/A ; 126.12 MHz ( period = 7.929 ns ) ; cnt_delay[3] ; cnt_delay[12] ; clk ; clk ; None ; None ; 7.220 ns ;
; N/A ; 126.15 MHz ( period = 7.927 ns ) ; cnt_delay[2] ; cnt_delay[18] ; clk ; clk ; None ; None ; 7.218 ns ;
; N/A ; 126.28 MHz ( period = 7.919 ns ) ; cnt_delay[2] ; cnt_delay[13] ; clk ; clk ; None ; None ; 7.210 ns ;
; N/A ; 126.47 MHz ( period = 7.907 ns ) ; cnt_delay[6] ; start_delaycnt ; clk ; clk ; None ; None ; 7.198 ns ;
; N/A ; 126.52 MHz ( period = 7.904 ns ) ; cnt_delay[7] ; cnt_delay[9] ; clk ; clk ; None ; None ; 7.195 ns ;
; N/A ; 126.65 MHz ( period = 7.896 ns ) ; cnt_delay[4] ; cnt_delay[17] ; clk ; clk ; None ; None ; 7.187 ns ;
; N/A ; 126.65 MHz ( period = 7.896 ns ) ; cnt_delay[3] ; cnt_delay[18] ; clk ; clk ; None ; None ; 7.187 ns ;
; N/A ; 126.65 MHz ( period = 7.896 ns ) ; state_tras[1] ; key_entry2 ; clk ; clk ; None ; None ; 7.187 ns ;
; N/A ; 126.76 MHz ( period = 7.889 ns ) ; cnt_delay[7] ; start_delaycnt ; clk ; clk ; None ; None ; 7.180 ns ;
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