📄 led_seg7.fit.rpt
字号:
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+------------------------+----------------------+-------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Fast Output Connection ; Location assigned by ; Load ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+------------------------+----------------------+-------+
; sm_cs1_n ; 100 ; 2 ; 2 ; 5 ; 2 ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 16mA ; no ; User ; 10 pF ;
; sm_cs2_n ; 99 ; 2 ; 2 ; 5 ; 1 ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 16mA ; no ; User ; 10 pF ;
; sm_db[0] ; 2 ; 1 ; 1 ; 4 ; 0 ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 16mA ; yes ; User ; 10 pF ;
; sm_db[1] ; 1 ; 2 ; 2 ; 5 ; 3 ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 16mA ; yes ; User ; 10 pF ;
; sm_db[2] ; 7 ; 1 ; 1 ; 3 ; 1 ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 16mA ; no ; User ; 10 pF ;
; sm_db[3] ; 6 ; 1 ; 1 ; 3 ; 0 ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 16mA ; no ; User ; 10 pF ;
; sm_db[4] ; 5 ; 1 ; 1 ; 4 ; 3 ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 16mA ; yes ; User ; 10 pF ;
; sm_db[5] ; 3 ; 1 ; 1 ; 4 ; 1 ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 16mA ; no ; User ; 10 pF ;
; sm_db[6] ; 4 ; 1 ; 1 ; 4 ; 2 ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 16mA ; no ; User ; 10 pF ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+------------------------+----------------------+-------+
+-----------------------------------------------------------+
; I/O Bank Usage ;
+----------+-----------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+-----------------+---------------+--------------+
; 1 ; 8 / 38 ( 21 % ) ; 3.3V ; -- ;
; 2 ; 3 / 42 ( 7 % ) ; 3.3V ; -- ;
+----------+-----------------+---------------+--------------+
+----------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; 1 ; 83 ; 2 ; sm_db[1] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 2 ; 0 ; 1 ; sm_db[0] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 3 ; 1 ; 1 ; sm_db[5] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 4 ; 2 ; 1 ; sm_db[6] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 5 ; 3 ; 1 ; sm_db[4] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 6 ; 4 ; 1 ; sm_db[3] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 7 ; 5 ; 1 ; sm_db[2] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 8 ; 6 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 9 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 10 ; ; ; GNDIO ; gnd ; ; ; -- ; ; -- ; -- ;
; 11 ; ; ; GNDINT ; gnd ; ; ; -- ; ; -- ; -- ;
; 12 ; 7 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 13 ; ; ; VCCINT ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 14 ; 8 ; 1 ; clk ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 15 ; 9 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 16 ; 10 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 17 ; 11 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 18 ; 12 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 19 ; 13 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 20 ; 14 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 21 ; 15 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 22 ; 16 ; 1 ; #TMS ; input ; ; ; -- ; ; -- ; -- ;
; 23 ; 17 ; 1 ; #TDI ; input ; ; ; -- ; ; -- ; -- ;
; 24 ; 18 ; 1 ; #TCK ; input ; ; ; -- ; ; -- ; -- ;
; 25 ; 19 ; 1 ; #TDO ; output ; ; ; -- ; ; -- ; -- ;
; 26 ; 20 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 27 ; 21 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 28 ; 22 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 29 ; 23 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 30 ; 24 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 31 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 32 ; ; ; GNDIO ; gnd ; ; ; -- ; ; -- ; -- ;
; 33 ; 25 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 34 ; 26 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 35 ; 27 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 36 ; 28 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 37 ; 29 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 38 ; 30 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 39 ; 31 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 40 ; 32 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 41 ; 33 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 42 ; 34 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 43 ; 35 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 44 ; 36 ; 1 ; rst_n ; input ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 45 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 46 ; ; ; GNDIO ; gnd ; ; ; -- ; ; -- ; -- ;
; 47 ; 37 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 48 ; 38 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 49 ; 39 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 50 ; 40 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 51 ; 41 ; 1 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 52 ; 42 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 53 ; 43 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 54 ; 44 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 55 ; 45 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 56 ; 46 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 57 ; 47 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 58 ; 48 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 59 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 60 ; ; ; GNDIO ; gnd ; ; ; -- ; ; -- ; -- ;
; 61 ; 49 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 62 ; 50 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 63 ; ; ; VCCINT ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 64 ; 51 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 65 ; ; ; GNDINT ; gnd ; ; ; -- ; ; -- ; -- ;
; 66 ; 52 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 67 ; 53 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 68 ; 54 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 69 ; 55 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 70 ; 56 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 71 ; 57 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 72 ; 58 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 73 ; 59 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 74 ; 60 ; 2 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 75 ; 61 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 76 ; 62 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 77 ; 63 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 78 ; 64 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 79 ; ; ; GNDIO ; gnd ; ; ; -- ; ; -- ; -- ;
; 80 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 81 ; 65 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 82 ; 66 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 83 ; 67 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 84 ; 68 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 85 ; 69 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 86 ; 70 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 87 ; 71 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 88 ; 72 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 89 ; 73 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 90 ; 74 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 91 ; 75 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 92 ; 76 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 93 ; ; ; GNDIO ; gnd ; ; ; -- ; ; -- ; -- ;
; 94 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 95 ; 77 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 96 ; 78 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 97 ; 79 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 98 ; 80 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 99 ; 81 ; 2 ; sm_cs2_n ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 100 ; 82 ; 2 ; sm_cs1_n ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+----------+--------------+
+-------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+----------------------------+-------+------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+----------------------------+-------+------------------------+
; 3.3-V LVTTL ; 10 pF ; Not Available ;
; 3.3-V LVCMOS ; 10 pF ; Not Available ;
; 2.5 V ; 10 pF ; Not Available ;
; 1.8 V ; 10 pF ; Not Available ;
; 1.5 V ; 10 pF ; Not Available ;
; 3.3V Schmitt Trigger Input ; 10 pF ; Not Available ;
; 2.5V Schmitt Trigger Input ; 10 pF ; Not Available ;
+----------------------------+-------+------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+-------------+--------------+------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+---------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; UFM Blocks ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Packed LCs ; Full Hierarchy Name ;
+----------------------------+-------------+--------------+------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+---------------------+
; |led_seg7 ; 45 (45) ; 29 ; 0 ; 11 ; 0 ; 16 (16) ; 0 (0) ; 29 (29) ; 24 (24) ; 0 (0) ; |led_seg7 ;
+----------------------------+-------------+--------------+------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+---------------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+-------------------------------------+
; Delay Chain Summary ;
+----------+----------+---------------+
; Name ; Pin Type ; Pad to Core 0 ;
+----------+----------+---------------+
; clk ; Input ; 0 ;
; rst_n ; Input ; 1 ;
; sm_cs1_n ; Output ; -- ;
; sm_cs2_n ; Output ; -- ;
; sm_db[0] ; Output ; -- ;
; sm_db[1] ; Output ; -- ;
; sm_db[2] ; Output ; -- ;
; sm_db[3] ; Output ; -- ;
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