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来自「system C源码 一种替代verilog的语言」· 代码 · 共 21 行

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Input source name = test.m0x000000000x000000000x000000000x000000000x000000000x01010203	/* add R1, R2, R3 */0x000000000x0202030e	/* addi R2, R3, 14 */0x000000000x04040506	/* sub R4, R5, R6 */0x000000000x0504051c	/* subi R4, R5, 28 */0x000000000x07010204	/* mul R1, R2, R4 */0x000000000x090a0d0f	/* nand R10, R13, R15 */0x00000000	/* lw  R11, R0, 1 */0x00000000

program - 源码说明

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