max3490.tan.rpt
来自「用VERILOG语言写的RS485通信程序,经调试可以直接使用」· RPT 代码 · 共 289 行 · 第 1/5 页
RPT
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; N/A ; 211.86 MHz ( period = 4.720 ns ) ; rs232tx:m2|prescaler_count_l[1] ; rs232tx:m2|tx_bit_count_l[3] ; clk ; clk ; None ; None ; 4.450 ns ;
; N/A ; 212.27 MHz ( period = 4.711 ns ) ; DISPLAY:m4|clk_div_counter[2] ; DISPLAY:m4|CH451_LOAD ; clk ; clk ; None ; None ; 4.450 ns ;
; N/A ; 212.27 MHz ( period = 4.711 ns ) ; DISPLAY:m4|clk_div_counter[2] ; DISPLAY:m4|shift_state.Pull_down_ch451_load ; clk ; clk ; None ; None ; 4.450 ns ;
; N/A ; 212.27 MHz ( period = 4.711 ns ) ; DISPLAY:m4|clk_div_counter[2] ; DISPLAY:m4|shift_state.Shift12_out_idle ; clk ; clk ; None ; None ; 4.450 ns ;
; N/A ; 212.36 MHz ( period = 4.709 ns ) ; DISPLAY:m4|state.CH451_Display ; DISPLAY:m4|CH451_cmd[3] ; clk ; clk ; None ; None ; 4.448 ns ;
; N/A ; 212.36 MHz ( period = 4.709 ns ) ; DISPLAY:m4|state.CH451_Display ; DISPLAY:m4|CH451_cmd[4] ; clk ; clk ; None ; None ; 4.448 ns ;
; N/A ; 212.36 MHz ( period = 4.709 ns ) ; DISPLAY:m4|state.CH451_Display ; DISPLAY:m4|CH451_cmd[5] ; clk ; clk ; None ; None ; 4.448 ns ;
; N/A ; 212.36 MHz ( period = 4.709 ns ) ; DISPLAY:m4|state.CH451_Display ; DISPLAY:m4|CH451_cmd[6] ; clk ; clk ; None ; None ; 4.448 ns ;
; N/A ; 212.49 MHz ( period = 4.706 ns ) ; rs232tx:m2|prescaler_count_l[0] ; rs232tx:m2|q[1] ; clk ; clk ; None ; None ; 4.447 ns ;
; N/A ; 212.49 MHz ( period = 4.706 ns ) ; counter3[8] ; state.MAX3490_delay ; clk ; clk ; None ; None ; 4.447 ns ;
; N/A ; 212.54 MHz ( period = 4.705 ns ) ; rs232tx:m2|prescaler_count_l[0] ; rs232tx:m2|q[4] ; clk ; clk ; None ; None ; 4.446 ns ;
; N/A ; 212.59 MHz ( period = 4.704 ns ) ; clock_gen_select:m3|dds_phase[5] ; state.MAX3490_start ; clk ; clk ; None ; None ; 4.445 ns ;
; N/A ; 212.63 MHz ( period = 4.703 ns ) ; rs232tx:m2|prescaler_count_l[0] ; rs232tx:m2|q[3] ; clk ; clk ; None ; None ; 4.444 ns ;
; N/A ; 212.72 MHz ( period = 4.701 ns ) ; rs232tx:m2|prescaler_count_l[0] ; rs232tx:m2|q[2] ; clk ; clk ; None ; None ; 4.442 ns ;
; N/A ; 212.72 MHz ( period = 4.701 ns ) ; counter4[5] ; state.MAX3490_idle ; clk ; clk ; None ; None ; 4.428 ns ;
; N/A ; 212.99 MHz ( period = 4.695 ns ) ; DISPLAY:m4|transfer_count[0] ; DISPLAY:m4|display_data[2] ; clk ; clk ; None ; None ; 4.414 ns ;
; N/A ; 212.99 MHz ( period = 4.695 ns ) ; DISPLAY:m4|transfer_count[0] ; DISPLAY:m4|display_data[5] ; clk ; clk ; None ; None ; 4.414 ns ;
; N/A ; 212.99 MHz ( period = 4.695 ns ) ; DISPLAY:m4|transfer_count[0] ; DISPLAY:m4|display_data[6] ; clk ; clk ; None ; None ; 4.414 ns ;
; N/A ; 212.99 MHz ( period = 4.695 ns ) ; DISPLAY:m4|transfer_count[0] ; DISPLAY:m4|display_data[26] ; clk ; clk ; None ; None ; 4.414 ns ;
; N/A ; 212.99 MHz ( period = 4.695 ns ) ; DISPLAY:m4|transfer_count[0] ; DISPLAY:m4|display_data[30] ; clk ; clk ; None ; None ; 4.414 ns ;
; N/A ; 213.31 MHz ( period = 4.688 ns ) ; counter4[7] ; state.MAX3490_idle ; clk ; clk ; None ; None ; 4.415 ns ;
; N/A ; 213.36 MHz ( period = 4.687 ns ) ; DISPLAY:m4|transfer_count[0] ; DISPLAY:m4|display_data[25] ; clk ; clk ; None ; None ; 4.406 ns ;
; N/A ; 213.36 MHz ( period = 4.687 ns ) ; DISPLAY:m4|transfer_count[0] ; DISPLAY:m4|display_data[29] ; clk ; clk ; None ; None ; 4.406 ns ;
; N/A ; 213.58 MHz ( period = 4.682 ns ) ; clock_gen_select:m3|dds_phase[5] ; rs232rx:m1|q[9] ; clk ; clk ; None ; None ; 4.452 ns ;
; N/A ; 213.58 MHz ( period = 4.682 ns ) ; clock_gen_select:m3|dds_phase[5] ; rs232rx:m1|q[8] ; clk ; clk ; None ; None ; 4.452 ns ;
; N/A ; 213.58 MHz ( period = 4.682 ns ) ; clock_gen_select:m3|dds_phase[5] ; rs232rx:m1|q[7] ; clk ; clk ; None ; None ; 4.452 ns ;
; N/A ; 213.58 MHz ( period = 4.682 ns ) ; clock_gen_select:m3|dds_phase[5] ; rs232rx:m1|q[6] ; clk ; clk ; None ; None ; 4.452 ns ;
; N/A ; 213.58 MHz ( period = 4.682 ns ) ; rs232tx:m2|tx_bit_count_l[0] ; rs232tx:m2|tx_bit_count_l[1] ; clk ; clk ; None ; None ; 4.421 ns ;
; N/A ; 213.63 MHz ( period = 4.681 ns ) ; DISPLAY:m4|clk_div_counter[2] ; DISPLAY:m4|CH451_DCLK ; clk ; clk ; None ; None ; 4.420 ns ;
; N/A ; 213.63 MHz ( period = 4.681 ns ) ; DISPLAY:m4|clk_div_counter[2] ; DISPLAY:m4|shift_state.Pull_up_ch451_dclk ; clk ; clk ; None ; None ; 4.420 ns ;
; N/A ; 213.63 MHz ( period = 4.681 ns ) ; DISPLAY:m4|clk_div_counter[2] ; DISPLAY:m4|shift_state.Pull_down_ch451_dclk ; clk ; clk ; None ; None ; 4.420 ns ;
; N/A ; 213.63 MHz ( period = 4.681 ns ) ; DISPLAY:m4|clk_div_counter[2] ; DISPLAY:m4|shift_state.Get_shift_out_data ; clk ; clk ; None ; None ; 4.420 ns ;
; N/A ; 213.63 MHz ( period = 4.681 ns ) ; DISPLAY:m4|clk_div_counter[2] ; DISPLAY:m4|shift_state.Shift_paralell_data ; clk ; clk ; None ; None ; 4.420 ns ;
; N/A ; 213.63 MHz ( period = 4.681 ns ) ; rs232tx:m2|tx_bit_count_l[0] ; rs232tx:m2|tx_bit_count_l[2] ; clk ; clk ; None ; None ; 4.420 ns ;
; N/A ; 213.77 MHz ( period = 4.678 ns ) ; rs232tx:m2|prescaler_count_l[0] ; rs232tx:m2|q[0] ; clk ; clk ; None ; None ; 4.419 ns ;
; N/A ; 213.77 MHz ( period = 4.678 ns ) ; rs232tx:m2|tx_bit_count_l[0] ; rs232tx:m2|tx_bit_count_l[0] ; clk ; clk ; None ; None ; 4.417 ns ;
; N/A ; 213.77 MHz ( period = 4.678 ns ) ; rs232tx:m2|prescaler_count_l[0] ; rs232tx:m2|q[8] ; clk ; clk ; None ; None ; 4.419 ns ;
; N/A ; 213.81 MHz ( period = 4.677 ns ) ; rs232tx:m2|tx_bit_count_l[0] ; rs232tx:m2|tx_bit_count_l[3] ; clk ; clk ; None ; None ; 4.416 ns ;
; N/A ; 213.90 MHz ( period = 4.675 ns ) ; DISPLAY:m4|clk_div_counter[1] ; DISPLAY:m4|display_data[2] ; clk ; clk ; None ; None ; 4.394 ns ;
; N/A ; 213.90 MHz ( period = 4.675 ns ) ; DISPLAY:m4|clk_div_counter[1] ; DISPLAY:m4|display_data[5] ; clk ; clk ; None ; None ; 4.394 ns ;
; N/A ; 213.90 MHz ( period = 4.675 ns ) ; DISPLAY:m4|clk_div_counter[1] ; DISPLAY:m4|display_data[6] ; clk ; clk ; None ; None ; 4.394 ns ;
; N/A ; 213.90 MHz ( period = 4.675 ns ) ; DISPLAY:m4|clk_div_counter[1] ; DISPLAY:m4|display_data[26] ; clk ; clk ; None ; None ; 4.394 ns ;
; N/A ; 213.90 MHz ( period = 4.675 ns ) ; DISPLAY:m4|clk_div_counter[1] ; DISPLAY:m4|display_data[30] ; clk ; clk ; None ; None ; 4.394 ns ;
; N/A ; 214.22 MHz ( period = 4.668 ns ) ; DISPLAY:m4|state.CH451_Display ; DISPLAY:m4|CH451_LOAD ; clk ; clk ; None ; None ; 4.407 ns ;
; N/A ; 214.22 MHz ( period = 4.668 ns ) ; DISPLAY:m4|state.CH451_Display ; DISPLAY:m4|shift_state.Pull_down_ch451_load ; clk ; clk ; None ; None ; 4.407 ns ;
; N/A ; 214.22 MHz ( period = 4.668 ns ) ; DISPLAY:m4|state.CH451_Display ; DISPLAY:m4|shift_state.Shift12_out_idle ; clk ; clk ; None ; None ; 4.407 ns ;
; N/A ; 214.27 MHz ( period = 4.667 ns ) ; DISPLAY:m4|clk_div_counter[1] ; DISPLAY:m4|display_data[25] ; clk ; clk ; None ; None ; 4.386 ns ;
; N/A ; 214.27 MHz ( period = 4.667 ns ) ; DISPLAY:m4|clk_div_counter[1] ; DISPLAY:m4|display_data[29] ; clk ; clk ; None ; None ; 4.386 ns ;
; N/A ; 214.41 MHz ( period = 4.664 ns ) ; rs232tx:m2|prescaler_count_l[0] ; state.MAX3490_start ; clk ; clk ; None ; None ; 4.405 ns ;
; N/A ; 214.68 MHz ( period = 4.658 ns ) ; DISPLAY:m4|transfer_count[0] ; DISPLAY:m4|display_data[0] ; clk ; clk ; None ; None ; 4.377 ns ;
; N/A ; 214.68 MHz ( period = 4.658 ns ) ; DISPLAY:m4|transfer_count[0] ; DISPLAY:m4|display_data[1] ; clk ; clk ; None ; None ; 4.377 ns ;
; N/A ; 214.68 MHz ( period = 4.658 ns ) ; DISPLAY:m4|transfer_count[0] ; DISPLAY:m4|display_data[4] ; clk ; clk ; None ; None ; 4.377 ns ;
; N/A ; 214.68 MHz ( period = 4.658 ns ) ; DISPLAY:m4|transfer_count[0] ; DISPLAY:m4|display_data[24] ; clk ; clk ; None ; None ; 4.377 ns ;
; N/A ; 214.68 MHz ( period = 4.658 ns ) ; DISPLAY:m4|transfer_count[0] ; DISPLAY:m4|display_data[28] ; clk ; clk ; None ; None ; 4.377 ns ;
; N/A ; 215.61 MHz ( period = 4.638 ns ) ; DISPLAY:m4|state.CH451_Display ; DISPLAY:m4|shift_state.Get_shift_out_data ; clk ; clk ; None ; None ; 4.377 ns ;
; N/A ; 215.61 MHz ( period = 4.638 ns ) ; DISPLAY:m4|state.CH451_Display ; DISPLAY:m4|shift_state.Shift_paralell_data ; clk ; clk ; None ; None ; 4.377 ns ;
; N/A ; 215.61 MHz ( period = 4.638 ns )
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