📄 counter2.fit.rpt
字号:
; Perform Physical Synthesis for Combinational Logic ; Off ; Off ;
; Perform Register Duplication ; Off ; Off ;
; Perform Register Retiming ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Logic Cell Insertion - Logic Duplication ; Auto ; Auto ;
; Auto Register Duplication ; Auto ; Auto ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
; Always Enable Input Buffers ; Off ; Off ;
+----------------------------------------------------+--------------------------------+--------------------------------+
Color Legend:
-- Green:
-- Package Resource: The HardCopy II package can be migrated from the Stratix II FPGA selected package, and the design has been fitted with the target device migration enabled.
-- Other Device Resources: The resource quantity is within the acceptable range in the HardCopy II device and package, and will likely migrate from the Stratix II FPGA selected package.
-- Orange:
-- Package Resource: The HardCopy II package can be migrated from the Stratix II FPGA selected package; however, the design has not been fitted with the target device migration enabled.
-- Other Device Resources: The resource quantity is within the acceptable range in the HardCopy II device and package; however, the resource is constrained so much that the design may not migrate.
-- Red:
-- Package Resource: The HardCopy II package cannot be migrated from the Stratix II FPGA selected package.
-- Other Device Resources: The design did not migrate because the resource quantity exceeds the acceptable range in the HardCopy II device and package, or, for other reasons detailed in the footnotes.
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; HardCopy II Device Resource Guide ;
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; Resource ; Stratix II EP2S60 ; HC210W ; HC210 ; HC220 ; HC220 ; HC230 ; HC240 ; HC240 ;
+---------------------------------+----------------------+--------------+--------------+--------------+--------------+---------------+---------------+---------------+
; Migration Compatibility ; ; None ; None ; Medium ; None ; None ; None ; None ;
; Primary Migration Constraint ; ; Package ; Package ; Package ; Package ; Package ; Package ; Package ;
; Package ; FBGA - 672 ; FBGA - 484 ; FBGA - 484 ; FBGA - 672 ; FBGA - 780 ; FBGA - 1020 ; FBGA - 1020 ; FBGA - 1508 ;
; Logic ; -- ; 1% ; 1% ; 1% ; 1% ; 1% ; 1% ; 1% ;
; -- Logic cells ; 19 ALUTs ; -- ; -- ; -- ; -- ; -- ; -- ; -- ;
; -- DSP elements ; 0 ; -- ; -- ; -- ; -- ; -- ; -- ; -- ;
; Pins ; ; ; ; ; ; ; ; ;
; -- Total ; 8 ; 8 / 309 ; 8 / 335 ; 8 / 493 ; 8 / 495 ; 8 / 699 ; 8 / 743 ; 8 / 952 ;
; -- Differential Input ; 0 ; 0 / 66 ; 0 / 70 ; 0 / 90 ; 0 / 90 ; 0 / 128 ; 0 / 224 ; 0 / 272 ;
; -- Differential Output ; 0 ; 0 / 44 ; 0 / 50 ; 0 / 70 ; 0 / 70 ; 0 / 112 ; 0 / 200 ; 0 / 256 ;
; -- PCI / PCI-X ; 0 ; 0 / 159 ; 0 / 166 ; 0 / 244 ; 0 / 246 ; 0 / 358 ; 0 / 366 ; 0 / 471 ;
; -- DQ ; 0 ; 0 / 20 ; 0 / 20 ; 0 / 50 ; 0 / 50 ; 0 / 204 ; 0 / 204 ; 0 / 204 ;
; -- DQS ; 0 ; 0 / 8 ; 0 / 8 ; 0 / 18 ; 0 / 18 ; 0 / 72 ; 0 / 72 ; 0 / 72 ;
; Memory ; ; ; ; ; ; ; ; ;
; -- M-RAM ; 0 ; 0 / 0 ; 0 / 0 ; 0 / 2 ; 0 / 2 ; 0 / 6 ; 0 / 9 ; 0 / 9 ;
; -- M4K blocks & M512 blocks ; 0 ; 0 / 190 ; 0 / 190 ; 0 / 408 ; 0 / 408 ; 0 / 614 ; 0 / 816 ; 0 / 816 ;
; PLLs ; ; ; ; ; ; ; ; ;
; -- Enhanced ; 0 ; 0 / 2 ; 0 / 2 ; 0 / 2 ; 0 / 2 ; 0 / 4 ; 0 / 4 ; 0 / 4 ;
; -- Fast ; 0 ; 0 / 2 ; 0 / 2 ; 0 / 2 ; 0 / 2 ; 0 / 4 ; 0 / 8 ; 0 / 8 ;
; DLLs ; 0 ; 0 / 1 ; 0 / 1 ; 0 / 1 ; 0 / 1 ; 0 / 2 ; 0 / 2 ; 0 / 2 ;
; SERDES ; ; ; ; ; ; ; ; ;
; -- RX ; 0 ; 0 / 17 ; 0 / 21 ; 0 / 31 ; 0 / 31 ; 0 / 46 ; 0 / 92 ; 0 / 116 ;
; -- TX ; 0 ; 0 / 18 ; 0 / 19 ; 0 / 29 ; 0 / 29 ; 0 / 44 ; 0 / 88 ; 0 / 116 ;
; Configuration ; ; ; ; ; ; ; ; ;
; -- CRC ; 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ;
; -- ASMI ; 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ;
; -- Remote Update ; 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ;
; -- JTAG ; 0 ; 0 / 1 ; 0 / 1 ; 0 / 1 ; 0 / 1 ; 0 / 1 ; 0 / 1 ; 0 / 1 ;
+---------------------------------+----------------------+--------------+--------------+--------------+--------------+---------------+---------------+---------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in F:/liangshuo程序/1/fen_zu_interlacing/counter2/counter2.pin.
+------------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+------------------------------------------------+-----------------------+
; Resource ; Usage ;
+------------------------------------------------+-----------------------+
; Total ALUTs ; 19 / 48,352 ( < 1 % ) ;
; -- ALUTs Used ; 18 ;
; -- Combinational with no register ; 7 ;
; -- Register only ; 0 ;
; -- Combinational with a register ; 11 ;
; -- ALUTs Unavailable ; 1 ;
; -- Due to unpartnered 7 input function ; 0 ;
; -- Due to unpartnered 6 input function ; 1 ;
; ; ;
; ALUT usage by number of inputs ; ;
; -- 7 input functions ; 0 ;
; -- 6 input functions ; 1 ;
; -- 5 input functions ; 4 ;
; -- 4 input functions ; 0 ;
; -- <=3 input functions ; 13 ;
; -- Register only ; 0 ;
; ; ;
; ALUTs without a partner ; 2 ;
; -- unpartnered 7 input functions ; 0 / 0 ( 0 % ) ;
; -- unpartnered 6 input functions ; 1 / 1 ( 100 % ) ;
; -- unpartnered 5 input functions ; 0 / 4 ( 0 % ) ;
; -- unpartnered 4 input functions ; 0 / 0 ( 0 % ) ;
; -- unpartnered <=3 input functions ; 1 / 13 ( 8 % ) ;
; -- Unpartnered registers only ; 0 / 11 ( 0 % ) ;
; ; ;
; ALUTs by mode ; ;
; -- normal mode ; 7 ;
; -- extended LUT mode ; 0 ;
; -- arithmetic mode ; 11 ;
; -- shared arithmetic mode ; 0 ;
; ; ;
; Total registers ; 11 / 51,182 ( < 1 % ) ;
; ALMs: partially or completely used ; 10 / 24,176 ( < 1 % ) ;
; Total LABs ; 2 / 3,022 ( < 1 % ) ;
; User inserted logic elements ; 0 ;
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