📄 led.fit.rpt
字号:
; 114 ; 94 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 115 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 116 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 117 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 118 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 119 ; 95 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 120 ; 96 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 121 ; 97 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 122 ; 98 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 123 ; 99 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 124 ; 100 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 125 ; 101 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 126 ; 102 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 127 ; 103 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 128 ; 104 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 129 ; 105 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 130 ; 106 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 131 ; 107 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 132 ; 108 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 133 ; 109 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 134 ; 110 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 135 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 136 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 137 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 138 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 139 ; 111 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 140 ; 112 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 141 ; 113 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 142 ; 114 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 143 ; 115 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
; 144 ; 116 ; 2 ; RESERVED_INPUT ; ; ; ; Column I/O ; ; no ; Off ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+----------+--------------+
Note: Pin directions (input, output or bidir) are based on device operating in user mode.
+------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+---------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+---------------------+-------+------------------------------------+
; 3.3-V LVTTL ; 10 pF ; Not Available ;
; 3.3-V LVCMOS ; 10 pF ; Not Available ;
; 2.5 V ; 10 pF ; Not Available ;
; 1.8 V ; 10 pF ; Not Available ;
; 1.5 V ; 10 pF ; Not Available ;
; SSTL-3 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-3 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; Differential SSTL-2 ; 10 pF ; (See SSTL-2) ;
; LVDS ; 4 pF ; 100 Ohm (Differential) ;
; RSDS ; 10 pF ; 100 Ohm (Differential) ;
+---------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+------------------------------------------------------------------------------------------------------+-------------+--------------+-------------+------+------+--------------+--------------+-------------------+------------------+-----------------+------------+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+--------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; M4Ks ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Packed LCs ; Full Hierarchy Name ; Library Name ;
+------------------------------------------------------------------------------------------------------+-------------+--------------+-------------+------+------+--------------+--------------+-------------------+------------------+-----------------+------------+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+--------------+
; |Block1 ; 1724 (1) ; 1088 ; 56320 ; 120 ; 51 ; 0 ; 636 (1) ; 293 (0) ; 795 (0) ; 179 (0) ; 80 (0) ; |Block1 ; work ;
; |LCD:inst3| ; 993 (1) ; 535 ; 21504 ; 52 ; 0 ; 0 ; 458 (1) ; 56 (0) ; 479 (0) ; 91 (0) ; 53 (0) ; |Block1|LCD:inst3 ; work ;
; |Data:the_Data| ; 13 (13) ; 8 ; 0 ; 0 ; 0 ; 0 ; 5 (5) ; 8 (8) ; 0 (0) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|Data:the_Data ; work ;
; |EN:the_EN| ; 1 (1) ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|EN:the_EN ; work ;
; |EN_s1_arbitrator:the_EN_s1| ; 2 (2) ; 0 ; 0 ; 0 ; 0 ; 0 ; 2 (2) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|EN_s1_arbitrator:the_EN_s1 ; work ;
; |LCD_reset_clk_domain_synch_module:LCD_reset_clk_domain_synch| ; 2 (2) ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 2 (2) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|LCD_reset_clk_domain_synch_module:LCD_reset_clk_domain_synch ; work ;
; |RS:the_RS| ; 2 (2) ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|RS:the_RS ; work ;
; |RW:the_RW| ; 2 (2) ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|RW:the_RW ; work ;
; |cpu:the_cpu| ; 840 (580) ; 471 ; 9216 ; 36 ; 0 ; 0 ; 369 (284) ; 37 (0) ; 434 (296) ; 91 (82) ; 27 (17) ; |Block1|LCD:inst3|cpu:the_cpu ; work ;
; |cpu_nios2_oci:the_cpu_nios2_oci| ; 259 (7) ; 174 ; 8192 ; 4 ; 0 ; 0 ; 85 (7) ; 37 (0) ; 137 (0) ; 9 (0) ; 10 (0) ; |Block1|LCD:inst3|cpu:the_cpu|cpu_nios2_oci:the_cpu_nios2_oci ; work ;
; |cpu_jtag_debug_module_wrapper:the_cpu_jtag_debug_module_wrapper| ; 151 (0) ; 90 ; 0 ; 0 ; 0 ; 0 ; 61 (0) ; 37 (0) ; 53 (0) ; 0 (0) ; 5 (0) ; |Block1|LCD:inst3|cpu:the_cpu|cpu_nios2_oci:the_cpu_nios2_oci|cpu_jtag_debug_module_wrapper:the_cpu_jtag_debug_module_wrapper ; work ;
; |cpu_jtag_debug_module:the_cpu_jtag_debug_module1| ; 151 (151) ; 90 ; 0 ; 0 ; 0 ; 0 ; 61 (61) ; 37 (37) ; 53 (53) ; 0 (0) ; 5 (5) ; |Block1|LCD:inst3|cpu:the_cpu|cpu_nios2_oci:the_cpu_nios2_oci|cpu_jtag_debug_module_wrapper:the_cpu_jtag_debug_module_wrapper|cpu_jtag_debug_module:the_cpu_jtag_debug_module1 ; work ;
; |cpu_nios2_avalon_reg:the_cpu_nios2_avalon_reg| ; 5 (5) ; 1 ; 0 ; 0 ; 0 ; 0 ; 4 (4) ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|cpu:the_cpu|cpu_nios2_oci:the_cpu_nios2_oci|cpu_nios2_avalon_reg:the_cpu_nios2_avalon_reg ; work ;
; |cpu_nios2_oci_break:the_cpu_nios2_oci_break| ; 33 (33) ; 32 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 32 (32) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|cpu:the_cpu|cpu_nios2_oci:the_cpu_nios2_oci|cpu_nios2_oci_break:the_cpu_nios2_oci_break ; work ;
; |cpu_nios2_oci_debug:the_cpu_nios2_oci_debug| ; 9 (9) ; 7 ; 0 ; 0 ; 0 ; 0 ; 2 (2) ; 0 (0) ; 7 (7) ; 0 (0) ; 3 (3) ; |Block1|LCD:inst3|cpu:the_cpu|cpu_nios2_oci:the_cpu_nios2_oci|cpu_nios2_oci_debug:the_cpu_nios2_oci_debug ; work ;
; |cpu_nios2_ocimem:the_cpu_nios2_ocimem| ; 54 (54) ; 44 ; 8192 ; 4 ; 0 ; 0 ; 10 (10) ; 0 (0) ; 44 (44) ; 9 (9) ; 2 (2) ; |Block1|LCD:inst3|cpu:the_cpu|cpu_nios2_oci:the_cpu_nios2_oci|cpu_nios2_ocimem:the_cpu_nios2_ocimem ; work ;
; |cpu_ociram_lpm_dram_bdp_component_module:cpu_ociram_lpm_dram_bdp_component| ; 0 (0) ; 0 ; 8192 ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|cpu:the_cpu|cpu_nios2_oci:the_cpu_nios2_oci|cpu_nios2_ocimem:the_cpu_nios2_ocimem|cpu_ociram_lpm_dram_bdp_component_module:cpu_ociram_lpm_dram_bdp_component ; work ;
; |altsyncram:the_altsyncram| ; 0 (0) ; 0 ; 8192 ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|cpu:the_cpu|cpu_nios2_oci:the_cpu_nios2_oci|cpu_nios2_ocimem:the_cpu_nios2_ocimem|cpu_ociram_lpm_dram_bdp_component_module:cpu_ociram_lpm_dram_bdp_component|altsyncram:the_altsyncram ; work ;
; |altsyncram_bp62:auto_generated| ; 0 (0) ; 0 ; 8192 ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|cpu:the_cpu|cpu_nios2_oci:the_cpu_nios2_oci|cpu_nios2_ocimem:the_cpu_nios2_ocimem|cpu_ociram_lpm_dram_bdp_component_module:cpu_ociram_lpm_dram_bdp_component|altsyncram:the_altsyncram|altsyncram_bp62:auto_generated ; work ;
; |cpu_rf_module:cpu_rf| ; 0 (0) ; 0 ; 1024 ; 32 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|cpu:the_cpu|cpu_rf_module:cpu_rf ; work ;
; |altsyncram:the_altsyncram| ; 0 (0) ; 0 ; 1024 ; 32 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|cpu:the_cpu|cpu_rf_module:cpu_rf|altsyncram:the_altsyncram ; work ;
; |altsyncram_0922:auto_generated| ; 0 (0) ; 0 ; 1024 ; 32 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |Block1|LCD:inst3|cpu:the_cpu|cpu_rf_module:cpu_rf|altsyncram:the_altsyncram|altsyncram_0922:auto_generated ⌨️ 快捷键说明
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