📄 multi_8x8.fit.rpt
字号:
+-----------------+---------+---------+--------+
+---------------------------------------------+
; Carry Chains ;
+--------------------+------------------------+
; Carry Chain Length ; Number of Carry Chains ;
+--------------------+------------------------+
; 0 ; 0 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 1 ;
; 5 ; 1 ;
; 6 ; 0 ;
; 7 ; 2 ;
; 8 ; 0 ;
; 9 ; 1 ;
+--------------------+------------------------+
+----------------------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals ;
+------------------------------------------------------------------------------------+---------+
; Name ; Fan-Out ;
+------------------------------------------------------------------------------------+---------+
; B_BCD:u11|reduce_nor~27 ; 37 ;
; clr ; 26 ;
; reg_16:u10|cout~4 ; 17 ;
; reg_16:u10|reduce_nor~20 ; 17 ;
; start ; 13 ;
; cnt10:u1|cqi[0]~95 ; 11 ;
; cnt10:u3|cqi[0]~95 ; 11 ;
; cnt10:u3|cqi[2]~97 ; 10 ;
; cnt10:u1|cqi[2]~97 ; 10 ;
; cnt10:u1|cqi[1]~96 ; 9 ;
; cnt10:u3|cqi[1]~96 ; 9 ;
; cnt10:u3|cqi[3]~98 ; 8 ;
; reg_8:u7|reg8[0]~36 ; 8 ;
; cnt10:u1|cqi[3]~98 ; 8 ;
; cnt10:u4|cqi[0]~98 ; 6 ;
; cnt10:u2|cqi[0]~98 ; 6 ;
; cnt10:u4|cqi[1]~99 ; 5 ;
; cnt10:u2|cqi[2]~100 ; 5 ;
; cnt10:u2|cqi[1]~99 ; 5 ;
; B_BCD:u11|out_a[11]~2870 ; 5 ;
; B_BCD:u11|out_a[7]~2866 ; 5 ;
; B_BCD:u11|lpm_counter:i_rtl_0|alt_counter_f10ke:wysi_counter|q[4]~0 ; 5 ;
; B_BCD:u11|out_a[3]~2862 ; 5 ;
; cnt10:u4|cqi[2]~100 ; 5 ;
; B_BCD:u11|out_a~2876 ; 4 ;
; reg_16:u10|lpm_counter:i_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[3]~54 ; 4 ;
; clk_a1 ; 4 ;
; B_BCD:u11|out_a~2878 ; 4 ;
; B_BCD:u11|out_a[12]~2871 ; 4 ;
; B_BCD:u11|out_a~2877 ; 4 ;
; B_BCD:u11|out_a[8]~2867 ; 4 ;
; cnt10:u2|cqi[3]~101 ; 4 ;
; B_BCD:u11|out_a[4]~2863 ; 4 ;
; B_BCD:u11|in_a[15]~23 ; 4 ;
; clk_b0 ; 4 ;
; B_BCD:u11|out_a[0]~2859 ; 4 ;
; clk_a0 ; 4 ;
; clk_b1 ; 4 ;
; cnt10:u4|cqi[3]~101 ; 4 ;
; B_BCD:u11|out_a~2875 ; 4 ;
; B_BCD:u11|add~302 ; 4 ;
; B_BCD:u11|out_a[14]~2873 ; 3 ;
; B_BCD:u11|out_a[13]~2872 ; 3 ;
; B_BCD:u11|out_a[10]~2869 ; 3 ;
; reg_16:u10|lpm_counter:i_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[0]~COUT ; 3 ;
; B_BCD:u11|lpm_counter:i_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[1]~COUT ; 3 ;
; reg_16:u10|lpm_counter:i_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[2]~COUT ; 3 ;
; reg_16:u10|lpm_counter:i_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[1]~COUT ; 3 ;
; B_BCD:u11|lpm_counter:i_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[0]~COUT ; 3 ;
; B_BCD:u11|out_a[9]~2868 ; 3 ;
+------------------------------------------------------------------------------------+---------+
+-------------------------------------------------------------------------------------------------------------------+
; Peripheral Signals ;
+-------------------+---------+----------------------------+-----------------+---------------------------+----------+
; Peripheral Signal ; Source ; Usage ; Dedicated Clock ; Peripheral Control Signal ; Polarity ;
+-------------------+---------+----------------------------+-----------------+---------------------------+----------+
; reg_16:u10|cout ; LC1_E13 ; Async. clear / Async. load ; no ; yes ; +ve ;
+-------------------+---------+----------------------------+-----------------+---------------------------+----------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 186 ;
; 1 ; 10 ;
; 2 ; 0 ;
; 3 ; 2 ;
; 4 ; 3 ;
; 5 ; 0 ;
; 6 ; 0 ;
; 7 ; 4 ;
; 8 ; 11 ;
+--------------------------+----------------+
+----------------------------------------------+
; Local Routing Interconnect ;
+-----------------------------+----------------+
; Local Routing Interconnects ; Number of LABs ;
+-----------------------------+----------------+
; 0 ; 197 ;
; 1 ; 3 ;
; 2 ; 2 ;
; 3 ; 1 ;
; 4 ; 4 ;
; 5 ; 2 ;
; 6 ; 4 ;
; 7 ; 3 ;
+-----------------------------+----------------+
+---------------------------------------------+
; LAB External Interconnect ;
+----------------------------+----------------+
; LAB External Interconnects ; Number of LABs ;
+----------------------------+----------------+
; 0 ; 187 ;
; 1 ; 0 ;
; 2 ; 6 ;
; 3 ; 2 ;
; 4 ; 7 ;
; 5 ; 2 ;
; 6 ; 1 ;
; 7 ; 4 ;
; 8 ; 3 ;
; 9 ; 0 ;
; 10 ; 1 ;
; 11 ; 0 ;
; 12 ; 3 ;
+----------------------------+----------------+
+-----------------------------------------------------------------------------------------+
; Row Interconnect ;
+-------+--------------------+-----------------------------+------------------------------+
; Row ; Interconnect Used ; Left Half Interconnect Used ; Right Half Interconnect Used ;
+-------+--------------------+-----------------------------+------------------------------+
; A ; 0 / 144 ( 0 % ) ; 0 / 72 ( 0 % ) ; 0 / 72 ( 0 % ) ;
; B ; 5 / 144 ( 3 % ) ; 20 / 72 ( 27 % ) ; 0 / 72 ( 0 % ) ;
; C ; 27 / 144 ( 18 % ) ; 2 / 72 ( 2 % ) ; 0 / 72 ( 0 % ) ;
; D ; 1 / 144 ( < 1 % ) ; 5 / 72 ( 6 % ) ; 0 / 72 ( 0 % ) ;
; E ; 27 / 144 ( 18 % ) ; 30 / 72 ( 41 % ) ; 0 / 72 ( 0 % ) ;
; F ; 5 / 144 ( 3 % ) ; 5 / 72 ( 6 % ) ; 0 / 72 ( 0 % ) ;
; Total ; 65 / 864 ( 7 % ) ; 62 / 432 ( 14 % ) ; 0 / 432 ( 0 % ) ;
+-------+--------------------+-----------------------------+------------------------------+
+---------------------------+
; LAB Column Interconnect ;
+-------+-------------------+
; Col. ; Interconnect Used ;
+-------+-------------------+
; 1 ; 4 / 24 ( 16 % ) ;
; 2 ; 1 / 24 ( 4 % ) ;
; 3 ; 1 / 24 ( 4 % ) ;
; 4 ; 4 / 24 ( 16 % ) ;
; 5 ; 6 / 24 ( 25 % ) ;
; 6 ; 1 / 24 ( 4 % ) ;
; 7 ; 5 / 24 ( 20 % ) ;
; 8 ; 3 / 24 ( 12 % ) ;
; 9 ; 3 / 24 ( 12 % ) ;
; 10 ; 0 / 24 ( 0 % ) ;
; 11 ; 1 / 24 ( 4 % ) ;
; 12 ; 0 / 24 ( 0 % ) ;
; 13 ; 0 / 24 ( 0 % ) ;
; 14 ; 3 / 24 ( 12 % ) ;
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