tc_define.v

来自「FPGA直接读取SD卡扇区数据」· Verilog 代码 · 共 30 行

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// Width of address bus
//
`define TC_AW		32

//
// Width of data bus
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`define TC_DW		32

//
// Width of byte select bus
//
`define TC_BSW		4

//
// Width of WB target inputs (coming from WB slave)
//
// data bus width + ack + err
//
`define TC_TIN_W	`TC_DW+1+1

//
// Width of WB initiator inputs (coming from WB masters)
//
// cyc + stb + cab + address bus width +
// byte select bus width + we + data bus width
//
`define TC_IIN_W	1+1+1+`TC_AW+`TC_BSW+1+`TC_DW