din5.sim.rpt

现代雷达普遍采用相参信号处理,而如何获得高精度基带数字正交( I , Q) 信号是整个系统信号处理成败的关键,以前通常的做法是采用模拟相位检波器得到I、Q信号,其正交性能一般为:幅度平衡在2 ％ 左右

; |din5|move:inst7|74164:inst|10                                                                      ; |din5|move:inst7|74164:inst|10                                                                   ; out              ;
; |din5|div5:inst1|clk_temp2                                                                          ; |din5|div5:inst1|clk_temp2                                                                       ; out              ;
; |din5|div5:inst1|cnt1~0                                                                             ; |din5|div5:inst1|cnt1~0                                                                          ; out              ;
; |din5|div5:inst1|cnt1~1                                                                             ; |din5|div5:inst1|cnt1~1                                                                          ; out              ;
; |din5|div5:inst1|cnt1~2                                                                             ; |din5|div5:inst1|cnt1~2                                                                          ; out              ;
; |din5|div5:inst1|cnt2~0                                                                             ; |din5|div5:inst1|cnt2~0                                                                          ; out              ;
; |din5|div5:inst1|cnt2~1                                                                             ; |din5|div5:inst1|cnt2~1                                                                          ; out              ;
; |din5|div5:inst1|cnt2~2                                                                             ; |din5|div5:inst1|cnt2~2                                                                          ; out              ;
; |din5|div5:inst1|clk_temp1~0                                                                        ; |din5|div5:inst1|clk_temp1~0                                                                     ; out              ;
; |din5|div5:inst1|clk_temp1~1                                                                        ; |din5|div5:inst1|clk_temp1~1                                                                     ; out              ;
; |din5|div5:inst1|clk_temp2~0                                                                        ; |din5|div5:inst1|clk_temp2~0                                                                     ; out              ;
; |din5|div5:inst1|clk_temp2~1                                                                        ; |din5|div5:inst1|clk_temp2~1                                                                     ; out              ;
; |din5|div5:inst1|div5                                                                               ; |din5|div5:inst1|div5                                                                            ; out0             ;
; |din5|div5:inst1|clk_temp1                                                                          ; |din5|div5:inst1|clk_temp1                                                                       ; out              ;
; |din5|div5:inst1|cnt2[0]                                                                            ; |din5|div5:inst1|cnt2[0]                                                                         ; out              ;
; |din5|div5:inst1|cnt2[1]                                                                            ; |din5|div5:inst1|cnt2[1]                                                                         ; out              ;
; |din5|div5:inst1|cnt2[2]                                                                            ; |din5|div5:inst1|cnt2[2]                                                                         ; out              ;
; |din5|div5:inst1|cnt1[0]                                                                            ; |din5|div5:inst1|cnt1[0]                                                                         ; out              ;
; |din5|div5:inst1|cnt1[1]                                                                            ; |din5|div5:inst1|cnt1[1]                                                                         ; out              ;
; |din5|div5:inst1|cnt1[2]                                                                            ; |din5|div5:inst1|cnt1[2]                                                                         ; out              ;
; |din5|div2:inst10|count[0]                                                                          ; |din5|div2:inst10|count[0]                                                                       ; out              ;
; |din5|div2:inst10|count[1]                                                                          ; |din5|div2:inst10|count[1]                                                                       ; out              ;
; |din5|div5:inst1|Equal0~5                                                                           ; |din5|div5:inst1|Equal0~5                                                                        ; out0             ;
; |din5|div5:inst1|Equal1~5                                                                           ; |din5|div5:inst1|Equal1~5                                                                        ; out0             ;
; |din5|div5:inst1|Equal2~5                                                                           ; |din5|div5:inst1|Equal2~5                                                                        ; out0             ;
; |din5|div5:inst1|Equal3~5                                                                           ; |din5|div5:inst1|Equal3~5                                                                        ; out0             ;
; |din5|div5:inst1|Equal4~5                                                                           ; |din5|div5:inst1|Equal4~5                                                                        ; out0             ;
; |din5|div5:inst1|Equal5~5                                                                           ; |din5|div5:inst1|Equal5~5                                                                        ; out0             ;
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