📄 davincihd.fit.rpt
字号:
+---------------------------------------------------------------------------------------------------------------------------+
; Control Signals ;
+--------------------------+-------------+---------+---------------------+--------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Usage ; Global ; Global Resource Used ; Global Line Name ;
+--------------------------+-------------+---------+---------------------+--------+----------------------+------------------+
; CLKIN ; PIN_62 ; 45 ; Clock ; yes ; Global Clock ; GCLK2 ;
; DATA_OUT_BUF[0]~1683 ; LC_X5_Y4_N3 ; 1 ; Async. clear ; no ; -- ; -- ;
; DATA_OUT_BUF[0]~1684 ; LC_X5_Y4_N9 ; 1 ; Async. load ; no ; -- ; -- ;
; DATA_OUT_BUF[1]~1680 ; LC_X4_Y3_N6 ; 1 ; Async. clear ; no ; -- ; -- ;
; DATA_OUT_BUF[1]~1681 ; LC_X4_Y3_N8 ; 1 ; Async. load ; no ; -- ; -- ;
; DATA_OUT_BUF[2]~1676 ; LC_X4_Y3_N7 ; 1 ; Async. clear ; no ; -- ; -- ;
; DATA_OUT_BUF[2]~1677 ; LC_X4_Y3_N5 ; 1 ; Async. load ; no ; -- ; -- ;
; DATA_OUT_BUF[3]~1671 ; LC_X5_Y3_N9 ; 1 ; Async. clear ; no ; -- ; -- ;
; DATA_OUT_BUF[3]~1672 ; LC_X5_Y3_N5 ; 1 ; Async. load ; no ; -- ; -- ;
; DATA_OUT_BUF[4]~1668 ; LC_X6_Y4_N7 ; 1 ; Async. clear ; no ; -- ; -- ;
; DATA_OUT_BUF[4]~1669 ; LC_X6_Y4_N5 ; 1 ; Async. load ; no ; -- ; -- ;
; DATA_OUT_BUF[5]~1665 ; LC_X6_Y4_N6 ; 1 ; Async. clear ; no ; -- ; -- ;
; DATA_OUT_BUF[5]~1666 ; LC_X6_Y4_N4 ; 1 ; Async. load ; no ; -- ; -- ;
; DATA_OUT_BUF[6]~1662 ; LC_X5_Y3_N1 ; 1 ; Async. clear ; no ; -- ; -- ;
; DATA_OUT_BUF[6]~1663 ; LC_X5_Y4_N4 ; 1 ; Async. load ; no ; -- ; -- ;
; DATA_OUT_BUF[7]~1658 ; LC_X5_Y3_N7 ; 1 ; Async. clear ; no ; -- ; -- ;
; DATA_OUT_BUF[7]~1659 ; LC_X7_Y3_N6 ; 8 ; Clock enable ; no ; -- ; -- ;
; DATA_OUT_BUF[7]~1660 ; LC_X5_Y3_N2 ; 1 ; Async. load ; no ; -- ; -- ;
; Enable_DEMODULATED_CIR~0 ; LC_X4_Y2_N2 ; 1 ; Output enable ; no ; -- ; -- ;
; Enable_MODULATED_CIR~0 ; LC_X4_Y2_N8 ; 1 ; Output enable ; no ; -- ; -- ;
; POR_RESETn ; PIN_30 ; 6 ; Async. clear ; no ; -- ; -- ;
; READ_OR_WRITE~378 ; LC_X7_Y3_N2 ; 3 ; Clock enable ; no ; -- ; -- ;
; Reg0[0]~322 ; LC_X5_Y2_N4 ; 8 ; Clock enable ; no ; -- ; -- ;
; Reg1[2]~332 ; LC_X5_Y2_N1 ; 8 ; Clock enable ; no ; -- ; -- ;
; Reset_SYSTEM~0 ; LC_X3_Y2_N5 ; 47 ; Async. clear ; yes ; Global Clock ; GCLK3 ;
; STATE.s1 ; LC_X7_Y4_N9 ; 27 ; Async. clear ; no ; -- ; -- ;
; STATE.s2 ; LC_X7_Y4_N7 ; 16 ; Async. clear ; no ; -- ; -- ;
; davincihdcir:U1|clken ; LC_X5_Y1_N1 ; 8 ; Clock enable ; no ; -- ; -- ;
; process0~0 ; LC_X3_Y2_N3 ; 14 ; Async. clear ; no ; -- ; -- ;
; sync_scl[3] ; LC_X2_Y3_N7 ; 59 ; Async. clear, Clock ; yes ; Global Clock ; GCLK1 ;
; sync_sda[3] ; LC_X2_Y1_N1 ; 5 ; Clock ; yes ; Global Clock ; GCLK0 ;
; tc_sync_pb_capture ; LC_X3_Y1_N6 ; 5 ; Clock enable ; no ; -- ; -- ;
+--------------------------+-------------+---------+---------------------+--------+----------------------+------------------+
+----------------------------------------------------------------------------------+
; Global & Other Fast Signals ;
+----------------+-------------+---------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+----------------+-------------+---------+----------------------+------------------+
; CLKIN ; PIN_62 ; 45 ; Global Clock ; GCLK2 ;
; Reset_SYSTEM~0 ; LC_X3_Y2_N5 ; 47 ; Global Clock ; GCLK3 ;
; sync_scl[3] ; LC_X2_Y3_N7 ; 59 ; Global Clock ; GCLK1 ;
; sync_sda[3] ; LC_X2_Y1_N1 ; 5 ; Global Clock ; GCLK0 ;
+----------------+-------------+---------+----------------------+------------------+
+-------------------------------------+
; Non-Global High Fan-Out Signals ;
+---------------------------+---------+
; Name ; Fan-Out ;
+---------------------------+---------+
; STATE.s1 ; 28 ;
; STATE.s2 ; 16 ;
; process0~0 ; 14 ;
; STATE.s0 ; 13 ;
; RIGHT_ADDR ; 12 ;
; REG_ADDR[1] ; 12 ;
; READ_OR_WRITE ; 11 ;
; REG_ADDR[0] ; 11 ;
; DATA_OUT_BUF[7]~1659 ; 8 ;
; process13~0 ; 8 ;
; davincihdcir:U1|clken ; 8 ;
; Reg1[2]~332 ; 8 ;
; Reg0[0]~322 ; 8 ;
; POR_RESETn ; 6 ;
; DATA_OUT_BUF[7]~1656 ; 6 ;
; PCI_DETECTn ; 5 ;
; davincihdcir:U1|Equal0~79 ; 5 ;
; davincihdcir:U1|Equal0~78 ; 5 ;
; tc_ponrs_counter[5]~73 ; 5 ;
; tc_sync_pb_capture ; 5 ;
; tc_sync_ponrs[2] ; 5 ;
; tc_sync_pb_porz[1] ; 5 ;
; EXT_EMIF_MODE ; 4 ;
; davincihdcir:U1|Equal1~44 ; 4 ;
; davincihdcir:U1|Add0~137 ; 4 ;
; WRONG_ADDR~92 ; 4 ;
; ADDR_IN_BUF[1] ; 4 ;
; ADDR_IN_BUF[2] ; 4 ;
; DATA_IN_BUF[8] ; 4 ;
; Reg1[5] ; 4 ;
; DATA_OUT_BUF[0] ; 3 ;
; DATA_OUT_BUF[3] ; 3 ;
; DATA_OUT_BUF[4] ; 3 ;
; davincihdcir:U1|sync[0] ; 3 ;
; davincihdcir:U1|sync[1] ; 3 ;
; davincihdcir:U1|sync[2] ; 3 ;
; DATA_OUT_BUF[5] ; 3 ;
; WRONG_ADDR ; 3 ;
; davincihdcir:U1|clkdiv[7] ; 3 ;
; davincihdcir:U1|clkdiv[3] ; 3 ;
; davincihdcir:U1|clkdiv[5] ; 3 ;
; DATA_OUT_BUF[6] ; 3 ;
; tc_ponrs_counter[5] ; 3 ;
; tc_ponrs_counter[0] ; 3 ;
; ADDR_IN_BUF[9] ; 3 ;
; READ_OR_WRITE~378 ; 3 ;
; ADDR_IN_BUF[3] ; 3 ;
; Equal9~63 ; 3 ;
; DATA_OUT_BUF[7] ; 3 ;
; DATA_ACK ; 3 ;
+---------------------------+---------+
+-------------------------------------------------+
; Interconnect Usage Summary ;
+----------------------------+--------------------+
; Interconnect Resource Type ; Usage ;
+----------------------------+--------------------+
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