dec2812.fit.rpt
来自「DSP2812开发板板上的CPLD源代码」· RPT 代码 · 共 642 行 · 第 1/5 页
RPT
642 行
; inst42 ; LC_X2_Y3_N2 ; 8 ; Clock ; yes ; Global clock ; GCLK3 ;
; inst46 ; LC_X2_Y3_N9 ; 7 ; Clock ; yes ; Global clock ; GCLK0 ;
; inst50 ; LC_X2_Y3_N4 ; 3 ; Clock ; yes ; Global clock ; GCLK1 ;
; inst55 ; LC_X2_Y3_N6 ; 1 ; Clock ; no ; -- ; -- ;
; inst62 ; LC_X2_Y3_N3 ; 3 ; Clock ; no ; -- ; -- ;
+--------------------+-------------+---------+---------------+--------+----------------------+------------------+
+--------------------------------------------------------------------------+
; Global & Other Fast Signals ;
+--------+-------------+---------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+--------+-------------+---------+----------------------+------------------+
; inst39 ; LC_X2_Y3_N0 ; 8 ; Global clock ; GCLK2 ;
; inst42 ; LC_X2_Y3_N2 ; 8 ; Global clock ; GCLK3 ;
; inst46 ; LC_X2_Y3_N9 ; 7 ; Global clock ; GCLK0 ;
; inst50 ; LC_X2_Y3_N4 ; 3 ; Global clock ; GCLK1 ;
+--------+-------------+---------+----------------------+------------------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+--------------------+------------+
; Name ; Fan-Out ;
+--------------------+------------+
; A[10] ; 17 ;
; A[9] ; 17 ;
; A[11] ; 8 ;
; A[12] ; 8 ;
; 74244:inst13|26~42 ; 8 ;
; inst75~56 ; 7 ;
; D~7 ; 6 ;
; D~6 ; 5 ;
; D~5 ; 5 ;
; WR ; 5 ;
; inst78 ; 5 ;
; inst75 ; 5 ;
; CS1 ; 4 ;
; D~4 ; 3 ;
; D~3 ; 3 ;
; D~2 ; 3 ;
; D~1 ; 3 ;
; RD ; 3 ;
; inst81 ; 3 ;
; inst76~27 ; 3 ;
; inst62 ; 3 ;
; inst50~22 ; 3 ;
; 74273:inst7|17 ; 3 ;
; 74273:inst7|18 ; 3 ;
; D~0 ; 2 ;
; NMI[1] ; 2 ;
; NMI[0] ; 2 ;
; 8019INT ; 2 ;
; USBINT ; 2 ;
; EXINT[4] ; 2 ;
; EXINT[1] ; 2 ;
; EXINT[2] ; 2 ;
; EXINT[3] ; 2 ;
; EXINT[5] ; 2 ;
; inst76 ; 2 ;
; inst77 ; 2 ;
; inst62~17 ; 2 ;
; inst84~16 ; 2 ;
; 74273:inst11|19 ; 2 ;
; KEY[1] ; 1 ;
; INP[1] ; 1 ;
; KEY[2] ; 1 ;
; INP[2] ; 1 ;
; KEY[3] ; 1 ;
; INP[3] ; 1 ;
; INP[4] ; 1 ;
; INP[5] ; 1 ;
; INP[6] ; 1 ;
; INP[7] ; 1 ;
; INP[8] ; 1 ;
+--------------------+------------+
+-------------------------------------------------+
; Interconnect Usage Summary ;
+----------------------------+--------------------+
; Interconnect Resource Type ; Usage ;
+----------------------------+--------------------+
; C4s ; 70 / 784 ( 9 % ) ;
; Direct links ; 11 / 888 ( 1 % ) ;
; Global clocks ; 4 / 4 ( 100 % ) ;
; LAB clocks ; 9 / 32 ( 28 % ) ;
; LUT chains ; 9 / 216 ( 4 % ) ;
; Local interconnects ; 111 / 888 ( 13 % ) ;
; R4s ; 67 / 704 ( 10 % ) ;
+----------------------------+--------------------+
+---------------------------------------------------------------------------+
; LAB Logic Elements ;
+--------------------------------------------+------------------------------+
; Number of Logic Elements (Average = 4.38) ; Number of LABs (Total = 16) ;
+--------------------------------------------+------------------------------+
; 1 ; 4 ;
; 2 ; 1 ;
; 3 ; 1 ;
; 4 ; 4 ;
; 5 ; 2 ;
; 6 ; 0 ;
; 7 ; 1 ;
; 8 ; 0 ;
; 9 ; 2 ;
; 10 ; 1 ;
+--------------------------------------------+------------------------------+
+-------------------------------------------------------------------+
; LAB-wide Signals ;
+------------------------------------+------------------------------+
; LAB-wide Signals (Average = 0.69) ; Number of LABs (Total = 16) ;
+------------------------------------+------------------------------+
; 1 Clock ; 7 ;
; 2 Clocks ; 4 ;
+------------------------------------+------------------------------+
+----------------------------------------------------------------------------+
; LAB Signals Sourced ;
+---------------------------------------------+------------------------------+
; Number of Signals Sourced (Average = 4.56) ; Number of LABs (Total = 16) ;
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