buffer.v

来自「插值滤波器,用于音频解码调制解调,滤波器系数用移位相加实现」· Verilog 代码 · 共 9 行

9 行

`timescale 1ns/10ps
module buffer(buf_in,buf_out);

input [18:1] buf_in;
output [18:1] buf_out;

assign buf_out=~(~buf_in);

endmodule

buffer.v - 源码说明

本页面展示了「插值滤波器,用于音频解码调制解调,滤波器系数用移位相加实现」中的 buffer.v 源码文件，采用 Verilog 编程语言编写，共 9 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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