📄 test_top_core.v
字号:
`timescale 1ns/10ps
module test_top_core(data_out);
output [18:1] data_out;
wire [18:1] data_in;
wire clock,reset;
wire [4:1] control;
top_core_sign top_core_sign(data_in,clock,reset,control);
top_core top_core(data_in,clock,reset,control,data_out);
endmodule
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