📄 mcf548x_gpio.h
字号:
/*
* File: mcf548x_gpio.h
* Purpose: Register and bit definitions for the MCF548X
*
* Notes:
*
*/
#ifndef __MCF548X_GPIO_H__
#define __MCF548X_GPIO_H__
/*********************************************************************
*
* General Purpose I/O (GPIO)
*
*********************************************************************/
/* Register read/write macros */
#define MCF_GPIO_PODR_FBCTL (*(vuint8 *)(void*)(&__MBAR[0x000A00]))
#define MCF_GPIO_PODR_FBCS (*(vuint8 *)(void*)(&__MBAR[0x000A01]))
#define MCF_GPIO_PODR_DMA (*(vuint8 *)(void*)(&__MBAR[0x000A02]))
#define MCF_GPIO_PODR_FEC0H (*(vuint8 *)(void*)(&__MBAR[0x000A04]))
#define MCF_GPIO_PODR_FEC0L (*(vuint8 *)(void*)(&__MBAR[0x000A05]))
#define MCF_GPIO_PODR_FEC1H (*(vuint8 *)(void*)(&__MBAR[0x000A06]))
#define MCF_GPIO_PODR_FEC1L (*(vuint8 *)(void*)(&__MBAR[0x000A07]))
#define MCF_GPIO_PODR_FECI2C (*(vuint8 *)(void*)(&__MBAR[0x000A08]))
#define MCF_GPIO_PODR_PCIBG (*(vuint8 *)(void*)(&__MBAR[0x000A09]))
#define MCF_GPIO_PODR_PCIBR (*(vuint8 *)(void*)(&__MBAR[0x000A0A]))
#define MCF_GPIO_PODR_PSC3PSC2 (*(vuint8 *)(void*)(&__MBAR[0x000A0C]))
#define MCF_GPIO_PODR_PSC1PSC0 (*(vuint8 *)(void*)(&__MBAR[0x000A0D]))
#define MCF_GPIO_PODR_DSPI (*(vuint8 *)(void*)(&__MBAR[0x000A0E]))
#define MCF_GPIO_PDDR_FBCTL (*(vuint8 *)(void*)(&__MBAR[0x000A10]))
#define MCF_GPIO_PDDR_FBCS (*(vuint8 *)(void*)(&__MBAR[0x000A11]))
#define MCF_GPIO_PDDR_DMA (*(vuint8 *)(void*)(&__MBAR[0x000A12]))
#define MCF_GPIO_PDDR_FEC0H (*(vuint8 *)(void*)(&__MBAR[0x000A14]))
#define MCF_GPIO_PDDR_FEC0L (*(vuint8 *)(void*)(&__MBAR[0x000A15]))
#define MCF_GPIO_PDDR_FEC1H (*(vuint8 *)(void*)(&__MBAR[0x000A16]))
#define MCF_GPIO_PDDR_FEC1L (*(vuint8 *)(void*)(&__MBAR[0x000A17]))
#define MCF_GPIO_PDDR_FECI2C (*(vuint8 *)(void*)(&__MBAR[0x000A18]))
#define MCF_GPIO_PDDR_PCIBG (*(vuint8 *)(void*)(&__MBAR[0x000A19]))
#define MCF_GPIO_PDDR_PCIBR (*(vuint8 *)(void*)(&__MBAR[0x000A1A]))
#define MCF_GPIO_PDDR_PSC3PSC2 (*(vuint8 *)(void*)(&__MBAR[0x000A1C]))
#define MCF_GPIO_PDDR_PSC1PSC0 (*(vuint8 *)(void*)(&__MBAR[0x000A1D]))
#define MCF_GPIO_PDDR_DSPI (*(vuint8 *)(void*)(&__MBAR[0x000A1E]))
#define MCF_GPIO_PPDSDR_FBCTL (*(vuint8 *)(void*)(&__MBAR[0x000A20]))
#define MCF_GPIO_PPDSDR_FBCS (*(vuint8 *)(void*)(&__MBAR[0x000A21]))
#define MCF_GPIO_PPDSDR_DMA (*(vuint8 *)(void*)(&__MBAR[0x000A22]))
#define MCF_GPIO_PPDSDR_FEC0H (*(vuint8 *)(void*)(&__MBAR[0x000A24]))
#define MCF_GPIO_PPDSDR_FEC0L (*(vuint8 *)(void*)(&__MBAR[0x000A25]))
#define MCF_GPIO_PPDSDR_FEC1H (*(vuint8 *)(void*)(&__MBAR[0x000A26]))
#define MCF_GPIO_PPDSDR_FEC1L (*(vuint8 *)(void*)(&__MBAR[0x000A27]))
#define MCF_GPIO_PPDSDR_FECI2C (*(vuint8 *)(void*)(&__MBAR[0x000A28]))
#define MCF_GPIO_PPDSDR_PCIBG (*(vuint8 *)(void*)(&__MBAR[0x000A29]))
#define MCF_GPIO_PPDSDR_PCIBR (*(vuint8 *)(void*)(&__MBAR[0x000A2A]))
#define MCF_GPIO_PPDSDR_PSC3PSC2 (*(vuint8 *)(void*)(&__MBAR[0x000A2C]))
#define MCF_GPIO_PPDSDR_PSC1PSC0 (*(vuint8 *)(void*)(&__MBAR[0x000A2D]))
#define MCF_GPIO_PPDSDR_DSPI (*(vuint8 *)(void*)(&__MBAR[0x000A2E]))
#define MCF_GPIO_PCLRR_FBCTL (*(vuint8 *)(void*)(&__MBAR[0x000A30]))
#define MCF_GPIO_PCLRR_FBCS (*(vuint8 *)(void*)(&__MBAR[0x000A31]))
#define MCF_GPIO_PCLRR_DMA (*(vuint8 *)(void*)(&__MBAR[0x000A32]))
#define MCF_GPIO_PCLRR_FEC0H (*(vuint8 *)(void*)(&__MBAR[0x000A34]))
#define MCF_GPIO_PCLRR_FEC0L (*(vuint8 *)(void*)(&__MBAR[0x000A35]))
#define MCF_GPIO_PCLRR_FEC1H (*(vuint8 *)(void*)(&__MBAR[0x000A36]))
#define MCF_GPIO_PCLRR_FEC1L (*(vuint8 *)(void*)(&__MBAR[0x000A37]))
#define MCF_GPIO_PCLRR_FECI2C (*(vuint8 *)(void*)(&__MBAR[0x000A38]))
#define MCF_GPIO_PCLRR_PCIBG (*(vuint8 *)(void*)(&__MBAR[0x000A39]))
#define MCF_GPIO_PCLRR_PCIBR (*(vuint8 *)(void*)(&__MBAR[0x000A3A]))
#define MCF_GPIO_PCLRR_PSC3PSC2 (*(vuint8 *)(void*)(&__MBAR[0x000A3C]))
#define MCF_GPIO_PCLRR_PSC1PSC0 (*(vuint8 *)(void*)(&__MBAR[0x000A3D]))
#define MCF_GPIO_PCLRR_DSPI (*(vuint8 *)(void*)(&__MBAR[0x000A3E]))
#define MCF_GPIO_PAR_FBCTL (*(vuint16*)(void*)(&__MBAR[0x000A40]))
#define MCF_GPIO_PAR_FBCS (*(vuint8 *)(void*)(&__MBAR[0x000A42]))
#define MCF_GPIO_PAR_DMA (*(vuint8 *)(void*)(&__MBAR[0x000A43]))
#define MCF_GPIO_PAR_FECI2CIRQ (*(vuint16*)(void*)(&__MBAR[0x000A44]))
#define MCF_GPIO_PAR_PCIBG (*(vuint16*)(void*)(&__MBAR[0x000A48]))
#define MCF_GPIO_PAR_PCIBR (*(vuint16*)(void*)(&__MBAR[0x000A4A]))
#define MCF_GPIO_PAR_PSC3 (*(vuint8 *)(void*)(&__MBAR[0x000A4C]))
#define MCF_GPIO_PAR_PSC2 (*(vuint8 *)(void*)(&__MBAR[0x000A4D]))
#define MCF_GPIO_PAR_PSC1 (*(vuint8 *)(void*)(&__MBAR[0x000A4E]))
#define MCF_GPIO_PAR_PSC0 (*(vuint8 *)(void*)(&__MBAR[0x000A4F]))
#define MCF_GPIO_PAR_DSPI (*(vuint16*)(void*)(&__MBAR[0x000A50]))
#define MCF_GPIO_PAR_TIMER (*(vuint8 *)(void*)(&__MBAR[0x000A52]))
/* Bit definitions and macros for MCF_GPIO_PODR_FBCTL */
#define MCF_GPIO_PODR_FBCTL_PODRFBCTL0 (0x01)
#define MCF_GPIO_PODR_FBCTL_PODRFBCTL1 (0x02)
#define MCF_GPIO_PODR_FBCTL_PODRFBCTL2 (0x04)
#define MCF_GPIO_PODR_FBCTL_PODRFBCTL3 (0x08)
#define MCF_GPIO_PODR_FBCTL_PODRFBCTL4 (0x10)
#define MCF_GPIO_PODR_FBCTL_PODRFBCTL5 (0x20)
#define MCF_GPIO_PODR_FBCTL_PODRFBCTL6 (0x40)
#define MCF_GPIO_PODR_FBCTL_PODRFBCTL7 (0x80)
/* Bit definitions and macros for MCF_GPIO_PODR_FBCS */
#define MCF_GPIO_PODR_FBCS_PODRFBCS1 (0x02)
#define MCF_GPIO_PODR_FBCS_PODRFBCS2 (0x04)
#define MCF_GPIO_PODR_FBCS_PODRFBCS3 (0x08)
#define MCF_GPIO_PODR_FBCS_PODRFBCS4 (0x10)
#define MCF_GPIO_PODR_FBCS_PODRFBCS5 (0x20)
/* Bit definitions and macros for MCF_GPIO_PODR_DMA */
#define MCF_GPIO_PODR_DMA_PODRDMA0 (0x01)
#define MCF_GPIO_PODR_DMA_PODRDMA1 (0x02)
#define MCF_GPIO_PODR_DMA_PODRDMA2 (0x04)
#define MCF_GPIO_PODR_DMA_PODRDMA3 (0x08)
/* Bit definitions and macros for MCF_GPIO_PODR_FEC0H */
#define MCF_GPIO_PODR_FEC0H_PODRFEC0H0 (0x01)
#define MCF_GPIO_PODR_FEC0H_PODRFEC0H1 (0x02)
#define MCF_GPIO_PODR_FEC0H_PODRFEC0H2 (0x04)
#define MCF_GPIO_PODR_FEC0H_PODRFEC0H3 (0x08)
#define MCF_GPIO_PODR_FEC0H_PODRFEC0H4 (0x10)
#define MCF_GPIO_PODR_FEC0H_PODRFEC0H5 (0x20)
#define MCF_GPIO_PODR_FEC0H_PODRFEC0H6 (0x40)
#define MCF_GPIO_PODR_FEC0H_PODRFEC0H7 (0x80)
/* Bit definitions and macros for MCF_GPIO_PODR_FEC0L */
#define MCF_GPIO_PODR_FEC0L_PODRFEC0L0 (0x01)
#define MCF_GPIO_PODR_FEC0L_PODRFEC0L1 (0x02)
#define MCF_GPIO_PODR_FEC0L_PODRFEC0L2 (0x04)
#define MCF_GPIO_PODR_FEC0L_PODRFEC0L3 (0x08)
#define MCF_GPIO_PODR_FEC0L_PODRFEC0L4 (0x10)
#define MCF_GPIO_PODR_FEC0L_PODRFEC0L5 (0x20)
#define MCF_GPIO_PODR_FEC0L_PODRFEC0L6 (0x40)
#define MCF_GPIO_PODR_FEC0L_PODRFEC0L7 (0x80)
/* Bit definitions and macros for MCF_GPIO_PODR_FEC1H */
#define MCF_GPIO_PODR_FEC1H_PODRFEC1H0 (0x01)
#define MCF_GPIO_PODR_FEC1H_PODRFEC1H1 (0x02)
#define MCF_GPIO_PODR_FEC1H_PODRFEC1H2 (0x04)
#define MCF_GPIO_PODR_FEC1H_PODRFEC1H3 (0x08)
#define MCF_GPIO_PODR_FEC1H_PODRFEC1H4 (0x10)
#define MCF_GPIO_PODR_FEC1H_PODRFEC1H5 (0x20)
#define MCF_GPIO_PODR_FEC1H_PODRFEC1H6 (0x40)
#define MCF_GPIO_PODR_FEC1H_PODRFEC1H7 (0x80)
/* Bit definitions and macros for MCF_GPIO_PODR_FEC1L */
#define MCF_GPIO_PODR_FEC1L_PODRFEC1L0 (0x01)
#define MCF_GPIO_PODR_FEC1L_PODRFEC1L1 (0x02)
#define MCF_GPIO_PODR_FEC1L_PODRFEC1L2 (0x04)
#define MCF_GPIO_PODR_FEC1L_PODRFEC1L3 (0x08)
#define MCF_GPIO_PODR_FEC1L_PODRFEC1L4 (0x10)
#define MCF_GPIO_PODR_FEC1L_PODRFEC1L5 (0x20)
#define MCF_GPIO_PODR_FEC1L_PODRFEC1L6 (0x40)
#define MCF_GPIO_PODR_FEC1L_PODRFEC1L7 (0x80)
/* Bit definitions and macros for MCF_GPIO_PODR_FECI2C */
#define MCF_GPIO_PODR_FECI2C_PODRFECI2C0 (0x01)
#define MCF_GPIO_PODR_FECI2C_PODRFECI2C1 (0x02)
#define MCF_GPIO_PODR_FECI2C_PODRFECI2C2 (0x04)
#define MCF_GPIO_PODR_FECI2C_PODRFECI2C3 (0x08)
/* Bit definitions and macros for MCF_GPIO_PODR_PCIBG */
#define MCF_GPIO_PODR_PCIBG_PODRPCIBG0 (0x01)
#define MCF_GPIO_PODR_PCIBG_PODRPCIBG1 (0x02)
#define MCF_GPIO_PODR_PCIBG_PODRPCIBG2 (0x04)
#define MCF_GPIO_PODR_PCIBG_PODRPCIBG3 (0x08)
#define MCF_GPIO_PODR_PCIBG_PODRPCIBG4 (0x10)
/* Bit definitions and macros for MCF_GPIO_PODR_PCIBR */
#define MCF_GPIO_PODR_PCIBR_PODRPCIBR0 (0x01)
#define MCF_GPIO_PODR_PCIBR_PODRPCIBR1 (0x02)
#define MCF_GPIO_PODR_PCIBR_PODRPCIBR2 (0x04)
#define MCF_GPIO_PODR_PCIBR_PODRPCIBR3 (0x08)
#define MCF_GPIO_PODR_PCIBR_PODRPCIBR4 (0x10)
/* Bit definitions and macros for MCF_GPIO_PODR_PSC3PSC2 */
#define MCF_GPIO_PODR_PSC3PSC2_PODRPSC3PSC20 (0x01)
#define MCF_GPIO_PODR_PSC3PSC2_PODRPSC3PSC21 (0x02)
#define MCF_GPIO_PODR_PSC3PSC2_PODRPSC3PSC22 (0x04)
#define MCF_GPIO_PODR_PSC3PSC2_PODRPSC3PSC23 (0x08)
#define MCF_GPIO_PODR_PSC3PSC2_PODRPSC3PSC24 (0x10)
#define MCF_GPIO_PODR_PSC3PSC2_PODRPSC3PSC25 (0x20)
#define MCF_GPIO_PODR_PSC3PSC2_PODRPSC3PSC26 (0x40)
#define MCF_GPIO_PODR_PSC3PSC2_PODRPSC3PSC27 (0x80)
/* Bit definitions and macros for MCF_GPIO_PODR_PSC1PSC0 */
#define MCF_GPIO_PODR_PSC1PSC0_PODRPSC1PSC00 (0x01)
#define MCF_GPIO_PODR_PSC1PSC0_PODRPSC1PSC01 (0x02)
#define MCF_GPIO_PODR_PSC1PSC0_PODRPSC1PSC02 (0x04)
#define MCF_GPIO_PODR_PSC1PSC0_PODRPSC1PSC03 (0x08)
#define MCF_GPIO_PODR_PSC1PSC0_PODRPSC1PSC04 (0x10)
#define MCF_GPIO_PODR_PSC1PSC0_PODRPSC1PSC05 (0x20)
#define MCF_GPIO_PODR_PSC1PSC0_PODRPSC1PSC06 (0x40)
#define MCF_GPIO_PODR_PSC1PSC0_PODRPSC1PSC07 (0x80)
/* Bit definitions and macros for MCF_GPIO_PODR_DSPI */
#define MCF_GPIO_PODR_DSPI_PODRDSPI0 (0x01)
#define MCF_GPIO_PODR_DSPI_PODRDSPI1 (0x02)
#define MCF_GPIO_PODR_DSPI_PODRDSPI2 (0x04)
#define MCF_GPIO_PODR_DSPI_PODRDSPI3 (0x08)
#define MCF_GPIO_PODR_DSPI_PODRDSPI4 (0x10)
#define MCF_GPIO_PODR_DSPI_PODRDSPI5 (0x20)
#define MCF_GPIO_PODR_DSPI_PODRDSPI6 (0x40)
/* Bit definitions and macros for MCF_GPIO_PDDR_FBCTL */
#define MCF_GPIO_PDDR_FBCTL_PDDRFBCTL0 (0x01)
#define MCF_GPIO_PDDR_FBCTL_PDDRFBCTL1 (0x02)
#define MCF_GPIO_PDDR_FBCTL_PDDRFBCTL2 (0x04)
#define MCF_GPIO_PDDR_FBCTL_PDDRFBCTL3 (0x08)
#define MCF_GPIO_PDDR_FBCTL_PDDRFBCTL4 (0x10)
#define MCF_GPIO_PDDR_FBCTL_PDDRFBCTL5 (0x20)
#define MCF_GPIO_PDDR_FBCTL_PDDRFBCTL6 (0x40)
#define MCF_GPIO_PDDR_FBCTL_PDDRFBCTL7 (0x80)
/* Bit definitions and macros for MCF_GPIO_PDDR_FBCS */
#define MCF_GPIO_PDDR_FBCS_PDDRFBCS1 (0x02)
#define MCF_GPIO_PDDR_FBCS_PDDRFBCS2 (0x04)
#define MCF_GPIO_PDDR_FBCS_PDDRFBCS3 (0x08)
#define MCF_GPIO_PDDR_FBCS_PDDRFBCS4 (0x10)
#define MCF_GPIO_PDDR_FBCS_PDDRFBCS5 (0x20)
/* Bit definitions and macros for MCF_GPIO_PDDR_DMA */
#define MCF_GPIO_PDDR_DMA_PDDRDMA0 (0x01)
#define MCF_GPIO_PDDR_DMA_PDDRDMA1 (0x02)
#define MCF_GPIO_PDDR_DMA_PDDRDMA2 (0x04)
#define MCF_GPIO_PDDR_DMA_PDDRDMA3 (0x08)
/* Bit definitions and macros for MCF_GPIO_PDDR_FEC0H */
#define MCF_GPIO_PDDR_FEC0H_PDDRFEC0H0 (0x01)
#define MCF_GPIO_PDDR_FEC0H_PDDRFEC0H1 (0x02)
#define MCF_GPIO_PDDR_FEC0H_PDDRFEC0H2 (0x04)
#define MCF_GPIO_PDDR_FEC0H_PDDRFEC0H3 (0x08)
#define MCF_GPIO_PDDR_FEC0H_PDDRFEC0H4 (0x10)
#define MCF_GPIO_PDDR_FEC0H_PDDRFEC0H5 (0x20)
#define MCF_GPIO_PDDR_FEC0H_PDDRFEC0H6 (0x40)
#define MCF_GPIO_PDDR_FEC0H_PDDRFEC0H7 (0x80)
/* Bit definitions and macros for MCF_GPIO_PDDR_FEC0L */
#define MCF_GPIO_PDDR_FEC0L_PDDRFEC0L0 (0x01)
#define MCF_GPIO_PDDR_FEC0L_PDDRFEC0L1 (0x02)
#define MCF_GPIO_PDDR_FEC0L_PDDRFEC0L2 (0x04)
#define MCF_GPIO_PDDR_FEC0L_PDDRFEC0L3 (0x08)
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