lcd_v.tan.rpt
来自「用EPM1270实现的1602液晶驱动Verilog」· RPT 代码 · 共 341 行 · 第 1/5 页
RPT
341 行
; Cut off read during write signal paths ; On ; ; ; ;
; Cut off feedback from I/O pins ; On ; ; ; ;
; Report Combined Fast/Slow Timing ; Off ; ; ; ;
; Ignore Clock Settings ; Off ; ; ; ;
; Analyze latches as synchronous elements ; Off ; ; ; ;
; Enable Recovery/Removal analysis ; Off ; ; ; ;
; Enable Clock Latency ; Off ; ; ; ;
+-------------------------------------------------------+--------------------+------+----+-------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Settings Summary ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; Clock Node Name ; Clock Setting Name ; Type ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; mclk ; ; User Pin ; None ; 0.000 ns ; 0.000 ns ; -- ; N/A ; N/A ; N/A ; ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'mclk' ;
+-----------------------------------------+-----------------------------------------------------+--------------------------+------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+--------------------------+------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A ; 108.50 MHz ( period = 9.217 ns ) ; lcd:inst1|clkcnt[4] ; lcd:inst1|clkcnt[6] ; mclk ; mclk ; None ; None ; 8.508 ns ;
; N/A ; 108.50 MHz ( period = 9.217 ns ) ; lcd:inst1|clkcnt[4] ; lcd:inst1|clkcnt[7] ; mclk ; mclk ; None ; None ; 8.508 ns ;
; N/A ; 108.50 MHz ( period = 9.217 ns ) ; lcd:inst1|clkcnt[4] ; lcd:inst1|clkcnt[5] ; mclk ; mclk ; None ; None ; 8.508 ns ;
; N/A ; 108.50 MHz ( period = 9.217 ns ) ; lcd:inst1|clkcnt[4] ; lcd:inst1|clkcnt[4] ; mclk ; mclk ; None ; None ; 8.508 ns ;
; N/A ; 108.50 MHz ( period = 9.217 ns ) ; lcd:inst1|clkcnt[4] ; lcd:inst1|clkcnt[3] ; mclk ; mclk ; None ; None ; 8.508 ns ;
; N/A ; 108.50 MHz ( period = 9.217 ns ) ; lcd:inst1|clkcnt[4] ; lcd:inst1|clkcnt[2] ; mclk ; mclk ; None ; None ; 8.508 ns ;
; N/A ; 108.50 MHz ( period = 9.217 ns ) ; lcd:inst1|clkcnt[4] ; lcd:inst1|clkcnt[1] ; mclk ; mclk ; None ; None ; 8.508 ns ;
; N/A ; 108.50 MHz ( period = 9.217 ns ) ; lcd:inst1|clkcnt[4] ; lcd:inst1|clkcnt[0] ; mclk ; mclk ; None ; None ; 8.508 ns ;
; N/A ; 110.71 MHz ( period = 9.033 ns ) ; lcd:inst1|clkcnt[7] ; lcd:inst1|clkcnt[6] ; mclk ; mclk ; None ; None ; 8.324 ns ;
; N/A ; 110.71 MHz ( period = 9.033 ns ) ; lcd:inst1|clkcnt[7] ; lcd:inst1|clkcnt[7] ; mclk ; mclk ; None ; None ; 8.324 ns ;
; N/A ; 110.71 MHz ( period = 9.033 ns ) ; lcd:inst1|clkcnt[7] ; lcd:inst1|clkcnt[5] ; mclk ; mclk ; None ; None ; 8.324 ns ;
; N/A ; 110.71 MHz ( period = 9.033 ns ) ; lcd:inst1|clkcnt[7] ; lcd:inst1|clkcnt[4] ; mclk ; mclk ; None ; None ; 8.324 ns ;
; N/A ; 110.71 MHz ( period = 9.033 ns ) ; lcd:inst1|clkcnt[7] ; lcd:inst1|clkcnt[3] ; mclk ; mclk ; None ; None ; 8.324 ns ;
; N/A ; 110.71 MHz ( period = 9.033 ns ) ; lcd:inst1|clkcnt[7] ; lcd:inst1|clkcnt[2] ; mclk ; mclk ; None ; None ; 8.324 ns ;
; N/A ; 110.71 MHz ( period = 9.033 ns ) ; lcd:inst1|clkcnt[7] ; lcd:inst1|clkcnt[1] ; mclk ; mclk ; None ; None ; 8.324 ns ;
; N/A ; 110.71 MHz ( period = 9.033 ns ) ; lcd:inst1|clkcnt[7] ; lcd:inst1|clkcnt[0] ; mclk ; mclk ; None ; None ; 8.324 ns ;
; N/A ; 111.02 MHz ( period = 9.007 ns ) ; lcd:inst1|clkcnt[3] ; lcd:inst1|clkcnt[6] ; mclk ; mclk ; None ; None ; 8.298 ns ;
; N/A ; 111.02 MHz ( period = 9.007 ns ) ; lcd:inst1|clkcnt[3] ; lcd:inst1|clkcnt[7] ; mclk ; mclk ; None ; None ; 8.298 ns ;
; N/A ; 111.02 MHz ( period = 9.007 ns ) ; lcd:inst1|clkcnt[3] ; lcd:inst1|clkcnt[5] ; mclk ; mclk ; None ; None ; 8.298 ns ;
; N/A ; 111.02 MHz ( period = 9.007 ns ) ; lcd:inst1|clkcnt[3] ; lcd:inst1|clkcnt[4] ; mclk ; mclk ; None ; None ; 8.298 ns ;
; N/A ; 111.02 MHz ( period = 9.007 ns ) ; lcd:inst1|clkcnt[3] ; lcd:inst1|clkcnt[3] ; mclk ; mclk ; None ; None ; 8.298 ns ;
; N/A ; 111.02 MHz ( period = 9.007 ns ) ; lcd:inst1|clkcnt[3] ; lcd:inst1|clkcnt[2] ; mclk ; mclk ; None ; None ; 8.298 ns ;
; N/A ; 111.02 MHz ( period = 9.007 ns ) ; lcd:inst1|clkcnt[3] ; lcd:inst1|clkcnt[1] ; mclk ; mclk ; None ; None ; 8.298 ns ;
; N/A ; 111.02 MHz ( period = 9.007 ns ) ; lcd:inst1|clkcnt[3] ; lcd:inst1|clkcnt[0] ; mclk ; mclk ; None ; None ; 8.298 ns ;
; N/A ; 113.19 MHz ( period = 8.835 ns ) ; lcd:inst1|clkcnt[5] ; lcd:inst1|clkcnt[6] ; mclk ; mclk ; None ; None ; 8.126 ns ;
; N/A ; 113.19 MHz ( period = 8.835 ns ) ; lcd:inst1|clkcnt[5] ; lcd:inst1|clkcnt[7] ; mclk ; mclk ; None ; None ; 8.126 ns ;
; N/A ; 113.19 MHz ( period = 8.835 ns ) ; lcd:inst1|clkcnt[5] ; lcd:inst1|clkcnt[5] ; mclk ; mclk ; None ; None ; 8.126 ns ;
; N/A ; 113.19 MHz ( period = 8.835 ns ) ; lcd:inst1|clkcnt[5] ; lcd:inst1|clkcnt[4] ; mclk ; mclk ; None ; None ; 8.126 ns ;
; N/A ; 113.19 MHz ( period = 8.835 ns ) ; lcd:inst1|clkcnt[5] ; lcd:inst1|clkcnt[3] ; mclk ; mclk ; None ; None ; 8.126 ns ;
; N/A ; 113.19 MHz ( period = 8.835 ns ) ; lcd:inst1|clkcnt[5] ; lcd:inst1|clkcnt[2] ; mclk ; mclk ; None ; None ; 8.126 ns ;
; N/A ; 113.19 MHz ( period = 8.835 ns ) ; lcd:inst1|clkcnt[5] ; lcd:inst1|clkcnt[1] ; mclk ; mclk ; None ; None ; 8.126 ns ;
; N/A ; 113.19 MHz ( period = 8.835 ns ) ; lcd:inst1|clkcnt[5] ; lcd:inst1|clkcnt[0] ; mclk ; mclk ; None ; None ; 8.126 ns ;
; N/A ; 113.47 MHz ( period = 8.813 ns ) ; lcd:inst1|clkcnt[0] ; lcd:inst1|clkcnt[6] ; mclk ; mclk ; None ; None ; 8.104 ns ;
; N/A ; 113.47 MHz ( period = 8.813 ns ) ; lcd:inst1|clkcnt[0] ; lcd:inst1|clkcnt[7] ; mclk ; mclk ; None ; None ; 8.104 ns ;
; N/A ; 113.47 MHz ( period = 8.813 ns ) ; lcd:inst1|clkcnt[0] ; lcd:inst1|clkcnt[5] ; mclk ; mclk ; None ; None ; 8.104 ns ;
; N/A ; 113.47 MHz ( period = 8.813 ns ) ; lcd:inst1|clkcnt[0] ; lcd:inst1|clkcnt[4] ; mclk ; mclk ; None ; None ; 8.104 ns ;
; N/A ; 113.47 MHz ( period = 8.813 ns ) ; lcd:inst1|clkcnt[0] ; lcd:inst1|clkcnt[3] ; mclk ; mclk ; None ; None ; 8.104 ns ;
; N/A ; 113.47 MHz ( period = 8.813 ns ) ; lcd:inst1|clkcnt[0] ; lcd:inst1|clkcnt[2] ; mclk ; mclk ; None ; None ; 8.104 ns ;
; N/A ; 113.47 MHz ( period = 8.813 ns ) ; lcd:inst1|clkcnt[0] ; lcd:inst1|clkcnt[1] ; mclk ; mclk ; None ; None ; 8.104 ns ;
; N/A ; 113.47 MHz ( period = 8.813 ns ) ; lcd:inst1|clkcnt[0] ; lcd:inst1|clkcnt[0] ; mclk ; mclk ; None ; None ; 8.104 ns ;
; N/A ; 114.56 MHz ( period = 8.729 ns ) ; lcd:inst1|address[0] ; lcd:inst1|address[1] ; mclk ; mclk ; None ; None ; 6.503 ns ;
; N/A ; 115.57 MHz ( period = 8.653 ns ) ; lcd:inst1|clkcnt[2] ; lcd:inst1|clkcnt[6] ; mclk ; mclk ; None ; None ; 7.944 ns ;
; N/A ; 115.57 MHz ( period = 8.653 ns ) ; lcd:inst1|clkcnt[2] ; lcd:inst1|clkcnt[7] ; mclk ; mclk ; None ; None ; 7.944 ns ;
; N/A ; 115.57 MHz ( period = 8.653 ns ) ; lcd:inst1|clkcnt[2] ; lcd:inst1|clkcnt[5] ; mclk ; mclk ; None ; None ; 7.944 ns ;
; N/A ; 115.57 MHz ( period = 8.653 ns ) ; lcd:inst1|clkcnt[2] ; lcd:inst1|clkcnt[4] ; mclk ; mclk ; None ; None ; 7.944 ns ;
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