📄 pic16cxxx-1-9.htm
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<title>PIC16Cxxx单片机应用与设计</title>
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<td colspan="2"><font style="font-size:16px" color="#000000"><b>>> <a href="index.htm">PIC16CXXX单片机应用与设计</a>
\</b></font></td>
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<td colspan="2"> </td>
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<table width="700" border="0" cellspacing="0" cellpadding="2" class="lh15">
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<td align="center"><b><font size="3">第一章 PIC16C6X单片机</font><font size="3"></font></b></td>
</tr>
<tr>
<td> <p> </p></td>
</tr>
<tr valign="top">
<td height="300"> 六、复位标志位<br> 我们在§1.7.2讲述了特殊功能寄存器，其中状态寄存器STATUS
和上电标志寄存器PCON含有复位标志位TO、PD和POR，请参阅前面的叙述。PCON在16C61中没有。当芯片上电复位后，POR位被清为0，表示发生了上电过程。程序应将其置为1，以便它能标识下一次的上电复位。下表是各标志位在各种复位后的情况：<br>
<p align="center"><img src="image/a143.gif" width="507" height="196">
</p>
<p>七、复位后的寄存器值 <br>
各种复位后特殊功能寄存器的值或变化情况如下表所示：</p>
<p align="center"><img src="image/a142.gif" width="544" height="352"><br>
</p>
八、外部掉电复位锁定<br> 在一些应用中我们可能需要对芯片的供电电压VDD随时进行检测，一旦发现VDD电压下降（一般是系统掉电引起）到一个门槛值时就使芯片复位以免系统失控，下面是二个典型电路：<br>
<div align="center"> a. VDD〈Vz+0.7V时复位<br>
</div>
<p align="center"><img src="image/a144.gif" width="218" height="379"></p>
<p>九、内部掉电复位锁定</p>
<p><img src="image/a145.gif" width="429" height="78" hspace="30">
</p>
<p> 上面我们谈到VDD掉电复位锁定。在PIC16C62A/63/64A/65A等型号中，芯片中已集成有掉电复位锁定电路，请参见PCON寄存器和"系统定义字"（Configuration）中有关位的描述。当VDD掉到BVDD（典型值为4.0V）以下时，复位锁定电路将使芯片保持复位状态，当VDD上升到BVDD以上时，PWRT延时器将启动计数72ms，然后脱离复位状态恢复进入运行状态，见下图：
</p>
<p align="center"><img src="image/a146.gif" width="577" height="254">
</p>
<p align="center">图1.65 掉电复位锁定时序</p>
<p>§1.13.4 中 断<br>
<br>
PIC16C6X有多种中断源，最多的是PIC16C65，有11种中断，PIC16C61则有3种中断，见下表：</p>
<p align="center"><img src="image/a147.gif" width="648" height="312"><br>
</p>
在有关中断的寄存器INTCON、PIE1、PIE2、PIR1、PIR2 中包括了各种中断的使能位和标志位以及所有中断使能位GIE（INTCON<7>）。芯片复位后硬件自动置GIE=0，而中断返回指令"RETFIE"执行后将置GIE=1以重新开中断。当CPU响应中断后，硬件自动清GIE=0
以关闭所有中断以免发生重复中断，然后把当前的PC值（地址）压入堆栈，PC寄存器置以中断向量地址（0004H）。进入中断服务程序后，程序必须检查中断源，这可以通过检测中断标志位来进行。一旦查到中断源，即用软件把该中断标志位清为0，因为执行中断返回指令RETFIE会重开中断，这时如果有中断标志位为1，会引起重复中断。中断请求逻辑电路如下：
<br> <p align="center"><img src="image/a148.gif" width="547" height="539"></p>
<p>对于外部触发中断，如INT和RB口中断，中断延迟时间约有3～4个指令周期，这取决于中断请求发生的时机，见图1.60所示。</p>
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