📄 mcf5272.h
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#define MCF5272_RD_PLI_P3CR(IMMP) Mcf5272_iord(IMMP,MCF5272_PLI_P3CR,16)
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#define MCF5272_RD_PLI_PDRQR(IMMP) Mcf5272_iord(IMMP,MCF5272_PLI_PDRQR,16)
#define MCF5272_RD_PLI_P0SDR(IMMP) Mcf5272_iord(IMMP,MCF5272_PLI_P0SDR,16)
#define MCF5272_RD_PLI_P1SDR(IMMP) Mcf5272_iord(IMMP,MCF5272_PLI_P1SDR,16)
#define MCF5272_RD_PLI_P2SDR(IMMP) Mcf5272_iord(IMMP,MCF5272_PLI_P2SDR,16)
#define MCF5272_RD_PLI_P3SDR(IMMP) Mcf5272_iord(IMMP,MCF5272_PLI_P3SDR,16)
#define MCF5272_RD_PLI_PCKSELR(IMMP) Mcf5272_iord(IMMP,MCF5272_PLI_PCKSELR,16)
/* Write access macros for general use */
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Mcf5272_iowr(IMMP,MCF5272_PLI_P0B1TR,32,DATA)
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Mcf5272_iowr(IMMP,MCF5272_PLI_P1B1TR,32,DATA)
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Mcf5272_iowr(IMMP,MCF5272_PLI_P2B1TR,32,DATA)
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Mcf5272_iowr(IMMP,MCF5272_PLI_P3B1TR,32,DATA)
#define MCF5272_WR_PLI_P0B2TR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P0B2TR,32,DATA)
#define MCF5272_WR_PLI_P1B2TR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P1B2TR,32,DATA)
#define MCF5272_WR_PLI_P2B2TR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P2B2TR,32,DATA)
#define MCF5272_WR_PLI_P3B2TR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P3B2TR,32,DATA)
#define MCF5272_WR_PLI_P0DTR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P0DTR,8,DATA)
#define MCF5272_WR_PLI_P1DTR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P1DTR,8,DATA)
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Mcf5272_iowr(IMMP,MCF5272_PLI_P2DTR,8,DATA)
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Mcf5272_iowr(IMMP,MCF5272_PLI_P3DTR,8,DATA)
#define MCF5272_WR_PLI_P0CR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P0CR,16,DATA)
#define MCF5272_WR_PLI_P1CR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P1CR,16,DATA)
#define MCF5272_WR_PLI_P2CR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P2CR,16,DATA)
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Mcf5272_iowr(IMMP,MCF5272_PLI_P3CR,16,DATA)
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Mcf5272_iowr(IMMP,MCF5272_PLI_P0ICR,16,DATA)
#define MCF5272_WR_PLI_P1ICR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P1ICR,16,DATA)
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Mcf5272_iowr(IMMP,MCF5272_PLI_P2ICR,16,DATA)
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Mcf5272_iowr(IMMP,MCF5272_PLI_P3ICR,16,DATA)
#define MCF5272_WR_PLI_P0GMT(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P0GMR,16,DATA)
#define MCF5272_WR_PLI_P1GMT(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P1GMT,16,DATA)
#define MCF5272_WR_PLI_P2GMT(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P2GMT,16,DATA)
#define MCF5272_WR_PLI_P3GMT(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P3GMT,16,DATA)
#define MCF5272_WR_PLI_PGMTA(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_PGMTA,8,DATA)
#define MCF5272_WR_PLI_P0GCIT(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P0GCIT,8,DATA)
#define MCF5272_WR_PLI_P1GCIT(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P1GCIT,8,DATA)
#define MCF5272_WR_PLI_P2GCIT(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P2GCIT,8,DATA)
#define MCF5272_WR_PLI_P3GCIT(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P3GCIT,8,DATA)
#define MCF5272_WR_PLI_PLCR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_PLCR,8,DATA)
#define MCF5272_WR_PLI_PDRQR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_PDRQR,16,DATA)
#define MCF5272_WR_PLI_P0SDR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P0SDR,16,DATA)
#define MCF5272_WR_PLI_P1SDR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P1SDR,16,DATA)
#define MCF5272_WR_PLI_P2SDR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P2SDR,16,DATA)
#define MCF5272_WR_PLI_P3SDR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_P3SDR,16,DATA)
#define MCF5272_WR_PLI_PCKSELR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_PLI_PCKSELR,16,DATA)
/**********************************************************************
*
* Fast Ethernet Controller Module Register Descriptions
*
***********************************************************************/
/* Offsets of the registers from the MBAR */
#define MCF5272_FEC_ECR (0x0840)
#define MCF5272_FEC_EIR (0x0844)
#define MCF5272_FEC_IMR (0x0848)
#define MCF5272_FEC_IVSR (0x084C)
#define MCF5272_FEC_RDAR (0x0850)
#define MCF5272_FEC_TDAR (0x0854)
#define MCF5272_FEC_MMFR (0x0880)
#define MCF5272_FEC_MSCR (0x0884)
#define MCF5272_FEC_FRBR (0x08CC)
#define MCF5272_FEC_FRSR (0x08D0)
#define MCF5272_FEC_TFWR (0x08E4)
#define MCF5272_FEC_FTSR (0x08EC)
#define MCF5272_FEC_RCR (0x0944)
#define MCF5272_FEC_MFLR (0x0948)
#define MCF5272_FEC_TCR (0x0984)
#define MCF5272_FEC_MALR (0x0C00)
#define MCF5272_FEC_MAUR (0x0C04)
#define MCF5272_FEC_HTUR (0x0C08)
#define MCF5272_FEC_HTLR (0x0C0C)
#define MCF5272_FEC_ERDSR (0x0C10)
#define MCF5272_FEC_ETDSR (0x0C14)
#define MCF5272_FEC_EMRBR (0x0C18)
#define MCF5272_FEC_EFIFO (0x0C40) /* 0x0C40 - 0x0DFF */
/* Read access macros for general use */
#define MCF5272_RD_FEC_ECR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_ECR,32)
#define MCF5272_RD_FEC_EIR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_EIR,32)
#define MCF5272_RD_FEC_IMR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_IMR,32)
#define MCF5272_RD_FEC_IVSR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_IVSR,32)
#define MCF5272_RD_FEC_RDAR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_RDAR,32)
#define MCF5272_RD_FEC_TDAR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_TDAR,32)
#define MCF5272_RD_FEC_MMFR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_MMFR,32)
#define MCF5272_RD_FEC_MSCR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_MSCR,32)
#define MCF5272_RD_FEC_FRBR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_FRBR,32)
#define MCF5272_RD_FEC_FRSR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_FRSR,32)
#define MCF5272_RD_FEC_TFWR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_TFWR,32)
#define MCF5272_RD_FEC_FTSR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_FTSR,32)
#define MCF5272_RD_FEC_RCR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_RCR,32)
#define MCF5272_RD_FEC_MFLR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_MFLR,32)
#define MCF5272_RD_FEC_TCR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_TCR,32)
#define MCF5272_RD_FEC_MALR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_MALR,32)
#define MCF5272_RD_FEC_MAUR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_MAUR,32)
#define MCF5272_RD_FEC_HTUR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_HTUR,32)
#define MCF5272_RD_FEC_HTLR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_HTLR,32)
#define MCF5272_RD_FEC_ERDSR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_ERDSR,32)
#define MCF5272_RD_FEC_ETDSR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_ETDSR,32)
#define MCF5272_RD_FEC_EMRBR(IMMP) \
Mcf5272_iord(IMMP,MCF5272_FEC_EMRBR,32)
/* Write access macros for general use */
#define MCF5272_WR_FEC_ECR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_ECR,32,DATA)
#define MCF5272_WR_FEC_EIR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_EIR,32,DATA)
#define MCF5272_WR_FEC_IMR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_IMR,32,DATA)
#define MCF5272_WR_FEC_RDAR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_RDAR,32,DATA)
#define MCF5272_WR_FEC_TDAR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_TDAR,32,DATA)
#define MCF5272_WR_FEC_MMFR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_MMFR,32,DATA)
#define MCF5272_WR_FEC_MSCR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_MSCR,32,DATA)
#define MCF5272_WR_FEC_FRSR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_FRSR,32,DATA)
#define MCF5272_WR_FEC_TFWR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_TFWR,32,DATA)
#define MCF5272_WR_FEC_FTSR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_FTSR,32,DATA)
#define MCF5272_WR_FEC_RCR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_RCR,32,DATA)
#define MCF5272_WR_FEC_MFLR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_MFLR,32,DATA)
#define MCF5272_WR_FEC_TCR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_TCR,32,DATA)
#define MCF5272_WR_FEC_MALR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_MALR,32,DATA)
#define MCF5272_WR_FEC_MAUR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_MAUR,32,DATA)
#define MCF5272_WR_FEC_HTUR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_HTUR,32,DATA)
#define MCF5272_WR_FEC_HTLR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_HTLR,32,DATA)
#define MCF5272_WR_FEC_ERDSR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_ERDSR,32,DATA)
#define MCF5272_WR_FEC_ETDSR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_ETDSR,32,DATA)
#define MCF5272_WR_FEC_EMRBR(IMMP,DATA) \
Mcf5272_iowr(IMMP,MCF5272_FEC_EMRBR,32,DATA)
/* Bit level definitions and macros */
#define MCF5272_FEC_ECR_RESET (0x00000001)
#define MCF5272_FEC_ECR_ETHER_EN (0x00000002)
#define MCF5272_FEC_EIR_GRA (0x10000000)
#define MCF5272_FEC_EIR_RXF (0x02000000)
#define MCF5272_FEC_EIR_TXF (0x08000000)
#define MCF5272_FEC_IMR_HBEEN (0x80000000)
#define MCF5272_FEC_IMR_BREN (0x40000000)
#define MCF5272_FEC_IMR_BTEN (0x20000000)
#define MCF5272_FEC_IMR_GRAEN (0x10000000)
#define MCF5272_FEC_IMR_TXFEN (0x08000000)
#define MCF5272_FEC_IMR_TXBEN (0x04000000)
#define MCF5272_FEC_IMR_RXFEN (0x02000000)
#define MCF5272_FEC_IMR_RXBEN (0x01000000)
#define MCF5272_FEC_IMR_MIIEN (0x00800000)
#define MCF5272_FEC_IMR_EBERREN (0x00400000)
#define MCF5272_FEC_RCR_PROM (0x00000008)
#define MCF5272_FEC_RCR_MII_MODE (0x00000004)
#define MCF5272_FEC_RCR_DRT (0x00000002)
#define MCF5272_FEC_RCR_LOOP (0x00000001)
#define MCF5272_FEC_TCR_GTS (0x00000001)
#define MCF5272_FEC_TCR_HBC (0x00000002)
#define MCF5272_FEC_TCR_FDEN (0x00000004)
#define MCF5272_MMFR_MODE (0x00004000)
#define MCF5272_MMFR_DUPLEX (0x00000200)
#define MCF5272_MMFR_LOOP (0x00004000)
#define MCF5272_MMFR_NEGOTIATE (0x00001000)
#define MCF5272_MMFR_100 (0x00002000)
/**********************************************************************
*
* USB_ Module Register Description
*
***********************************************************************/
/* Offsets of the registers from the MBAR */
#define MCF5272_USB_FNR (0x1002)
#define MCF5272_USB_FNMR (0x1006)
#define MCF5272_USB_RFMR (0x100A)
#define MCF5272_USB_RFMMR (0x100E)
#define MCF5272_USB_FAR (0x1013)
#define MCF5272_USB_ASR (0x1014)
#define MCF5272_USB_DRR1 (0x1018)
#define MCF5272_USB_DRR2 (0x101C)
#define MCF5272_USB_SPECR (0x1022)
#define MCF5272_USB_EP0SR (0x1026)
#define MCF5272_USB_IEP0CFG (0x1028)
#define MCF5272_USB_OEP0CFG (0x102C)
#define MCF5272_USB_EP1CFG (0x1030)
#define MCF5272_USB_EP2CFG (0x1034)
#define MCF5272_USB_EP3CFG (0x1038)
#define MCF5272_USB_EP4CFG (0x103C)
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