📄 基于cpld控制的直流固态功率控制器的设计，sspc ，cpld，反时限保护-中电网.htm
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<DIV align=center>基于CPLD控制的直流固态功率控制器的设计</DIV></TD></TR>
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<DIV align=center>陈再春，谢拴勤</DIV></TD></TR>
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<DIV align=center>(西北工业大学 自动化学院，陕西 西安710072)</DIV></TD></TR>
<TR class=l12>
<TD>
<P><BR>SSPC(固态功率控制器)是由半导体器件构成的智能开关装置，用于接通／断开电路，实现电路保护和接收上级计算机的控制信号并向上位机实时反馈其状态信息。由于控制逻辑完全由CPLD内部的硬件电路完成，因此与功率器件一起工作时，具有很好的电磁兼容性和抗干扰能力。研制多开关的SSPC组共享大规模控制芯片，具有相当大的工程实用价值，尤其适用于空间有限的场合，如飞机上。</P>
<P>本文充分利用CPLD的特点，设计了具有集成度高、速度快、抗干扰能力强和可靠性高等优点的28V直流SSPC。在一块电路板上集成多个SSPC，各个功率开关问相互独立工作，进一步提高了功率密度。<BR><BR><B>1
功能定义</B></P>
<P>28V直流SSPC应该具有以下功能：</P>
<P>(1) 接收上位机的控制信号。该控制信号能够兼容TTL／CMOS电平，且高电平表示导通，低电平表示关断；</P>
<P>(2) 根据流过的SSPC的电流逻辑分析出自身的状态，并根据表1中的代码表示上传给上位机；</P>
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<P>(3) SSPC能够实时诊断自身故障，并根据故障的严重程度不同，采取不同的保护措施。</P>
<P><B>2 总体方案设计</B></P>
<P>28V直流SSPC组的结构如图1所示。</P>
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<TD>
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<P>每路SSPC的取样电阻上的电压经过调理电路和低通滤波以后，送到4通道的A／D转换器的模拟输入端，A／D转换器的数据输出端、状态信号和控制信号分别接到CPLD的I／O引脚，便于程序控制A／D转换器的动作。CPLD另外的I／O口可以配置为MOSFET的动作命令输出口线、SSPC的状态输出口线和与上位机相连的控制命令输入口线；CPLD自身提供的JTAG
BST电路，可以方便地测试系统内部测试器件之间的连接和检验器件的操作。</P>
<P>由CPLD组成的逻辑判断电路的主要功能有：</P>
<P>(1) 将A／D转换得到的数据通过逻辑判断，综合出SSPC的工作状态并向上位机输出；</P>
<P>(2) 接收上位机的控制命令，结合自身的工作状态，综合得出SSPC的通断信号，控制MOSFET的开通和关断。</P>
<P><B>3 硬件设计</B></P>
<P>(1) 关键器件选型</P>
<P>电力MOSFET选用IR公司的IRF540N，它的漏-源最大耐压为IOOV，导通阻抗44mΩ，允许通过的最大电流33A。其最大优点为纳秒级的开通和关断时间，能够完全满足设计需要。</P>
<P>逻辑控制芯片采用ALTERA公司的flex6000系列。该系列采用的OptiFLEX结构增加了器件的有效面积，可用门的数目达8
000～24
000门，触发器丰富且基于LUT(查找表)结构，能够满足系统处理数据的需要。其待机状态的电流小于1mA的低功耗模式，具有强功能的I／O引脚和灵活的内部连接等优点，从而使其成为设计首选。</P>
<P>(2) 硬件电路的组成</P>
<P>①电力MOSFET驱动和保护电路[3]：采用专门的驱动芯片TC4427，12V供电，如图2所示。为了抑制电压和电流的瞬变，MOSFET保护电路采用RCD吸收电路，用以减小器件的开关损耗。</P>
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<P>②取样电路：利用取样电阻(一般选用康铜丝)，将流过负载的电流信号转化成可测的电压信号，经过隔离放大器、整流电路、滤波电路、采样保持器和A／D转换电路，将数字信号传送到CPLD进行逻辑分析。</P>
<P>③信号采集和调理电路：通过隔离放大器，将取样电阻的电压调节到A／D转换器的允许范围内，经过R-C低通滤波器滤除噪声信号后，送到A／D转换器的输入端。</P>
<P>④A／D转换电路：采用12位的四通道A／D转换器AD7864，与CPLD的接口主要有：a．数据输出线：与CPLD的I／O口相连；b．控制线：转换启动信号(CONVST)、片选信号(CS)、通道选择信号(H／S
SEL和SL1～SL4)以及读写控制信号(RD／WR)等；c．状态线：BUSY信号和转换结束标志(EOC)等。</P>
<P>⑤隔离电路：CPLD为3V
I／O供电和2.5V内核供电，因此采集的SSPC状态信号和接收的电力MOSFET控制信号都需要经过电平转换及电气隔离，但实际上要采用光耦隔离的方式进行。因为MOSFET的控制信号需要较大的驱动电流，如果直接从CPLD输出来驱动，会因CPLD电流太小而无法驱动，所以实际中采用六通道反相器74LF04来做光耦前一级的驱动；接收上位机输出的控制信号是从光耦输出来的，其电流一般不大(Ie<5mA)，所以可以直接接在CPLD的I／O口上。</P>
<P><B>4 软件功能设计</B></P>
<P>(1) 控制AD7864的动作，从数据口读出转换的结果。</P>
<P>运用状态机的设计方法，AD7864的动作可大致分为3个步骤区间，每个步骤对应一个状态，每个状态赋予CPLD特定的功能。</P>
<P>①在步骤S0(CS=1、WR=1、RD=1)时，A／D转换之中；</P>
<P>②在步骤S1(CS=0、WR=1、RD=1)时，监控EOC信号是否由高电平变为低电平，即<BR>A／D转换是否结束；</P>
<P>③在步骤S2(CS=0、WR=1、RD=0)时，从DB0～DB11读取转换的结果。</P>
<P>软件流程如图3所示。</P>
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<TR>
<TD>
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<P>(2) 对采集的数据进行分析。</P>
<P>数据分析流程如图4所示。</P>
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<TD>
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<P>①当电流在额定范围内时，SSPC正常工作；</P>
<P>②当电流大于额定电流，而小于额定电流的800％时，SSPC进入反时限保护；</P>
<P>③当电流大于额定电流的800％时，SSPC立刻跳闸。</P>
<P>下面介绍SSPC的反时限保护阶段的算法推导。</P>
<P>反时限保护曲线的通用表达式为：</P>
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<TD>
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<P>式中：t为以秒为单位的动作时间；k为时间系数(整定值)；I为测量的电流；Iopr为电流动作定值。反时限保护曲线的陡度，由α、β共同决定。<BR><BR>将上式化为kβ=「(I／Iopr)α-1」t，</P>
<P>离散模型为：</P>
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<TR>
<TD>
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<P>采样周期△t=20/N(ms)为常数(N为每周期内采样点数)，M为使等式成立时累加的采样周期数；当电流I大于反时限启动电流Iopr时，即I／Iopr大于1时，在每个采样周期中断中将此周期的「(I／Iopr)α-1
」累加，当累加值大于kβ／△t时，反时限累计延时到，保护跳闸。</P>
<P>用VHDL语言实现的反时限保护算法流程如图5所示。</P>
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<TD>
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<P>(3)
SSPC将内部采集到的电流信号、接收到的控制命令和内部状态(包括系统启动的状态、电流在不同的范围内变化、跳闸的条件和从跳闸恢复到正常的条件以及故障切除和未切除时的系统启动等)经过逻辑判断后，综合出MOSFET的导通／关断指令，作为驱动电路的输入信号。</P>
<P>软件流程如图6所示。<BR></P>
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<TD>
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<P><B>5 试验结果</B></P>
<P>该仿真是在ALTERA系列CPLD的开发环境MAX+PLUS
II上进行的。当在不同的电流值下采集到的四路SSPC负载电流为不同值时，SSPC的工作情况也不一样。</P>
<P>(1) 当I／Iopr<l时，SSPC正常导通；当I／Iopr>8时，SSPC立即跳闸。</P>
<P>(2)
当I／Iopr为1.2(SSPC_1)、2(SSPC_2)、由1.2增加到2(SSPC_3)和5(SSPC_4)时，SSPC的跳闸时间分别为402ms、161ms、223ms和26ms。</P>
<P>各个临界点的实验所得数据经过曲线拟和，得到如图7所示结果。</P>
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<P>试验结果表明，利用CPLD进行SSPC的开发设计，其延迟时间完全可以通过编程控制，且各路SSPC之间干扰较少。</P>
<P>CPLD内部的硬件结构决定了系统良好的抗干扰性和高可靠性，非常适合于电力系统方面的控制。因此，采用CPLD应是一个研究方向。</P></TD></TR>
<TR>
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<TR>
<TD>
<DIV
align=center>本文摘自《电子技术应用》</DIV></TD></TR></TBODY></TABLE></TD></TR></TBODY></TABLE>
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