📄 core.sdc
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define_clock -name {clk} -freq 50.0 -clockgroup default_clkgroupdefine_clock -name {pci_clk_in} -freq 40.000 -clockgroup pci_clkgroupdefine_clock -name {erx_clk} -freq 30.000 -clockgroup erx_clk_clkgroupdefine_clock -name {etx_clk} -freq 30.000 -clockgroup etx_clk_clkgroupdefine_output_delay -default 8.00 -ref clk:rdefine_input_delay -default 10.00 -ref clk:rdefine_output_delay -default 14.00 -ref pci_clk_in:rdefine_input_delay -default 18.00 -ref pci_clk_in:rdefine_output_delay -default 8.00 -ref erx_clk:rdefine_input_delay -default 10.00 -ref erx_clk:rdefine_output_delay -default 8.00 -ref etx_clk:rdefine_input_delay -default 10.00 -ref etx_clk:rdefine_global_attribute syn_useioff {1}
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