📄 exam2.fit.rpt
字号:
; 7 ; GND* ; ;
; 8 ; GND* ; ;
; 9 ; GND* ; ;
; 10 ; GND* ; ;
; 11 ; GND* ; ;
; 12 ; GND* ; ;
; 13 ; GND* ; ;
; 14 ; GND* ; ;
; 15 ; GND_INT ; ;
; 16 ; VCC_INT ; ;
; 17 ; GND* ; ;
; 18 ; GND* ; ;
; 19 ; GND* ; ;
; 20 ; GND* ; ;
; 21 ; GND* ; ;
; 22 ; GND* ; ;
; 23 ; GND* ; ;
; 24 ; VCC_IO ; ;
; 25 ; GND_INT ; ;
; 26 ; GND* ; ;
; 27 ; GND* ; ;
; 28 ; GND* ; ;
; 29 ; GND* ; ;
; 30 ; CLR ; LVTTL/LVCMOS ;
; 31 ; ENA ; LVTTL/LVCMOS ;
; 32 ; UPWORD ; LVTTL/LVCMOS ;
; 33 ; QOUT ; LVTTL/LVCMOS ;
; 34 ; #TMS ; ;
; 35 ; ^nSTATUS ; ;
; 36 ; RESET ; LVTTL/LVCMOS ;
; 37 ; W_CLK ; LVTTL/LVCMOS ;
; 38 ; GND* ; ;
; 39 ; READ ; LVTTL/LVCMOS ;
; 40 ; GND_INT ; ;
; 41 ; GND* ; ;
; 42 ; GND* ; ;
; 43 ; GND* ; ;
; 44 ; GND* ; ;
; 45 ; VCC_IO ; ;
; 46 ; GND* ; ;
; 47 ; GND* ; ;
; 48 ; GND* ; ;
; 49 ; GND* ; ;
; 50 ; VCC_INT ; ;
; 51 ; GND* ; ;
; 52 ; GND_INT ; ;
; 53 ; VCC_CKLK ; ;
; 54 ; SCLK1 ; LVTTL/LVCMOS ;
; 55 ; GND+ ; ;
; 56 ; SCLK0 ; LVTTL/LVCMOS ;
; 57 ; GND_CKLK ; ;
; 58 ; GND_INT ; ;
; 59 ; GND* ; ;
; 60 ; GND* ; ;
; 61 ; VCC_IO ; ;
; 62 ; FOUT[8] ; LVTTL/LVCMOS ;
; 63 ; FOUT[9] ; LVTTL/LVCMOS ;
; 64 ; FOUT[6] ; LVTTL/LVCMOS ;
; 65 ; DATA[7] ; LVTTL/LVCMOS ;
; 66 ; GND_INT ; ;
; 67 ; DATA[6] ; LVTTL/LVCMOS ;
; 68 ; DATA[5] ; LVTTL/LVCMOS ;
; 69 ; DATA[4] ; LVTTL/LVCMOS ;
; 70 ; DATA[3] ; LVTTL/LVCMOS ;
; 71 ; VCC_IO ; ;
; 72 ; DATA[2] ; LVTTL/LVCMOS ;
; 73 ; DATA[1] ; LVTTL/LVCMOS ;
; 74 ; ^nCONFIG ; ;
; 75 ; VCC_INT ; ;
; 76 ; ^MSEL1 ; ;
; 77 ; ^MSEL0 ; ;
; 78 ; DATA[0] ; LVTTL/LVCMOS ;
; 79 ; GND* ; ;
; 80 ; POUT[5] ; LVTTL/LVCMOS ;
; 81 ; POUT[7] ; LVTTL/LVCMOS ;
; 82 ; POUT[6] ; LVTTL/LVCMOS ;
; 83 ; POUT[9] ; LVTTL/LVCMOS ;
; 84 ; GND_INT ; ;
; 85 ; VCC_INT ; ;
; 86 ; POUT[8] ; LVTTL/LVCMOS ;
; 87 ; WORD[0] ; LVTTL/LVCMOS ;
; 88 ; WORD[1] ; LVTTL/LVCMOS ;
; 89 ; WORD[2] ; LVTTL/LVCMOS ;
; 90 ; WORD[3] ; LVTTL/LVCMOS ;
; 91 ; WORD[4] ; LVTTL/LVCMOS ;
; 92 ; WORD[5] ; LVTTL/LVCMOS ;
; 93 ; GND_INT ; ;
; 94 ; VCC_IO ; ;
; 95 ; WORD[6] ; LVTTL/LVCMOS ;
; 96 ; WORD[7] ; LVTTL/LVCMOS ;
; 97 ; GND* ; ;
; 98 ; GND* ; ;
; 99 ; GND* ; ;
; 100 ; FOUT[5] ; LVTTL/LVCMOS ;
; 101 ; FOUT[4] ; LVTTL/LVCMOS ;
; 102 ; FOUT[7] ; LVTTL/LVCMOS ;
; 103 ; VCC_INT ; ;
; 104 ; GND_INT ; ;
; 105 ; #TDI ; ;
; 106 ; ^nCE ; ;
; 107 ; ^DCLK ; ;
; 108 ; ^DATA0 ; ;
; 109 ; GND* ; ;
; 110 ; GND* ; ;
; 111 ; GND* ; ;
; 112 ; GND* ; ;
; 113 ; GND* ; ;
; 114 ; GND* ; ;
; 115 ; VCC_IO ; ;
; 116 ; SEL[2] ; LVTTL/LVCMOS ;
; 117 ; SEL[3] ; LVTTL/LVCMOS ;
; 118 ; SEL[0] ; LVTTL/LVCMOS ;
; 119 ; SEL[1] ; LVTTL/LVCMOS ;
; 120 ; POUT[3] ; LVTTL/LVCMOS ;
; 121 ; POUT[4] ; LVTTL/LVCMOS ;
; 122 ; FOUT[1] ; LVTTL/LVCMOS ;
; 123 ; GND_INT ; ;
; 124 ; CLKIN_12M ; LVTTL/LVCMOS ;
; 125 ; GND+ ; ;
; 126 ; BCLK ; LVTTL/LVCMOS ;
; 127 ; VCC_INT ; ;
; 128 ; FOUT[0] ; LVTTL/LVCMOS ;
; 129 ; GND_INT ; ;
; 130 ; FOUT[3] ; LVTTL/LVCMOS ;
; 131 ; FOUT[2] ; LVTTL/LVCMOS ;
; 132 ; POUT[2] ; LVTTL/LVCMOS ;
; 133 ; POUT[1] ; LVTTL/LVCMOS ;
; 134 ; VCC_IO ; ;
; 135 ; POUT[0] ; LVTTL/LVCMOS ;
; 136 ; GND* ; ;
; 137 ; GND* ; ;
; 138 ; GND* ; ;
; 139 ; GND_INT ; ;
; 140 ; GND* ; ;
; 141 ; GND* ; ;
; 142 ; GND* ; ;
; 143 ; GND* ; ;
; 144 ; GND* ; ;
+-------+------------+--------------+
+----------------------------------------------------------------+
; Control Signals ;
+--------------+---------+---------+--------------+--------------+
; Name ; Pin # ; Fan-Out ; Usage ; Global Usage ;
+--------------+---------+---------+--------------+--------------+
; READ ; 39 ; 8 ; Clock ; Non-global ;
; SCLK0 ; 56 ; 18 ; Clock ; Pin ;
; TCLK ; LC1_A12 ; 32 ; Clock ; Non-global ;
; SCLK1 ; 54 ; 2 ; Clock ; Pin ;
; CLKIN_12M ; 124 ; 1 ; Clock ; Pin ;
; CLK_6M ; LC1_B2 ; 55 ; Clock ; Non-global ;
; UPWORD ; 32 ; 34 ; Clock ; Non-global ;
; FWORD[15]~60 ; LC2_C3 ; 8 ; Clock enable ; Non-global ;
; FWORD[7]~61 ; LC1_C3 ; 8 ; Clock enable ; Non-global ;
; PWORD[9]~48 ; LC2_C4 ; 2 ; Clock enable ; Non-global ;
; PWORD[7]~49 ; LC1_C4 ; 8 ; Clock enable ; Non-global ;
; RESET ; 36 ; 31 ; Async. clear ; Non-global ;
; P10B[9]~75 ; LC1_C5 ; 26 ; Clock enable ; Non-global ;
; ENA ; 31 ; 80 ; Clock enable ; Non-global ;
; CLR ; 30 ; 80 ; Async. clear ; Non-global ;
; BCLK ; 126 ; 33 ; Clock ; Pin ;
; W_CLK ; 37 ; 30 ; Clock ; Non-global ;
+--------------+---------+---------+--------------+--------------+
+--------------------------------------+
; Global & Other Fast Signals ;
+-----------+-------+---------+--------+
; Name ; Pin # ; Fan-Out ; Global ;
+-----------+-------+---------+--------+
; SCLK0 ; 56 ; 18 ; yes ;
; SCLK1 ; 54 ; 2 ; yes ;
; CLKIN_12M ; 124 ; 1 ; yes ;
; BCLK ; 126 ; 33 ; yes ;
+-----------+-------+---------+--------+
+---------------------------------------------+
; Carry Chains ;
+--------------------+------------------------+
; Carry Chain Length ; Number of Carry Chains ;
+--------------------+------------------------+
; 0 - 2 ; 0 ;
; 3 - 5 ; 0 ;
; 6 - 8 ; 0 ;
; 9 - 11 ; 1 ;
; 12 - 14 ; 0 ;
; 15 - 17 ; 1 ;
; 18 - 20 ; 0 ;
; 21 - 23 ; 0 ;
; 24 - 26 ; 1 ;
; 27 - 29 ; 0 ;
; 30 - 32 ; 2 ;
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