second_pulse_latch.tan.rpt

步进电机位置控制系统的FPGA设计与实现。

; N/A   ; None         ; 4.000 ns   ; second_pulse_out[13]~reg0 ; second_pulse_out[13] ; Clk_1Hz    ;
; N/A   ; None         ; 4.000 ns   ; second_pulse_out[12]~reg0 ; second_pulse_out[12] ; Clk_1Hz    ;
; N/A   ; None         ; 4.000 ns   ; second_pulse_out[11]~reg0 ; second_pulse_out[11] ; Clk_1Hz    ;
; N/A   ; None         ; 4.000 ns   ; second_pulse_out[10]~reg0 ; second_pulse_out[10] ; Clk_1Hz    ;
; N/A   ; None         ; 4.000 ns   ; second_pulse_out[9]~reg0  ; second_pulse_out[9]  ; Clk_1Hz    ;
; N/A   ; None         ; 4.000 ns   ; second_pulse_out[8]~reg0  ; second_pulse_out[8]  ; Clk_1Hz    ;
; N/A   ; None         ; 4.000 ns   ; second_pulse_out[7]~reg0  ; second_pulse_out[7]  ; Clk_1Hz    ;
; N/A   ; None         ; 4.000 ns   ; second_pulse_out[6]~reg0  ; second_pulse_out[6]  ; Clk_1Hz    ;
; N/A   ; None         ; 4.000 ns   ; second_pulse_out[5]~reg0  ; second_pulse_out[5]  ; Clk_1Hz    ;
; N/A   ; None         ; 4.000 ns   ; second_pulse_out[4]~reg0  ; second_pulse_out[4]  ; Clk_1Hz    ;
; N/A   ; None         ; 4.000 ns   ; second_pulse_out[3]~reg0  ; second_pulse_out[3]  ; Clk_1Hz    ;
; N/A   ; None         ; 4.000 ns   ; second_pulse_out[2]~reg0  ; second_pulse_out[2]  ; Clk_1Hz    ;
; N/A   ; None         ; 4.000 ns   ; second_pulse_out[1]~reg0  ; second_pulse_out[1]  ; Clk_1Hz    ;
; N/A   ; None         ; 4.000 ns   ; second_pulse_out[0]~reg0  ; second_pulse_out[0]  ; Clk_1Hz    ;
+-------+--------------+------------+---------------------------+----------------------+------------+


+----------------------------------------------------------------------------------------------------+
; th                                                                                                 ;
+---------------+-------------+------------+------------------+---------------------------+----------+
; Minimum Slack ; Required th ; Actual th  ; From             ; To                        ; To Clock ;
+---------------+-------------+------------+------------------+---------------------------+----------+
; N/A           ; None        ; -0.800 ns  ; acceleration[7]  ; second_pulse_out[7]~reg0  ; Clk_1Hz  ;
; N/A           ; None        ; -0.900 ns  ; acceleration[8]  ; second_pulse_out[8]~reg0  ; Clk_1Hz  ;
; N/A           ; None        ; -1.000 ns  ; acceleration[1]  ; second_pulse_out[1]~reg0  ; Clk_1Hz  ;
; N/A           ; None        ; -1.000 ns  ; acceleration[0]  ; second_pulse_out[0]~reg0  ; Clk_1Hz  ;
; N/A           ; None        ; -1.000 ns  ; acceleration[0]  ; second_pulse_out[1]~reg0  ; Clk_1Hz  ;
; N/A           ; None        ; -1.100 ns  ; acceleration[16] ; second_pulse_out[14]~reg0 ; Clk_1Hz  ;
; N/A           ; None        ; -1.100 ns  ; acceleration[16] ; second_pulse_out[11]~reg0 ; Clk_1Hz  ;
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; N/A           ; None        ; -1.100 ns  ; acceleration[16] ; second_pulse_out[5]~reg0  ; Clk_1Hz  ;
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; N/A           ; None        ; -1.100 ns  ; acceleration[16] ; second_pulse_out[13]~reg0 ; Clk_1Hz  ;
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; N/A           ; None        ; -1.100 ns  ; acceleration[16] ; second_pulse_out[15]~reg0 ; Clk_1Hz  ;
; N/A           ; None        ; -1.100 ns  ; Reset            ; second_pulse_out[14]~reg0 ; Clk_1Hz  ;
; N/A           ; None        ; -1.100 ns  ; Reset            ; second_pulse_out[11]~reg0 ; Clk_1Hz  ;
; N/A           ; None        ; -1.100 ns  ; Reset            ; second_pulse_out[6]~reg0  ; Clk_1Hz  ;
; N/A           ; None        ; -1.100 ns  ; Reset            ; second_pulse_out[5]~reg0  ; Clk_1Hz  ;
; N/A           ; None        ; -1.100 ns  ; Reset            ; second_pulse_out[4]~reg0  ; Clk_1Hz  ;
; N/A           ; None        ; -1.100 ns  ; Reset            ; second_pulse_out[3]~reg0  ; Clk_1Hz  ;
; N/A           ; None        ; -1.100 ns  ; Reset            ; second_pulse_out[0]~reg0  ; Clk_1Hz  ;
; N/A           ; None        ; -1.100 ns  ; Reset            ; second_pulse_out[2]~reg0  ; Clk_1Hz  ;
; N/A           ; None        ; -1.100 ns  ; Reset            ; second_pulse_out[1]~reg0  ; Clk_1Hz  ;
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; N/A           ; None        ; -1.100 ns  ; Reset            ; second_pulse_out[8]~reg0  ; Clk_1Hz  ;
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; N/A           ; None        ; -1.100 ns  ; Reset            ; second_pulse_out[15]~reg0 ; Clk_1Hz  ;
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; N/A           ; None        ; -9.900 ns  ; acceleration[13] ; second_pulse_out[13]~reg0 ; Clk_1Hz  ;
; N/A           ; None        ; -9.900 ns  ; acceleration