📄 trafficlight.fit.rpt
字号:
; 38 ; 44 ; 4 ; Green1 ; output ; LVTTL ; ; Column I/O ; N ;
; 39 ; 45 ; 4 ; Yellow1 ; output ; LVTTL ; ; Column I/O ; N ;
; 40 ; 46 ; 4 ; Red1 ; output ; LVTTL ; ; Column I/O ; N ;
; 41 ; 49 ; 4 ; SW ; input ; LVTTL ; ; Column I/O ; N ;
; 42 ; 50 ; 4 ; Yellow2 ; output ; LVTTL ; ; Column I/O ; N ;
; 43 ; ; ; GND ; gnd ; ; ; -- ; ;
; 44 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 45 ; ; ; GND ; gnd ; ; ; -- ; ;
; 46 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ;
; 47 ; 51 ; 4 ; Green2 ; output ; LVTTL ; ; Column I/O ; N ;
; 48 ; 52 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 49 ; 55 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 50 ; 56 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 51 ; 57 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 52 ; 58 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 53 ; 59 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 54 ; 60 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 55 ; 61 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 56 ; 62 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 57 ; 63 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 58 ; ; ; GND ; gnd ; ; ; -- ; ;
; 59 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ;
; 60 ; 68 ; 3 ; ^CONF_DONE ; ; ; ; -- ; ;
; 61 ; 69 ; 3 ; ^nSTATUS ; ; ; ; -- ; ;
; 62 ; 70 ; 3 ; #TCK ; input ; ; ; -- ; ;
; 63 ; 71 ; 3 ; #TMS ; input ; ; ; -- ; ;
; 64 ; 72 ; 3 ; #TDO ; output ; ; ; -- ; ;
; 65 ; 73 ; 3 ; Red2 ; output ; LVTTL ; ; Row I/O ; N ;
; 66 ; 75 ; 3 ; GND+ ; ; ; ; Row I/O ; ;
; 67 ; 77 ; 3 ; #TDI ; input ; ; ; -- ; ;
; 68 ; 78 ; 3 ; SEG_Sel[1] ; output ; LVTTL ; ; Row I/O ; N ;
; 69 ; 79 ; 3 ; SEG_Data[5] ; output ; LVTTL ; ; Row I/O ; N ;
; 70 ; 80 ; 3 ; SEG_Sel[0] ; output ; LVTTL ; ; Row I/O ; N ;
; 71 ; 81 ; 3 ; SEG_Data[7] ; output ; LVTTL ; ; Row I/O ; N ;
; 72 ; 82 ; 3 ; SEG_Data[4] ; output ; LVTTL ; ; Row I/O ; N ;
; 73 ; 84 ; 3 ; SEG_Data[3] ; output ; LVTTL ; ; Row I/O ; N ;
; 74 ; 87 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 75 ; 88 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 76 ; 89 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 77 ; 90 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 78 ; 93 ; 2 ; SEG_Data[1] ; output ; LVTTL ; ; Column I/O ; N ;
; 79 ; 94 ; 2 ; SEG_Data[2] ; output ; LVTTL ; ; Column I/O ; N ;
; 80 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ;
; 81 ; ; ; GND ; gnd ; ; ; -- ; ;
; 82 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 83 ; ; ; GND ; gnd ; ; ; -- ; ;
; 84 ; 95 ; 2 ; Reset ; input ; LVTTL ; ; Column I/O ; N ;
; 85 ; 96 ; 2 ; SEG_Data[6] ; output ; LVTTL ; ; Column I/O ; N ;
; 86 ; 99 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 87 ; 100 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 88 ; 101 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 89 ; 105 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 90 ; 106 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 91 ; 109 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 92 ; 110 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 93 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 94 ; ; ; GND ; gnd ; ; ; -- ; ;
; 95 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ;
; 96 ; ; ; GND ; gnd ; ; ; -- ; ;
; 97 ; 111 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 98 ; 112 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 99 ; 115 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 100 ; 116 ; 2 ; GND* ; ; ; ; Column I/O ; ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
+------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+---------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+---------------------+-------+------------------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; 2.5 V ; 10 pF ; Not Available ;
; 1.8 V ; 10 pF ; Not Available ;
; 1.5 V ; 10 pF ; Not Available ;
; SSTL-3 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-3 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; Differential SSTL-2 ; 30 pF ; (See SSTL-2) ;
+---------------------+-------+------------------------------------+
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------+
; |trafficlight ; 152 (0) ; 83 ; 0 ; 19 ; 0 ; 69 (0) ; 3 (0) ; 80 (0) ; 83 (0) ; |trafficlight ;
; |control:inst14| ; 6 (6) ; 0 ; 0 ; 0 ; 0 ; 6 (6) ; 0 (0) ; 0 (0) ; 0 (0) ; |trafficlight|control:inst14 ;
; |counter05:inst1| ; 7 (3) ; 5 ; 0 ; 0 ; 0 ; 2 (2) ; 0 (0) ; 5 (1) ; 4 (0) ; |trafficlight|counter05:inst1 ;
; |lpm_counter:CData0_rtl_1| ; 4 (0) ; 4 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |trafficlight|counter05:inst1|lpm_counter:CData0_rtl_1 ;
; |cntr_0b7:auto_generated| ; 4 (4) ; 4 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (4) ; 4 (4) ; |trafficlight|counter05:inst1|lpm_counter:CData0_rtl_1|cntr_0b7:auto_generated ;
; |counter55:inst2| ; 25 (16) ; 9 ; 0 ; 0 ; 0 ; 16 (15) ; 0 (0) ; 9 (1) ; 15 (7) ; |trafficlight|counter55:inst2 ;
; |lpm_counter:CData0_rtl_0| ; 4 (0) ; 4 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |trafficlight|counter55:inst2|lpm_counter:CData0_rtl_0 ;
; |cntr_0b7:auto_generated| ; 4 (4) ; 4 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (4) ; 4 (4) ; |trafficlight|counter55:inst2|lpm_counter:CData0_rtl_0|cntr_0b7:auto_generated ;
; |lpm_counter:CData1_rtl_2| ; 5 (0) ; 4 ; 0 ; 0 ; 0 ; 1 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |trafficlight|counter55:inst2|lpm_counter:CData1_rtl_2 ;
; |cntr_cv7:auto_generated| ; 5 (5) ; 4 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 4 (4) ; 4 (4) ; |trafficlight|counter55:inst2|lpm_counter:CData1_rtl_2|cntr_cv7:auto_generated ;
; |datamux:inst6| ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 0 (0) ; 0 (0) ; |trafficlight|datamux:inst6 ;
; |dispdecoder:inst7| ; 7 (7) ; 0 ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 0 (0) ; 0 (0) ; |trafficlight|dispdecoder:inst7 ;
; |dispmux:inst8| ; 16 (16) ; 0 ; 0 ; 0 ; 0 ; 16 (16) ; 0 (0) ; 0 (0) ; 0 (0) ; |trafficlight|dispmux:inst8 ;
; |dispselect:inst9| ; 1 (1) ; 1 ; 0 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |trafficlight|dispselect:inst9 ;
; |fdiv1hz:inst11| ; 43 (11) ; 33 ; 0 ; 0 ; 0 ; 10 (10) ; 0 (0) ; 33 (1) ; 32 (0) ; |trafficlight|fdiv1hz:inst11 ;
; |lpm_counter:cnt_rtl_4| ; 32 (0) ; 32 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 32 (0) ; 32 (0) ; |trafficlight|fdiv1hz:inst11|lpm_counter:cnt_rtl_4 ;
; |cntr_hc7:auto_generated| ; 32 (32) ; 32 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 32 (32) ; 32 (32) ; |trafficlight|fdiv1hz:inst11|lpm_counter:cnt_rtl_4|cntr_hc7:auto_generated ;
; |fdiv1khz:inst12| ; 43 (11) ; 33 ; 0 ; 0 ; 0 ; 10 (10) ; 0 (0) ; 33 (1) ; 32 (0) ; |trafficlight|fdiv1khz:inst12 ;
; |lpm_counter:cnt_rtl_3| ; 32 (0) ; 32 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 32 (0) ; 32 (0) ; |trafficlight|fdiv1khz:inst12|lpm_counter:cnt_rtl_3 ;
; |cntr_hc7:auto_generated| ; 32 (32) ; 32 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 32 (32) ; 32 (32) ; |trafficlight|fdiv1khz:inst12|lpm_counter:cnt_rtl_3|cntr_hc7:auto_generated ;
; |scan:inst| ; 3 (3) ; 2 ; 0 ; 0 ; 0 ; 1 (1) ; 2 (2) ; 0 (0) ; 0 (0) ; |trafficlight|scan:inst ;
+------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------+
+--------------------------------------------------------------------------------------+
; Delay Chain Summary ;
+-------------+----------+---------------+---------------+-----------------------+-----+
; Name ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ;
+-------------+----------+---------------+---------------+-----------------------+-----+
; Reset ; Input ; ON ; ON ; -- ; -- ;
; SW ; Input ; OFF ; ON ; -- ; -- ;
; CLK ; Input ; OFF ; OFF ; -- ; -- ;
; Red1 ; Output ; -- ; -- ; -- ; -- ;
; Red2 ; Output ; -- ; -- ; -- ; -- ;
; Yellow1 ; Output ; -- ; -- ; -- ; -- ;
; Yellow2 ; Output ; -- ; -- ; -- ; -- ;
; Green1 ; Output ; -- ; -- ; -- ; -- ;
; Green2 ; Output ; -- ; -- ; -- ; -- ;
; SEG_Data[7] ; Output ; -- ; -- ; -- ; -- ;
; SEG_Data[6] ; Output ; -- ; -- ; -- ; -- ;
; SEG_Data[5] ; Output ; -- ; -- ; -- ; -- ;
; SEG_Data[4] ; Output ; -- ; -- ; -- ; -- ;
; SEG_Data[3] ; Output ; -- ; -- ; -- ; -- ;
; SEG_Data[2] ; Output ; -- ; -- ; -- ; -- ;
; SEG_Data[1] ; Output ; -- ; -- ; -- ; -- ;
; SEG_Data[0] ; Output ; -- ; -- ; -- ; -- ;
; SEG_Sel[1] ; Output ; -- ; -- ; -- ; -- ;
; SEG_Sel[0] ; Output ; -- ; -- ; -- ; -- ;
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