📄 msi2c_2.h
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#ifndef DSP_ACCESS
#define MSI2C_2_I2C_BUF_16_2 REG16(MSI2C_2_BASE_ADDR_ARM+MSI2C_2_I2C_BUF_OFFSET*coeff16_arm+2)
#else
#define MSI2C_2_I2C_BUF_16_2 REG16(MSI2C_2_BASE_ADDR_DSP+MSI2C_2_I2C_BUF_OFFSET+1)
#endif
#define MSI2C_2_I2C_BUF_16_2_RDMA_EN_POS 15
#define MSI2C_2_I2C_BUF_16_2_RDMA_EN_NUMB 1
#define MSI2C_2_I2C_BUF_16_2_RDMA_EN_RES_VAL 0x0
//R/W
#define MSI2C_2_I2C_BUF_16_2_RESERVED1_POS 8
#define MSI2C_2_I2C_BUF_16_2_RESERVED1_NUMB 7
#define MSI2C_2_I2C_BUF_16_2_RESERVED1_RES_VAL 0x0
//None
#define MSI2C_2_I2C_BUF_16_2_XDMA_EN_POS 7
#define MSI2C_2_I2C_BUF_16_2_XDMA_EN_NUMB 1
#define MSI2C_2_I2C_BUF_16_2_XDMA_EN_RES_VAL 0x0
//R/W
#define MSI2C_2_I2C_BUF_16_2_RESERVED2_POS 0
#define MSI2C_2_I2C_BUF_16_2_RESERVED2_NUMB 7
#define MSI2C_2_I2C_BUF_16_2_RESERVED2_RES_VAL 0x0
#ifndef DSP_ACCESS
#define MSI2C_2_I2C_BUF_32 REG32(MSI2C_2_BASE_ADDR_ARM+MSI2C_2_I2C_BUF_OFFSET*coeff32_arm)
#define MSI2C_2_I2C_BUF_32_RDMA_EN_POS 15
#define MSI2C_2_I2C_BUF_32_RDMA_EN_NUMB 1
#define MSI2C_2_I2C_BUF_32_RDMA_EN_RES_VAL 0x0
//R/W
#define MSI2C_2_I2C_BUF_32_RESERVED1_POS 8
#define MSI2C_2_I2C_BUF_32_RESERVED1_NUMB 7
#define MSI2C_2_I2C_BUF_32_RESERVED1_RES_VAL 0x0
//None
#define MSI2C_2_I2C_BUF_32_XDMA_EN_POS 7
#define MSI2C_2_I2C_BUF_32_XDMA_EN_NUMB 1
#define MSI2C_2_I2C_BUF_32_XDMA_EN_RES_VAL 0x0
//R/W
#define MSI2C_2_I2C_BUF_32_RESERVED2_POS 0
#define MSI2C_2_I2C_BUF_32_RESERVED2_NUMB 7
#define MSI2C_2_I2C_BUF_32_RESERVED2_RES_VAL 0x0
//None
//MSI2C_2_I2C_CNT
#endif /* DSP_ACCESS */
#ifndef DSP_ACCESS
#define MSI2C_2_I2C_CNT_16_0 REG16(MSI2C_2_BASE_ADDR_ARM+MSI2C_2_I2C_CNT_OFFSET*coeff16_arm+0)
#else
#define MSI2C_2_I2C_CNT_16_0 REG16(MSI2C_2_BASE_ADDR_DSP+MSI2C_2_I2C_CNT_OFFSET)
#endif
#define MSI2C_2_I2C_CNT_16_0_DCOUNT_POS 0
#define MSI2C_2_I2C_CNT_16_0_DCOUNT_NUMB 16
#define MSI2C_2_I2C_CNT_16_0_DCOUNT_RES_VAL 0x0
//R/W
#ifndef DSP_ACCESS
#define MSI2C_2_I2C_CNT_16_2 REG16(MSI2C_2_BASE_ADDR_ARM+MSI2C_2_I2C_CNT_OFFSET*coeff16_arm+2)
#else
#define MSI2C_2_I2C_CNT_16_2 REG16(MSI2C_2_BASE_ADDR_DSP+MSI2C_2_I2C_CNT_OFFSET+1)
#endif
#define MSI2C_2_I2C_CNT_16_2_DCOUNT_POS 0
#define MSI2C_2_I2C_CNT_16_2_DCOUNT_NUMB 16
#define MSI2C_2_I2C_CNT_16_2_DCOUNT_RES_VAL 0x0
#ifndef DSP_ACCESS
#define MSI2C_2_I2C_CNT_32 REG32(MSI2C_2_BASE_ADDR_ARM+MSI2C_2_I2C_CNT_OFFSET*coeff32_arm)
#define MSI2C_2_I2C_CNT_32_DCOUNT_POS 0
#define MSI2C_2_I2C_CNT_32_DCOUNT_NUMB 16
#define MSI2C_2_I2C_CNT_32_DCOUNT_RES_VAL 0x0
//R/W
//MSI2C_2_I2C_DATA
#endif /* DSP_ACCESS */
#ifndef DSP_ACCESS
#define MSI2C_2_I2C_DATA_16_0 REG16(MSI2C_2_BASE_ADDR_ARM+MSI2C_2_I2C_DATA_OFFSET*coeff16_arm+0)
#else
#define MSI2C_2_I2C_DATA_16_0 REG16(MSI2C_2_BASE_ADDR_DSP+MSI2C_2_I2C_DATA_OFFSET)
#endif
#define MSI2C_2_I2C_DATA_16_0_DATA_POS 0
#define MSI2C_2_I2C_DATA_16_0_DATA_NUMB 16
#define MSI2C_2_I2C_DATA_16_0_DATA_RES_VAL 0x0
//R/W
#ifndef DSP_ACCESS
#define MSI2C_2_I2C_DATA_16_2 REG16(MSI2C_2_BASE_ADDR_ARM+MSI2C_2_I2C_DATA_OFFSET*coeff16_arm+2)
#else
#define MSI2C_2_I2C_DATA_16_2 REG16(MSI2C_2_BASE_ADDR_DSP+MSI2C_2_I2C_DATA_OFFSET+1)
#endif
#define MSI2C_2_I2C_DATA_16_2_DATA_POS 0
#define MSI2C_2_I2C_DATA_16_2_DATA_NUMB 16
#define MSI2C_2_I2C_DATA_16_2_DATA_RES_VAL 0x0
#ifndef DSP_ACCESS
#define MSI2C_2_I2C_DATA_32 REG32(MSI2C_2_BASE_ADDR_ARM+MSI2C_2_I2C_DATA_OFFSET*coeff32_arm)
#define MSI2C_2_I2C_DATA_32_DATA_POS 0
#define MSI2C_2_I2C_DATA_32_DATA_NUMB 16
#define MSI2C_2_I2C_DATA_32_DATA_RES_VAL 0x0
//R/W
//MSI2C_2_I2C_SYSC
#endif /* DSP_ACCESS */
#ifndef DSP_ACCESS
#define MSI2C_2_I2C_SYSC_16_0 REG16(MSI2C_2_BASE_ADDR_ARM+MSI2C_2_I2C_SYSC_OFFSET*coeff16_arm+0)
#else
#define MSI2C_2_I2C_SYSC_16_0 REG16(MSI2C_2_BASE_ADDR_DSP+MSI2C_2_I2C_SYSC_OFFSET)
#endif
#define MSI2C_2_I2C_SYSC_16_0_RESERVED1_POS 2
#define MSI2C_2_I2C_SYSC_16_0_RESERVED1_NUMB 14
#define MSI2C_2_I2C_SYSC_16_0_RESERVED1_RES_VAL 0x0
//None
#define MSI2C_2_I2C_SYSC_16_0_SRST_POS 1
#define MSI2C_2_I2C_SYSC_16_0_SRST_NUMB 1
#define MSI2C_2_I2C_SYSC_16_0_SRST_RES_VAL 0x0
//R/W
#define MSI2C_2_I2C_SYSC_16_0_RESERVED2_POS 0
#define MSI2C_2_I2C_SYSC_16_0_RESERVED2_NUMB 1
#define MSI2C_2_I2C_SYSC_16_0_RESERVED2_RES_VAL 0x0
//None
#ifndef DSP_ACCESS
#define MSI2C_2_I2C_SYSC_16_2 REG16(MSI2C_2_BASE_ADDR_ARM+MSI2C_2_I2C_SYSC_OFFSET*coeff16_arm+2)
#else
#define MSI2C_2_I2C_SYSC_16_2 REG16(MSI2C_2_BASE_ADDR_DSP+MSI2C_2_I2C_SYSC_OFFSET+1)
#endif
#define MSI2C_2_I2C_SYSC_16_2_RESERVED1_POS 2
#define MSI2C_2_I2C_SYSC_16_2_RESERVED1_NUMB 14
#define MSI2C_2_I2C_SYSC_16_2_RESERVED1_RES_VAL 0x0
//None
#define MSI2C_2_I2C_SYSC_16_2_SRST_POS 1
#define MSI2C_2_I2C_SYSC_16_2_SRST_NUMB 1
#define MSI2C_2_I2C_SYSC_16_2_SRST_RES_VAL 0x0
//R/W
#define MSI2C_2_I2C_SYSC_16_2_RESERVED2_POS 0
#define MSI2C_2_I2C_SYSC_16_2_RESERVED2_NUMB 1
#define MSI2C_2_I2C_SYSC_16_2_RESERVED2_RES_VAL 0x0
#ifndef DSP_ACCESS
#define MSI2C_2_I2C_SYSC_32 REG32(MSI2C_2_BASE_ADDR_ARM+MSI2C_2_I2C_SYSC_OFFSET*coeff32_arm)
#define MSI2C_2_I2C_SYSC_32_RESERVED1_POS 2
#define MSI2C_2_I2C_SYSC_32_RESERVED1_NUMB 14
#define MSI2C_2_I2C_SYSC_32_RESERVED1_RES_VAL 0x0
//None
#define MSI2C_2_I2C_SYSC_32_SRST_POS 1
#define MSI2C_2_I2C_SYSC_32_SRST_NUMB 1
#define MSI2C_2_I2C_SYSC_32_SRST_RES_VAL 0x0
//R/W
#define MSI2C_2_I2C_SYSC_32_RESERVED2_POS 0
#define MSI2C_2_I2C_SYSC_32_RESERVED2_NUMB 1
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