📄 net_1c6_911.pin
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-- This is a Quartus II output file. It is for reporting purposes only, and is
-- not intended for use as a Quartus II input file. This file cannot be used
-- to make Quartus II pin assignments - for instructions on how to make pin
-- assignments, please see Quartus II help.
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-- NC : No Connect. This pin has no internal connection to the device.
-- VCCINT : Dedicated power pin, which MUST be connected to VCC (1.5V).
-- VCCIO : Dedicated power pin, which MUST be connected to VCC
-- of its bank.
-- Bank 1: 3.3V
-- Bank 2: 3.3V
-- Bank 3: 3.3V
-- Bank 4: 3.3V
-- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND.
-- It can also be used to report unused dedicated pins. The connection
-- on the board for unused dedicated pins depends on whether this will
-- be used in a future design. One example is device migration. When
-- using device migration, refer to the device pin-tables. If it is a
-- GND pin in the pin table or if it will not be used in a future design
-- for another purpose the it MUST be connected to GND. If it is an unused
-- dedicated pin, then it can be connected to a valid signal on the board
-- (low, high, or toggling) if that signal is required for a different
-- revision of the design.
-- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins.
-- This pin should be connected to GND. It may also be connected to a
-- valid signal on the board (low, high, or toggling) if that signal
-- is required for a different revision of the design.
-- GND* : Unused I/O pin. This pin can either be left unconnected or
-- connected to GND. Connecting this pin to GND will improve the
-- device's immunity to noise.
-- RESERVED : Unused I/O pin, which MUST be left unconnected.
-- RESERVED_INPUT : Pin is tri-stated and should be connected to the board.
-- RESERVED_INPUT_WITH_WEAK_PULLUP : Pin is tri-stated with internal weak pull-up resistor.
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Quartus II Version 5.1 Build 216 03/06/2006 Service Pack 2 SJ Full Version
CHIP "net_1c6_911" ASSIGNED TO AN: EP1C6Q240C8
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
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LED[0] : 1 : output : LVTTL : : 1 : Y
LED[1] : 2 : output : LVTTL : : 1 : Y
sd_data[15] : 3 : bidir : LVTTL : : 1 : Y
sd_data[14] : 4 : bidir : LVTTL : : 1 : Y
sd_data[13] : 5 : bidir : LVTTL : : 1 : Y
sd_data[12] : 6 : bidir : LVTTL : : 1 : Y
sd_data[11] : 7 : bidir : LVTTL : : 1 : Y
sd_data[10] : 8 : bidir : LVTTL : : 1 : Y
VCCIO1 : 9 : power : : 3.3V : 1 :
GND : 10 : gnd : : : :
sd_data[9] : 11 : bidir : LVTTL : : 1 : Y
sd_data[8] : 12 : bidir : LVTTL : : 1 : Y
sd_dqm[1] : 13 : output : LVTTL : : 1 : Y
sd_clk : 14 : output : LVTTL : : 1 : Y
sd_cke : 15 : output : LVTTL : : 1 : Y
sd_addr[11] : 16 : output : LVTTL : : 1 : Y
sd_addr[9] : 17 : output : LVTTL : : 1 : Y
sd_addr[8] : 18 : output : LVTTL : : 1 : Y
sd_addr[7] : 19 : output : LVTTL : : 1 : Y
sd_addr[6] : 20 : output : LVTTL : : 1 : Y
sd_addr[5] : 21 : output : LVTTL : : 1 : Y
VCCIO1 : 22 : power : : 3.3V : 1 :
sd_addr[4] : 23 : output : LVTTL : : 1 : Y
~nCSO~ : 24 : input : LVTTL : : 1 : N
DATA0 : 25 : input : : : 1 :
nCONFIG : 26 : : : : 1 :
VCCA_PLL1 : 27 : power : : 1.5V : :
clk : 28 : input : LVTTL : : 1 : Y
GND+ : 29 : : : : 1 :
GNDA_PLL1 : 30 : gnd : : : :
GNDG_PLL1 : 31 : gnd : : : :
nCEO : 32 : : : : 1 :
nCE : 33 : : : : 1 :
MSEL0 : 34 : : : : 1 :
MSEL1 : 35 : : : : 1 :
DCLK : 36 : bidir : : : 1 :
~ASDO~ : 37 : input : LVTTL : : 1 : N
sd_addr[3] : 38 : output : LVTTL : : 1 : Y
sd_addr[2] : 39 : output : LVTTL : : 1 : Y
GND : 40 : gnd : : : :
sd_addr[1] : 41 : output : LVTTL : : 1 : Y
sd_addr[0] : 42 : output : LVTTL : : 1 : Y
sd_addr[10] : 43 : output : LVTTL : : 1 : Y
sd_ba[1] : 44 : output : LVTTL : : 1 : Y
sd_ba[0] : 45 : output : LVTTL : : 1 : Y
sd_cs : 46 : output : LVTTL : : 1 : Y
sd_ras : 47 : output : LVTTL : : 1 : Y
sd_cas : 48 : output : LVTTL : : 1 : Y
sd_we : 49 : output : LVTTL : : 1 : Y
sd_dqm[0] : 50 : output : LVTTL : : 1 : Y
VCCIO1 : 51 : power : : 3.3V : 1 :
GND : 52 : gnd : : : :
sd_data[7] : 53 : bidir : LVTTL : : 1 : Y
sd_data[6] : 54 : bidir : LVTTL : : 1 : Y
sd_data[5] : 55 : bidir : LVTTL : : 1 : Y
sd_data[4] : 56 : bidir : LVTTL : : 1 : Y
sd_data[3] : 57 : bidir : LVTTL : : 1 : Y
sd_data[2] : 58 : bidir : LVTTL : : 1 : Y
sd_data[1] : 59 : bidir : LVTTL : : 1 : Y
sd_data[0] : 60 : bidir : LVTTL : : 1 : Y
net_be[1] : 61 : output : LVTTL : : 4 : Y
net_be[2] : 62 : output : LVTTL : : 4 : Y
net_dq[8] : 63 : bidir : LVTTL : : 4 : Y
net_be[3] : 64 : output : LVTTL : : 4 : Y
net_dq[10] : 65 : bidir : LVTTL : : 4 : Y
net_dq[9] : 66 : bidir : LVTTL : : 4 : Y
net_dq[12] : 67 : bidir : LVTTL : : 4 : Y
net_dq[11] : 68 : bidir : LVTTL : : 4 : Y
GND : 69 : gnd : : : :
VCCIO4 : 70 : power : : 3.3V : 4 :
GND : 71 : gnd : : : :
VCCINT : 72 : power : : 1.5V : :
net_dq[14] : 73 : bidir : LVTTL : : 4 : Y
net_dq[13] : 74 : bidir : LVTTL : : 4 : Y
net_dq[16] : 75 : bidir : LVTTL : : 4 : Y
net_dq[15] : 76 : bidir : LVTTL : : 4 : Y
net_dq[18] : 77 : bidir : LVTTL : : 4 : Y
net_dq[17] : 78 : bidir : LVTTL : : 4 : Y
net_dq[20] : 79 : bidir : LVTTL : : 4 : Y
RESERVED_INPUT : 80 : : : : 4 :
RESERVED_INPUT : 81 : : : : 4 :
net_dq[19] : 82 : bidir : LVTTL : : 4 : Y
net_dq[22] : 83 : bidir : LVTTL : : 4 : Y
net_dq[21] : 84 : bidir : LVTTL : : 4 : Y
net_dq[24] : 85 : bidir : LVTTL : : 4 : Y
net_dq[23] : 86 : bidir : LVTTL : : 4 : Y
net_dq[26] : 87 : bidir : LVTTL : : 4 : Y
net_dq[25] : 88 : bidir : LVTTL : : 4 : Y
GND : 89 : gnd : : : :
VCCINT : 90 : power : : 1.5V : :
GND : 91 : gnd : : : :
VCCIO4 : 92 : power : : 3.3V : 4 :
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