📄 dds.fit.rpt
字号:
; 88 ; GND* ; ;
; 89 ; GND* ; ;
; 90 ; GND* ; ;
; 91 ; VCC_INT ; ;
; 92 ; GND* ; ;
; 93 ; GND* ; ;
; 94 ; GND* ; ;
; 95 ; GND* ; ;
; 96 ; GND* ; ;
; 97 ; GND* ; ;
; 98 ; VCC_IO ; ;
; 99 ; GND* ; ;
; 100 ; GND* ; ;
; 101 ; GND* ; ;
; 102 ; GND* ; ;
; 103 ; GND* ; ;
; 104 ; Q[2] ; LVTTL/LVCMOS ;
; 105 ; ^nCONFIG ; ;
; 106 ; VCC_INT ; ;
; 107 ; ^MSEL1 ; ;
; 108 ; ^MSEL0 ; ;
; 109 ; GND ; ;
; 110 ; VCC_IO ; ;
; 111 ; GND* ; ;
; 112 ; GND* ; ;
; 113 ; GND* ; ;
; 114 ; GND* ; ;
; 115 ; K[5] ; LVTTL/LVCMOS ;
; 116 ; GND* ; ;
; 117 ; GND ; ;
; 118 ; VCC_IO ; ;
; 119 ; GND* ; ;
; 120 ; GND* ; ;
; 121 ; GND* ; ;
; 122 ; GND* ; ;
; 123 ; GND ; ;
; 124 ; VCC_INT ; ;
; 125 ; GND* ; ;
; 126 ; Q[8] ; LVTTL/LVCMOS ;
; 127 ; GND* ; ;
; 128 ; GND* ; ;
; 129 ; GND ; ;
; 130 ; VCC_INT ; ;
; 131 ; GND* ; ;
; 132 ; GND* ; ;
; 133 ; GND* ; ;
; 134 ; Q[3] ; LVTTL/LVCMOS ;
; 135 ; GND* ; ;
; 136 ; GND* ; ;
; 137 ; GND ; ;
; 138 ; VCC_IO ; ;
; 139 ; GND* ; ;
; 140 ; GND* ; ;
; 141 ; GND* ; ;
; 142 ; GND* ; ;
; 143 ; Q[7] ; LVTTL/LVCMOS ;
; 144 ; GND* ; ;
; 145 ; GND ; ;
; 146 ; VCC_IO ; ;
; 147 ; GND* ; ;
; 148 ; GND* ; ;
; 149 ; GND* ; ;
; 150 ; Q[5] ; LVTTL/LVCMOS ;
; 151 ; GND ; ;
; 152 ; VCC_INT ; ;
; 153 ; #TDI ; ;
; 154 ; ^nCE ; ;
; 155 ; ^DCLK ; ;
; 156 ; ^DATA0 ; ;
; 157 ; GND* ; ;
; 158 ; GND* ; ;
; 159 ; GND* ; ;
; 160 ; GND* ; ;
; 161 ; GND* ; ;
; 162 ; GND* ; ;
; 163 ; GND* ; ;
; 164 ; GND* ; ;
; 165 ; VCC_IO ; ;
; 166 ; Q[0] ; LVTTL/LVCMOS ;
; 167 ; GND* ; ;
; 168 ; GND* ; ;
; 169 ; GND* ; ;
; 170 ; GND* ; ;
; 171 ; GND ; ;
; 172 ; GND* ; ;
; 173 ; GND* ; ;
; 174 ; GND* ; ;
; 175 ; GND* ; ;
; 176 ; GND* ; ;
; 177 ; GND* ; ;
; 178 ; VCC_IO ; ;
; 179 ; GND* ; ;
; 180 ; GND* ; ;
; 181 ; GND ; ;
; 182 ; EN ; LVTTL/LVCMOS ;
; 183 ; K[0] ; LVTTL/LVCMOS ;
; 184 ; RESET ; LVTTL/LVCMOS ;
; 185 ; VCC_INT ; ;
; 186 ; GND* ; ;
; 187 ; GND* ; ;
; 188 ; GND ; ;
; 189 ; GND* ; ;
; 190 ; GND* ; ;
; 191 ; GND* ; ;
; 192 ; GND* ; ;
; 193 ; K[8] ; LVTTL/LVCMOS ;
; 194 ; VCC_IO ; ;
; 195 ; GND* ; ;
; 196 ; K[4] ; LVTTL/LVCMOS ;
; 197 ; GND* ; ;
; 198 ; GND* ; ;
; 199 ; K[7] ; LVTTL/LVCMOS ;
; 200 ; GND* ; ;
; 201 ; VCC_INT ; ;
; 202 ; GND* ; ;
; 203 ; K[1] ; LVTTL/LVCMOS ;
; 204 ; GND* ; ;
; 205 ; GND* ; ;
; 206 ; GND* ; ;
; 207 ; GND* ; ;
; 208 ; K[2] ; LVTTL/LVCMOS ;
+-------+------------+--------------+
+-------------------------------------------------------+
; Control Signals ;
+-------+-------+---------+--------------+--------------+
; Name ; Pin # ; Fan-Out ; Usage ; Global Usage ;
+-------+-------+---------+--------------+--------------+
; CLK ; 79 ; 36 ; Clock ; Pin ;
; RESET ; 184 ; 10 ; Async. clear ; Pin ;
; EN ; 182 ; 10 ; Clock enable ; Non-global ;
+-------+-------+---------+--------------+--------------+
+----------------------------------+
; Global & Other Fast Signals ;
+-------+-------+---------+--------+
; Name ; Pin # ; Fan-Out ; Global ;
+-------+-------+---------+--------+
; CLK ; 79 ; 36 ; yes ;
; RESET ; 184 ; 10 ; yes ;
; EN ; 182 ; 10 ; no ;
; K[9] ; 78 ; 1 ; no ;
; K[3] ; 80 ; 1 ; no ;
; K[0] ; 183 ; 1 ; no ;
+-------+-------+---------+--------+
+---------------------------------------------+
; Carry Chains ;
+--------------------+------------------------+
; Carry Chain Length ; Number of Carry Chains ;
+--------------------+------------------------+
; 0 ; 0 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 0 ;
; 7 ; 0 ;
; 8 ; 0 ;
; 9 ; 0 ;
; 10 ; 1 ;
+--------------------+------------------------+
+----------------+
; Cascade Chains ;
+--------+-------+
; Length ; Count ;
+--------+-------+
; 2 ; 2 ;
+--------+-------+
+-----------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals ;
+-------------------------------------------------------------------------+---------+
; Name ; Fan-Out ;
+-------------------------------------------------------------------------+---------+
; REG1:U1|Q[3]~24 ; 25 ;
; REG1:U1|Q[2]~32 ; 21 ;
; REG1:U1|Q[1]~33 ; 21 ;
; REG1:U1|Q[0]~25 ; 15 ;
; EN ; 10 ;
; ROM:U2|Equal0~77 ; 7 ;
; ROM:U2|Equal0~78 ; 7 ;
; REG1:U1|Q[4]~26 ; 7 ;
; ROM:U2|Equal11~92 ; 6 ;
; ROM:U2|Equal19~45 ; 6 ;
; ROM:U2|Equal11~93 ; 6 ;
; ROM:U2|Equal6~56 ; 5 ;
; ROM:U2|Equal18~53 ; 5 ;
; ROM:U2|Equal2~56 ; 5 ;
; ROM:U2|Equal4~57 ; 4 ;
; ROM:U2|Equal1~51 ; 4 ;
; ROM:U2|Equal0~79 ; 3 ;
; ROM:U2|Equal13~67 ; 3 ;
; REG1:U1|Q[8]~31 ; 3 ;
; REG1:U1|Q[9]~27 ; 3 ;
; ROM:U2|Equal18~54 ; 3 ;
; ROM:U2|Equal19~46 ; 3 ;
; ROM:U2|OUTP[6]~7 ; 3 ;
; SUM99:U0|TEMP[1]~47 ; 2 ;
; SUM99:U0|TEMP[3]~38 ; 2 ;
; ROM:U2|WideOr3~134 ; 2 ;
; ROM:U2|WideOr3~130 ; 2 ;
; ROM:U2|WideOr4~101 ; 2 ;
; ROM:U2|WideOr6~76 ; 2 ;
; ROM:U2|WideOr5~149 ; 2 ;
; SUM99:U0|TEMP[2]~46 ; 2 ;
; SUM99:U0|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[1] ; 2 ;
; SUM99:U0|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[2] ; 2 ;
; ROM:U2|Equal0~76 ; 2 ;
; SUM99:U0|TEMP[6]~43 ; 2 ;
; SUM99:U0|TEMP[5]~42 ; 2 ;
; SUM99:U0|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[8] ; 2 ;
; ROM:U2|Equal31~53 ; 2 ;
; REG1:U1|Q[6]~29 ; 2 ;
; SUM99:U0|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[7] ; 2 ;
; ROM:U2|WideOr1~36 ; 2 ;
; ROM:U2|WideOr3~132 ; 2 ;
; SUM99:U0|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[6] ; 2 ;
; ROM:U2|WideOr2~115 ; 2 ;
; ROM:U2|Equal19~47 ; 2 ;
; ROM:U2|Equal4~58 ; 2 ;
; SUM99:U0|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[5] ; 2 ;
; ROM:U2|Equal3~53 ; 2 ;
; REG1:U1|Q[5]~28 ; 2 ;
; ROM:U2|Equal7~60 ; 2 ;
+-------------------------------------------------------------------------+---------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 604 ;
; 1 ; 7 ;
; 2 ; 0 ;
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