fir_top_coef_0.v

altera FPGA/CPLD高级篇(VHDL源代码)

		//----- ! -------- W A R N I N G -------- ! -----
		//----- ! -------- FIR COMPILER GENERATED FILE --- ! -----
		//---------------------DO NOT ATTEMPT TO MODIFY! -----

//SET1//;
//COEF 0 : 363;
//COEF 1 : 377;
//COEF 2 : 391;
//COEF 3 : 405;
//COEF 4 : 418;
//COEF 5 : 430;
//COEF 6 : 441;
//COEF 7 : 452;

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