📄 gdb.pin
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-- This is a Quartus II output file. It is for reporting purposes only, and is
-- not intended for use as a Quartus II input file. This file cannot be used
-- to make Quartus II pin assignments - for instructions on how to make pin
-- assignments, please see Quartus II help.
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-- NC : No Connect. This pin has no internal connection to the device.
-- VCCINT : Dedicated power pin, which MUST be connected to VCC (2.5V/3.3V).
-- VCCIO : Dedicated power pin, which MUST be connected to VCC
-- of its bank.
-- Bank 1: 3.3V
-- Bank 2: 3.3V
-- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND.
-- It can also be used to report unused dedicated pins. The connection
-- on the board for unused dedicated pins depends on whether this will
-- be used in a future design. One example is device migration. When
-- using device migration, refer to the device pin-tables. If it is a
-- GND pin in the pin table or if it will not be used in a future design
-- for another purpose the it MUST be connected to GND. If it is an unused
-- dedicated pin, then it can be connected to a valid signal on the board
-- (low, high, or toggling) if that signal is required for a different
-- revision of the design.
-- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins.
-- This pin should be connected to GND. It may also be connected to a
-- valid signal on the board (low, high, or toggling) if that signal
-- is required for a different revision of the design.
-- GND* : Unused I/O pin. This pin can either be left unconnected or
-- connected to GND. Connecting this pin to GND will improve the
-- device's immunity to noise.
-- RESERVED : Unused I/O pin, which MUST be left unconnected.
-- RESERVED_INPUT : Pin is tri-stated and should be connected to the board.
-- RESERVED_INPUT_WITH_WEAK_PULLUP : Pin is tri-stated with internal weak pull-up resistor.
-- RESERVED_INPUT_WITH_BUS_HOLD : Pin is tri-stated with bus-hold circuitry.
-- RESERVED_OUTPUT_DRIVEN_HIGH : Pin is output driven high.
---------------------------------------------------------------------------------
Quartus II Version 7.1 Build 156 04/30/2007 SJ Full Version
CHIP "GDB" ASSIGNED TO AN: EPM240T100I5
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
-------------------------------------------------------------------------------------------------------------
DJA : 1 : output : 3.3-V LVTTL : : 2 : Y
DJB : 2 : output : 3.3-V LVTTL : : 1 : Y
DJC : 3 : output : 3.3-V LVTTL : : 1 : Y
GATEDJ : 4 : output : 3.3-V LVTTL : : 1 : Y
GND* : 5 : : : : 1 :
VIODE_A : 6 : output : 3.3-V LVTTL : : 1 : Y
VIODE_B : 7 : output : 3.3-V LVTTL : : 1 : Y
GND* : 8 : : : : 1 :
VCCIO1 : 9 : power : : 3.3V : 1 :
GNDIO : 10 : gnd : : : :
GNDINT : 11 : gnd : : : :
clk : 12 : input : 3.3-V LVTTL : : 1 : Y
VCCINT : 13 : power : : 3.3V : :
GND* : 14 : : : : 1 :
GND* : 15 : : : : 1 :
GND* : 16 : : : : 1 :
GND* : 17 : : : : 1 :
GND* : 18 : : : : 1 :
GND* : 19 : : : : 1 :
GND* : 20 : : : : 1 :
GND* : 21 : : : : 1 :
TMS : 22 : input : : : 1 :
TDI : 23 : input : : : 1 :
TCK : 24 : input : : : 1 :
TDO : 25 : output : : : 1 :
GND* : 26 : : : : 1 :
GND* : 27 : : : : 1 :
RD : 28 : output : 3.3-V LVTTL : : 1 : Y
WR : 29 : input : 3.3-V LVTTL : : 1 : Y
ADDR[8] : 30 : input : 3.3-V LVTTL : : 1 : Y
VCCIO1 : 31 : power : : 3.3V : 1 :
GNDIO : 32 : gnd : : : :
ADDR[9] : 33 : input : 3.3-V LVTTL : : 1 : Y
ADDR[10] : 34 : input : 3.3-V LVTTL : : 1 : Y
ADDR[11] : 35 : input : 3.3-V LVTTL : : 1 : Y
ADDR[12] : 36 : input : 3.3-V LVTTL : : 1 : Y
ADDR[13] : 37 : input : 3.3-V LVTTL : : 1 : Y
ADDR[14] : 38 : input : 3.3-V LVTTL : : 1 : Y
ADDR[15] : 39 : input : 3.3-V LVTTL : : 1 : Y
ADDR[0] : 40 : input : 3.3-V LVTTL : : 1 : Y
ADDR[1] : 41 : input : 3.3-V LVTTL : : 1 : Y
ADDR[2] : 42 : input : 3.3-V LVTTL : : 1 : Y
GND* : 43 : : : : 1 :
RESET : 44 : input : 3.3-V LVTTL : : 1 : Y
VCCIO1 : 45 : power : : 3.3V : 1 :
GNDIO : 46 : gnd : : : :
ADDR[3] : 47 : input : 3.3-V LVTTL : : 1 : Y
ADDR[4] : 48 : input : 3.3-V LVTTL : : 1 : Y
ADDR[5] : 49 : input : 3.3-V LVTTL : : 1 : Y
ADDR[6] : 50 : input : 3.3-V LVTTL : : 1 : Y
ADDR[7] : 51 : input : 3.3-V LVTTL : : 1 : Y
BD[0] : 52 : input : 3.3-V LVTTL : : 2 : Y
BD[1] : 53 : input : 3.3-V LVTTL : : 2 : Y
BD[2] : 54 : input : 3.3-V LVTTL : : 2 : Y
BD[3] : 55 : input : 3.3-V LVTTL : : 2 : Y
BD[4] : 56 : input : 3.3-V LVTTL : : 2 : Y
BD[5] : 57 : input : 3.3-V LVTTL : : 2 : Y
BD[6] : 58 : input : 3.3-V LVTTL : : 2 : Y
VCCIO2 : 59 : power : : 3.3V : 2 :
GNDIO : 60 : gnd : : : :
BD[7] : 61 : input : 3.3-V LVTTL : : 2 : Y
GND* : 62 : : : : 2 :
VCCINT : 63 : power : : 3.3V : :
GND* : 64 : : : : 2 :
GNDINT : 65 : gnd : : : :
INT0 : 66 : output : 3.3-V LVTTL : : 2 : Y
INT1 : 67 : output : 3.3-V LVTTL : : 2 : Y
GATE : 68 : input : 3.3-V LVTTL : : 2 : Y
FORTH : 69 : input : 3.3-V LVTTL : : 2 : Y
GATEV : 70 : input : 3.3-V LVTTL : : 2 : Y
READY0 : 71 : output : 3.3-V LVTTL : : 2 : Y
GND* : 72 : : : : 2 :
GND* : 73 : : : : 2 :
GND* : 74 : : : : 2 :
GND* : 75 : : : : 2 :
GND* : 76 : : : : 2 :
GND* : 77 : : : : 2 :
GND* : 78 : : : : 2 :
GNDIO : 79 : gnd : : : :
VCCIO2 : 80 : power : : 3.3V : 2 :
GND* : 81 : : : : 2 :
GND* : 82 : : : : 2 :
GND* : 83 : : : : 2 :
GND* : 84 : : : : 2 :
GND* : 85 : : : : 2 :
GND* : 86 : : : : 2 :
GND* : 87 : : : : 2 :
GND* : 88 : : : : 2 :
GND* : 89 : : : : 2 :
AB[0] : 90 : input : 3.3-V LVTTL : : 2 : Y
AB[1] : 91 : input : 3.3-V LVTTL : : 2 : Y
GND* : 92 : : : : 2 :
GNDIO : 93 : gnd : : : :
VCCIO2 : 94 : power : : 3.3V : 2 :
GND* : 95 : : : : 2 :
GND* : 96 : : : : 2 :
GND* : 97 : : : : 2 :
GND* : 98 : : : : 2 :
GND* : 99 : : : : 2 :
GND* : 100 : : : : 2 :
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