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📁 输入为八位十进制数
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; Ignore Maximum Fan-Out Assignments                                             ; Off                ; Off                ;
; Retiming Meta-Stability Register Sequence Length                               ; 2                  ; 2                  ;
; PowerPlay Power Optimization                                                   ; Normal compilation ; Normal compilation ;
; HDL message level                                                              ; Level2             ; Level2             ;
; Suppress Register Optimization Related Messages                                ; Off                ; Off                ;
; Number of Removed Registers Reported in Synthesis Report                       ; 100                ; 100                ;
; Clock MUX Protection                                                           ; On                 ; On                 ;
; Block Design Naming                                                            ; Auto               ; Auto               ;
+--------------------------------------------------------------------------------+--------------------+--------------------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Source Files Read                                                                                                                         ;
+----------------------------------+-----------------+------------------------------------+----------------------------------------------------------------------+
; File Name with User-Entered Path ; Used in Netlist ; File Type                          ; File Name with Absolute Path                                         ;
+----------------------------------+-----------------+------------------------------------+----------------------------------------------------------------------+
; frequence.vhd                    ; yes             ; User VHDL File                     ; D:/altera/comp/frequence.vhd                                         ;
; display.vhd                      ; yes             ; User VHDL File                     ; D:/altera/comp/display.vhd                                           ;
; comp.bdf                         ; yes             ; User Block Diagram/Schematic File  ; D:/altera/comp/comp.bdf                                              ;
; ad.vhd                           ; yes             ; User VHDL File                     ; D:/altera/comp/ad.vhd                                                ;
; clk_division.vhd                 ; yes             ; Other                              ; D:/altera/comp/clk_division.vhd                                      ;
; lpm_counter.tdf                  ; yes             ; Megafunction                       ; d:/altera/72/quartus/libraries/megafunctions/lpm_counter.tdf         ;
; lpm_constant.inc                 ; yes             ; Megafunction                       ; d:/altera/72/quartus/libraries/megafunctions/lpm_constant.inc        ;
; lpm_decode.inc                   ; yes             ; Megafunction                       ; d:/altera/72/quartus/libraries/megafunctions/lpm_decode.inc          ;
; lpm_add_sub.inc                  ; yes             ; Megafunction                       ; d:/altera/72/quartus/libraries/megafunctions/lpm_add_sub.inc         ;
; cmpconst.inc                     ; yes             ; Megafunction                       ; d:/altera/72/quartus/libraries/megafunctions/cmpconst.inc            ;
; lpm_compare.inc                  ; yes             ; Megafunction                       ; d:/altera/72/quartus/libraries/megafunctions/lpm_compare.inc         ;
; lpm_counter.inc                  ; yes             ; Megafunction                       ; d:/altera/72/quartus/libraries/megafunctions/lpm_counter.inc         ;
; dffeea.inc                       ; yes             ; Megafunction                       ; d:/altera/72/quartus/libraries/megafunctions/dffeea.inc              ;
; alt_synch_counter.inc            ; yes             ; Megafunction                       ; d:/altera/72/quartus/libraries/megafunctions/alt_synch_counter.inc   ;
; alt_synch_counter_f.inc          ; yes             ; Megafunction                       ; d:/altera/72/quartus/libraries/megafunctions/alt_synch_counter_f.inc ;
; alt_counter_f10ke.inc            ; yes             ; Megafunction                       ; d:/altera/72/quartus/libraries/megafunctions/alt_counter_f10ke.inc   ;
; alt_counter_stratix.inc          ; yes             ; Megafunction                       ; d:/altera/72/quartus/libraries/megafunctions/alt_counter_stratix.inc ;
; aglobal72.inc                    ; yes             ; Megafunction                       ; d:/altera/72/quartus/libraries/megafunctions/aglobal72.inc           ;
; db/cntr_3dh.tdf                  ; yes             ; Auto-Generated Megafunction        ; D:/altera/comp/db/cntr_3dh.tdf                                       ;
; counter24.vhd                    ; yes             ; Other                              ; D:/altera/comp/counter24.vhd                                         ;
; db/cntr_4ij.tdf                  ; yes             ; Auto-Generated Megafunction        ; D:/altera/comp/db/cntr_4ij.tdf                                       ;
+----------------------------------+-----------------+------------------------------------+----------------------------------------------------------------------+


+--------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Resource Usage Summary                                                                                          ;
+---------------------------------------------+----------------------------------------------------------------------------------------+
; Resource                                    ; Usage                                                                                  ;
+---------------------------------------------+----------------------------------------------------------------------------------------+
; Total logic elements                        ; 383                                                                                    ;
;     -- Combinational with no register       ; 192                                                                                    ;
;     -- Register only                        ; 73                                                                                     ;
;     -- Combinational with a register        ; 118                                                                                    ;
;                                             ;                                                                                        ;
; Logic element usage by number of LUT inputs ;                                                                                        ;
;     -- 4 input functions                    ; 114                                                                                    ;
;     -- 3 input functions                    ; 45                                                                                     ;
;     -- 2 input functions                    ; 135                                                                                    ;
;     -- 1 input functions                    ; 15                                                                                     ;
;     -- 0 input functions                    ; 1                                                                                      ;
;                                             ;                                                                                        ;
; Logic elements by mode                      ;                                                                                        ;
;     -- normal mode                          ; 274                                                                                    ;
;     -- arithmetic mode                      ; 109                                                                                    ;
;     -- qfbk mode                            ; 0                                                                                      ;
;     -- register cascade mode                ; 0                                                                                      ;
;     -- synchronous clear/load mode          ; 48                                                                                     ;
;     -- asynchronous clear/load mode         ; 0                                                                                      ;
;                                             ;                                                                                        ;
; Total registers                             ; 191                                                                                    ;
; Total logic cells in carry chains           ; 125                                                                                    ;
; I/O pins                                    ; 28                                                                                     ;
; Maximum fan-out node                        ; clk_division:inst8|lpm_counter:lpm_counter_component|cntr_3dh:auto_generated|safe_q[0] ;
; Maximum fan-out                             ; 93                                                                                     ;
; Total fan-out                               ; 1319                                                                                   ;
; Average fan-out                             ; 3.21                                                                                   ;
+---------------------------------------------+----------------------------------------------------------------------------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Resource Utilization by Entity                                                                                                                                                                                                                                                 ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+------------------------------------------------------------------------------------+--------------+
; Compilation Hierarchy Node                ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Packed LCs ; Full Hierarchy Name                                                                ; Library Name ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+------------------------------------------------------------------------------------+--------------+
; |comp                                     ; 383 (1)     ; 191          ; 0           ; 28   ; 0            ; 192 (1)      ; 73 (0)            ; 118 (0)          ; 125 (0)         ; 0 (0)      ; |comp                                                                              ; work         ;
;    |ad:inst2|                             ; 188 (188)   ; 91           ; 0           ; 0    ; 0            ; 97 (97)      ; 46 (46)           ; 45 (45)          ; 70 (70)         ; 0 (0)      ; |comp|ad:inst2                                                                     ; work         ;
;    |clk_division:inst7|                   ; 1 (0)       ; 1            ; 0           ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (0)            ; 0 (0)           ; 0 (0)      ; |comp|clk_division:inst7                                                           ; work         ;
;       |lpm_counter:lpm_counter_component| ; 1 (0)       ; 1            ; 0           ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (0)            ; 0 (0)           ; 0 (0)      ; |comp|clk_division:inst7|lpm_counter:lpm_counter_component                         ; work         ;
;          |cntr_3dh:auto_generated|        ; 1 (1)       ; 1            ; 0           ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (1)            ; 0 (0)           ; 0 (0)      ; |comp|clk_division:inst7|lpm_counter:lpm_counter_component|cntr_3dh:auto_generated ; work         ;
;    |clk_division:inst8|                   ; 1 (0)       ; 1            ; 0           ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (0)            ; 0 (0)           ; 0 (0)      ; |comp|clk_division:inst8                                                           ; work         ;
;       |lpm_counter:lpm_counter_component| ; 1 (0)       ; 1            ; 0           ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (0)            ; 0 (0)           ; 0 (0)      ; |comp|clk_division:inst8|lpm_counter:lpm_counter_component                         ; work         ;
;          |cntr_3dh:auto_generated|        ; 1 (1)       ; 1            ; 0           ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (1)            ; 0 (0)           ; 0 (0)      ; |comp|clk_division:inst8|lpm_counter:lpm_counter_component|cntr_3dh:auto_generated ; work         ;
;    |counter24:inst5|                      ; 33 (0)      ; 24           ; 0           ; 0    ; 0            ; 9 (0)        ; 0 (0)             ; 24 (0)           ; 25 (0)          ; 0 (0)      ; |comp|counter24:inst5                                                              ; work         ;
;       |lpm_counter:lpm_counter_component| ; 33 (0)      ; 24           ; 0           ; 0    ; 0            ; 9 (0)        ; 0 (0)             ; 24 (0)           ; 25 (0)          ; 0 (0)      ; |comp|counter24:inst5|lpm_counter:lpm_counter_component                            ; work         ;
;          |cntr_4ij:auto_generated|        ; 33 (33)     ; 24           ; 0           ; 0    ; 0            ; 9 (9)        ; 0 (0)             ; 24 (24)          ; 25 (25)         ; 0 (0)      ; |comp|counter24:inst5|lpm_counter:lpm_counter_component|cntr_4ij:auto_generated    ; work         ;
;    |display:inst1|                        ; 70 (70)     ; 23           ; 0           ; 0    ; 0            ; 47 (47)      ; 2 (2)             ; 21 (21)          ; 5 (5)           ; 0 (0)      ; |comp|display:inst1                                                                ; work         ;
;    |frequence:inst|                       ; 89 (89)     ; 51           ; 0           ; 0    ; 0            ; 38 (38)      ; 25 (25)           ; 26 (26)          ; 25 (25)         ; 0 (0)      ; |comp|frequence:inst                                                               ; work         ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+------------------------------------------------------------------------------------+--------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.


Encoding Type:  One-Hot
+-------------------------------------------------------------------------------------------------------------+
; State Machine - |comp|ad:inst2|state                                                                        ;
+----------+----------+----------+----------+----------+----------+----------+----------+----------+----------+
; Name     ; state.s8 ; state.s7 ; state.s6 ; state.s5 ; state.s4 ; state.s3 ; state.s2 ; state.s1 ; state.s0 ;
+----------+----------+----------+----------+----------+----------+----------+----------+----------+----------+
; state.s0 ; 0        ; 0        ; 0        ; 0        ; 0        ; 0        ; 0        ; 0        ; 0        ;
; state.s1 ; 0        ; 0        ; 0        ; 0        ; 0        ; 0        ; 0        ; 1        ; 1        ;
; state.s2 ; 0        ; 0        ; 0        ; 0        ; 0        ; 0        ; 1        ; 0        ; 1        ;
; state.s3 ; 0        ; 0        ; 0        ; 0        ; 0        ; 1        ; 0        ; 0        ; 1        ;
; state.s4 ; 0        ; 0        ; 0        ; 0        ; 1        ; 0        ; 0        ; 0        ; 1        ;
; state.s5 ; 0        ; 0        ; 0        ; 1        ; 0        ; 0        ; 0        ; 0        ; 1        ;
; state.s6 ; 0        ; 0        ; 1        ; 0        ; 0        ; 0        ; 0        ; 0        ; 1        ;
; state.s7 ; 0        ; 1        ; 0        ; 0        ; 0        ; 0        ; 0        ; 0        ; 1        ;
; state.s8 ; 1        ; 0        ; 0        ; 0        ; 0        ; 0        ; 0        ; 0        ; 1        ;
+----------+----------+----------+----------+----------+----------+----------+----------+----------+----------+


+--------------------------------------------------------------------------------+
; Registers Removed During Synthesis                                             ;
+---------------------------------------+----------------------------------------+
; Register name                         ; Reason for Removal                     ;
+---------------------------------------+----------------------------------------+
; ad:inst2|data_transf_buff[0]          ; Stuck at GND due to stuck port data_in ;
; ad:inst2|dis_d[0]                     ; Stuck at GND due to stuck port data_in ;

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