📄 chengfa_8.sim.rpt
字号:
+--------------------------------------------------------------------+
; Coverage Summary ;
+-----------------------------------------------------+--------------+
; Type ; Value ;
+-----------------------------------------------------+--------------+
; Total coverage as a percentage ; 77.19 % ;
; Total nodes checked ; 439 ;
; Total output ports checked ; 456 ;
; Total output ports with complete 1/0-value coverage ; 352 ;
; Total output ports with no 1/0-value coverage ; 96 ;
; Total output ports with no 1-value coverage ; 104 ;
; Total output ports with no 0-value coverage ; 96 ;
+-----------------------------------------------------+--------------+
The following table displays output ports that toggle between 1 and 0 during simulation.
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Complete 1/0-Value Coverage ;
+----------------------------------------------------------------------------+---------------------------------------------------------------------------------+------------------+
; Node Name ; Output Port Name ; Output Port Type ;
+----------------------------------------------------------------------------+---------------------------------------------------------------------------------+------------------+
; |CHENGFA_8|Y[3]~reg0 ; |CHENGFA_8|Y[3]~reg0 ; out ;
; |CHENGFA_8|p~2 ; |CHENGFA_8|p~2 ; out ;
; |CHENGFA_8|p~3 ; |CHENGFA_8|p~3 ; out ;
; |CHENGFA_8|p~4 ; |CHENGFA_8|p~4 ; out ;
; |CHENGFA_8|p~5 ; |CHENGFA_8|p~5 ; out ;
; |CHENGFA_8|p~6 ; |CHENGFA_8|p~6 ; out ;
; |CHENGFA_8|p~7 ; |CHENGFA_8|p~7 ; out ;
; |CHENGFA_8|p~8 ; |CHENGFA_8|p~8 ; out ;
; |CHENGFA_8|p~9 ; |CHENGFA_8|p~9 ; out ;
; |CHENGFA_8|p~10 ; |CHENGFA_8|p~10 ; out ;
; |CHENGFA_8|p~11 ; |CHENGFA_8|p~11 ; out ;
; |CHENGFA_8|p~12 ; |CHENGFA_8|p~12 ; out ;
; |CHENGFA_8|p~13 ; |CHENGFA_8|p~13 ; out ;
; |CHENGFA_8|p~14 ; |CHENGFA_8|p~14 ; out ;
; |CHENGFA_8|p~15 ; |CHENGFA_8|p~15 ; out ;
; |CHENGFA_8|p~18 ; |CHENGFA_8|p~18 ; out ;
; |CHENGFA_8|p~19 ; |CHENGFA_8|p~19 ; out ;
; |CHENGFA_8|p~20 ; |CHENGFA_8|p~20 ; out ;
; |CHENGFA_8|p~21 ; |CHENGFA_8|p~21 ; out ;
; |CHENGFA_8|p~22 ; |CHENGFA_8|p~22 ; out ;
; |CHENGFA_8|p~23 ; |CHENGFA_8|p~23 ; out ;
; |CHENGFA_8|p~24 ; |CHENGFA_8|p~24 ; out ;
; |CHENGFA_8|p~25 ; |CHENGFA_8|p~25 ; out ;
; |CHENGFA_8|p~26 ; |CHENGFA_8|p~26 ; out ;
; |CHENGFA_8|p~27 ; |CHENGFA_8|p~27 ; out ;
; |CHENGFA_8|p~28 ; |CHENGFA_8|p~28 ; out ;
; |CHENGFA_8|p~29 ; |CHENGFA_8|p~29 ; out ;
; |CHENGFA_8|p~30 ; |CHENGFA_8|p~30 ; out ;
; |CHENGFA_8|p~31 ; |CHENGFA_8|p~31 ; out ;
; |CHENGFA_8|t~2 ; |CHENGFA_8|t~2 ; out ;
; |CHENGFA_8|t~3 ; |CHENGFA_8|t~3 ; out ;
; |CHENGFA_8|t~4 ; |CHENGFA_8|t~4 ; out ;
; |CHENGFA_8|t~5 ; |CHENGFA_8|t~5 ; out ;
; |CHENGFA_8|t~6 ; |CHENGFA_8|t~6 ; out ;
; |CHENGFA_8|t~7 ; |CHENGFA_8|t~7 ; out ;
; |CHENGFA_8|t~8 ; |CHENGFA_8|t~8 ; out ;
; |CHENGFA_8|t~9 ; |CHENGFA_8|t~9 ; out ;
; |CHENGFA_8|t~10 ; |CHENGFA_8|t~10 ; out ;
; |CHENGFA_8|t~11 ; |CHENGFA_8|t~11 ; out ;
; |CHENGFA_8|t~12 ; |CHENGFA_8|t~12 ; out ;
; |CHENGFA_8|t~13 ; |CHENGFA_8|t~13 ; out ;
; |CHENGFA_8|t~14 ; |CHENGFA_8|t~14 ; out ;
; |CHENGFA_8|t~15 ; |CHENGFA_8|t~15 ; out ;
; |CHENGFA_8|count~0 ; |CHENGFA_8|count~0 ; out ;
; |CHENGFA_8|count~1 ; |CHENGFA_8|count~1 ; out ;
; |CHENGFA_8|count~2 ; |CHENGFA_8|count~2 ; out ;
; |CHENGFA_8|Y[2]~reg0 ; |CHENGFA_8|Y[2]~reg0 ; out ;
; |CHENGFA_8|STATE~0 ; |CHENGFA_8|STATE~0 ; out ;
; |CHENGFA_8|Y[4]~reg0 ; |CHENGFA_8|Y[4]~reg0 ; out ;
; |CHENGFA_8|Y[5]~reg0 ; |CHENGFA_8|Y[5]~reg0 ; out ;
; |CHENGFA_8|Y[6]~reg0 ; |CHENGFA_8|Y[6]~reg0 ; out ;
; |CHENGFA_8|Y[7]~reg0 ; |CHENGFA_8|Y[7]~reg0 ; out ;
; |CHENGFA_8|Y[8]~reg0 ; |CHENGFA_8|Y[8]~reg0 ; out ;
; |CHENGFA_8|Y[9]~reg0 ; |CHENGFA_8|Y[9]~reg0 ; out ;
; |CHENGFA_8|Y[10]~reg0 ; |CHENGFA_8|Y[10]~reg0 ; out ;
; |CHENGFA_8|Y[11]~reg0 ; |CHENGFA_8|Y[11]~reg0 ; out ;
; |CHENGFA_8|STATE.s2 ; |CHENGFA_8|STATE.s2 ; out ;
; |CHENGFA_8|STATE.s1 ; |CHENGFA_8|STATE.s1 ; out ;
; |CHENGFA_8|STATE.s0 ; |CHENGFA_8|STATE.s0 ; out ;
; |CHENGFA_8|t[0] ; |CHENGFA_8|t[0] ; out ;
; |CHENGFA_8|t[1] ; |CHENGFA_8|t[1] ; out ;
; |CHENGFA_8|t[2] ; |CHENGFA_8|t[2] ; out ;
; |CHENGFA_8|t[3] ; |CHENGFA_8|t[3] ; out ;
; |CHENGFA_8|t[4] ; |CHENGFA_8|t[4] ; out ;
; |CHENGFA_8|t[5] ; |CHENGFA_8|t[5] ; out ;
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