test44x_fll02.c

ADC12操作 DATA FLASH操作 EEPROM操作 FLASH读写操作 LCD点阵操作 TIMER_A_操作 Timer_B操作 比较器A操作 端口操作 基

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//  MSP430-TEST44X Demo  FLL+ clock, runs internal DCO at 8Mhz
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//  Description: This program demostrates setting the internalDCO to run at
//  8Mhz with auto-calibration by the FLL+.
//  ACLK = LFXT1 = 32768, MCLK = SMCLK = DCOCLK = (n+1) x 2 x ACLK
//  //*An external watch crystal is required on XIN/XOUT for ACLK*//	
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//                 MSP430F449
//             -----------------
//         /|\|              XIN|-
//          | |                 | 32khz xtal
//          --|RST          XOUT|-
//            |                 |
//            |             P1.1|--> MCLK = 8Mhz
//            |                 |
//            |             P1.5|--> ACLK = 32khz
//            |                 |
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//  Lierda, Inc
//  February 2006.03
//  Built with IAR Embedded Workbench Version: 3.40a
//  ID：  MSP430-TEST44X
//  DATA：2005-7-12
//  REV： 2.0A
//  程序功能：该程序是通过设置不同的时钟源输出模式，具体是P1.5=ACLK=32.768Khz;P1.1=MCLK=8Mhz,
//            通过本实验了解MSP430内部的时钟来源和不同频率的设置。
//  硬件连接：在必须连接P1.1、P1.5短接器，
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#include "msp430x44x.h"

void main(void)
{
  WDTCTL = WDTPW + WDTHOLD;       // stop watchdog timer
  SCFI0 |= FN_4;                  // x2 DCO frequency, 8MHz nominal DCO
  SCFQCTL = 121;                  // (121+1) x 32768 x 2 = 7.99 Mhz
  FLL_CTL0 = DCOPLUS + XCAP18PF;  // DCO+ set so freq = xtal x D x N+1
  P1DIR = 0x22;                   // P1.1 & P1.5 to output direction
  P1SEL = 0x22;                   // P1.1 & P1.5 to output MCLK & ACLK

  while(1);                       // loop in place
}