📄 clock6.fit.rpt
字号:
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The equations can be found in C:/altera/quartus50/clock/clock6.fit.eqn.
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; Pin-Out File ;
+--------------+
The pin-out file can be found in C:/altera/quartus50/clock/clock6.pin.
+---------------------------------------------------+
; Fitter Resource Usage Summary ;
+-------------------------------+-------------------+
; Resource ; Usage ;
+-------------------------------+-------------------+
; Logic cells ; 79 / 128 ( 61 % ) ;
; Registers ; 48 / 128 ( 37 % ) ;
; Number of pterms used ; 207 ;
; User inserted logic elements ; 0 ;
; I/O pins ; 19 / 80 ( 23 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; -- Dedicated input pins ; 0 / 2 ( 0 % ) ;
; Global signals ; 1 ;
; Shareable expanders ; 11 / 128 ( 8 % ) ;
; Parallel expanders ; 5 / 120 ( 4 % ) ;
; Cells using turbo bit ; 79 / 128 ( 61 % ) ;
; Maximum fan-out node ; count[11] ;
; Maximum fan-out ; 38 ;
; Total fan-out ; 962 ;
; Average fan-out ; 8.83 ;
+-------------------------------+-------------------+
+---------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+------+-------+----------+-----+-----------------------+--------------------+--------+--------------+----------------------+
; Name ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; I/O Standard ; Location assigned by ;
+------+-------+----------+-----+-----------------------+--------------------+--------+--------------+----------------------+
; clk ; 87 ; -- ; -- ; 24 ; 0 ; yes ; LVTTL ; User ;
+------+-------+----------+-----+-----------------------+--------------------+--------+--------------+----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+----------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+
; Name ; Pin # ; I/O Bank ; LAB ; Output Register ; Slow Slew Rate ; Open Drain ; TRI Primitive ; I/O Standard ; Location assigned by ; Load ;
+----------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+
; lddat[0] ; 83 ; -- ; 8 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; lddat[1] ; 84 ; -- ; 8 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; lddat[2] ; 85 ; -- ; 8 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; lddat[3] ; 92 ; -- ; 1 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; lddat[4] ; 93 ; -- ; 1 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; lddat[5] ; 94 ; -- ; 1 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; lddat[6] ; 96 ; -- ; 1 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; lddat[7] ; 97 ; -- ; 1 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; ldsel[0] ; 81 ; -- ; 8 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; ldsel[1] ; 80 ; -- ; 8 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; ldsel[2] ; 79 ; -- ; 8 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; ldsel[3] ; 77 ; -- ; 8 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; ldsel[4] ; 76 ; -- ; 8 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; ldsel[5] ; 75 ; -- ; 8 ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
+----------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+
+-------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; 1 ; 12 ; -- ; RESERVED ; ; ; ; ;
; 2 ; 13 ; -- ; RESERVED ; ; ; ; ;
; 3 ; 14 ; -- ; VCCIO ; power ; ; 3.3V ; ;
; 4 ; 15 ; -- ; +TDI ; input ; LVTTL ; ; N ;
; 5 ; 16 ; -- ; RESERVED ; ; ; ; ;
; 6 ; 17 ; -- ; RESERVED ; ; ; ; ;
; 7 ; 18 ; -- ; RESERVED ; ; ; ; ;
; 8 ; 19 ; -- ; RESERVED ; ; ; ; ;
; 9 ; 20 ; -- ; RESERVED ; ; ; ; ;
; 10 ; 21 ; -- ; RESERVED ; ; ; ; ;
; 11 ; 22 ; -- ; GND ; gnd ; ; ; ;
; 12 ; 23 ; -- ; RESERVED ; ; ; ; ;
; 13 ; 24 ; -- ; RESERVED ; ; ; ; ;
; 14 ; 25 ; -- ; RESERVED ; ; ; ; ;
; 15 ; 26 ; -- ; +TMS ; input ; LVTTL ; ; N ;
; 16 ; 27 ; -- ; RESERVED ; ; ; ; ;
; 17 ; 28 ; -- ; RESERVED ; ; ; ; ;
; 18 ; 29 ; -- ; VCCIO ; power ; ; 3.3V ; ;
; 19 ; 30 ; -- ; RESERVED ; ; ; ; ;
; 20 ; 31 ; -- ; RESERVED ; ; ; ; ;
; 21 ; 32 ; -- ; RESERVED ; ; ; ; ;
; 22 ; 33 ; -- ; RESERVED ; ; ; ; ;
; 23 ; 34 ; -- ; RESERVED ; ; ; ; ;
; 24 ; 35 ; -- ; RESERVED ; ; ; ; ;
; 25 ; 36 ; -- ; RESERVED ; ; ; ; ;
; 26 ; 37 ; -- ; GND ; gnd ; ; ; ;
; 27 ; 38 ; -- ; RESERVED ; ; ; ; ;
; 28 ; 39 ; -- ; RESERVED ; ; ; ; ;
; 29 ; 40 ; -- ; RESERVED ; ; ; ; ;
; 30 ; 41 ; -- ; RESERVED ; ; ; ; ;
; 31 ; 42 ; -- ; RESERVED ; ; ; ; ;
; 32 ; 43 ; -- ; RESERVED ; ; ; ; ;
; 33 ; 44 ; -- ; GND ; gnd ; ; ; ;
; 34 ; 45 ; -- ; VCCIO ; power ; ; 3.3V ; ;
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