📄 a2d.tan.rpt
字号:
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; Clock Setup: 'clk' ;
+-----------------------------------------+-----------------------------------------------------+------------+------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+------------+------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A ; 57.08 MHz ( period = 17.520 ns ) ; count1[8] ; t_ramsi ; clk ; clk ; None ; None ; 16.811 ns ;
; N/A ; 58.48 MHz ( period = 17.100 ns ) ; count1[1] ; t_ramsi ; clk ; clk ; None ; None ; 16.391 ns ;
; N/A ; 58.83 MHz ( period = 16.998 ns ) ; count1[11] ; t_ramsi ; clk ; clk ; None ; None ; 16.289 ns ;
; N/A ; 59.04 MHz ( period = 16.937 ns ) ; count1[1] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 16.228 ns ;
; N/A ; 59.15 MHz ( period = 16.907 ns ) ; count1[8] ; t_ramsi~en ; clk ; clk ; None ; None ; 16.198 ns ;
; N/A ; 59.26 MHz ( period = 16.875 ns ) ; count1[8] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 16.166 ns ;
; N/A ; 60.39 MHz ( period = 16.558 ns ) ; count1[8] ; count3[0] ; clk ; clk ; None ; None ; 15.849 ns ;
; N/A ; 60.39 MHz ( period = 16.558 ns ) ; count1[8] ; count3[1] ; clk ; clk ; None ; None ; 15.849 ns ;
; N/A ; 60.65 MHz ( period = 16.487 ns ) ; count1[1] ; t_ramsi~en ; clk ; clk ; None ; None ; 15.778 ns ;
; N/A ; 60.75 MHz ( period = 16.461 ns ) ; count1[8] ; ram_part_addr[3] ; clk ; clk ; None ; None ; 15.752 ns ;
; N/A ; 60.93 MHz ( period = 16.412 ns ) ; count1[0] ; t_ramsi ; clk ; clk ; None ; None ; 15.703 ns ;
; N/A ; 61.03 MHz ( period = 16.385 ns ) ; count1[11] ; t_ramsi~en ; clk ; clk ; None ; None ; 15.676 ns ;
; N/A ; 61.08 MHz ( period = 16.373 ns ) ; count1[8] ; t_ramdata[1] ; clk ; clk ; None ; None ; 15.664 ns ;
; N/A ; 61.08 MHz ( period = 16.373 ns ) ; count1[8] ; t_ramdata[0] ; clk ; clk ; None ; None ; 15.664 ns ;
; N/A ; 61.15 MHz ( period = 16.353 ns ) ; count1[11] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 15.644 ns ;
; N/A ; 61.24 MHz ( period = 16.330 ns ) ; count1[8] ; t_ramdata[2] ; clk ; clk ; None ; None ; 15.621 ns ;
; N/A ; 61.27 MHz ( period = 16.320 ns ) ; count1[9] ; t_ramsi ; clk ; clk ; None ; None ; 15.611 ns ;
; N/A ; 61.54 MHz ( period = 16.249 ns ) ; count1[0] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 15.540 ns ;
; N/A ; 62.07 MHz ( period = 16.112 ns ) ; count2[7] ; t_ramsi ; clk ; clk ; None ; None ; 15.403 ns ;
; N/A ; 62.17 MHz ( period = 16.086 ns ) ; count1[12] ; t_ramsi ; clk ; clk ; None ; None ; 15.377 ns ;
; N/A ; 62.17 MHz ( period = 16.085 ns ) ; count2[3] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 15.376 ns ;
; N/A ; 62.29 MHz ( period = 16.055 ns ) ; count2[7] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 15.346 ns ;
; N/A ; 62.42 MHz ( period = 16.021 ns ) ; count1[12] ; t_ramdata[1] ; clk ; clk ; None ; None ; 15.312 ns ;
; N/A ; 62.42 MHz ( period = 16.021 ns ) ; count1[12] ; t_ramdata[0] ; clk ; clk ; None ; None ; 15.312 ns ;
; N/A ; 62.59 MHz ( period = 15.978 ns ) ; count1[12] ; t_ramdata[2] ; clk ; clk ; None ; None ; 15.269 ns ;
; N/A ; 62.90 MHz ( period = 15.897 ns ) ; count2[4] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 15.188 ns ;
; N/A ; 62.98 MHz ( period = 15.879 ns ) ; count1[8] ; ram_part_addr[2] ; clk ; clk ; None ; None ; 15.170 ns ;
; N/A ; 62.98 MHz ( period = 15.877 ns ) ; count1[2] ; t_ramsi ; clk ; clk ; None ; None ; 15.168 ns ;
; N/A ; 63.02 MHz ( period = 15.868 ns ) ; count1[8] ; ram_part_addr[1] ; clk ; clk ; None ; None ; 15.159 ns ;
; N/A ; 63.15 MHz ( period = 15.836 ns ) ; count1[1] ; ram_part_addr[3] ; clk ; clk ; None ; None ; 15.127 ns ;
; N/A ; 63.22 MHz ( period = 15.817 ns ) ; count1[10] ; t_ramsi ; clk ; clk ; None ; None ; 15.108 ns ;
; N/A ; 63.30 MHz ( period = 15.799 ns ) ; count1[0] ; t_ramsi~en ; clk ; clk ; None ; None ; 15.090 ns ;
; N/A ; 63.36 MHz ( period = 15.783 ns ) ; count1[1] ; ram_part_addr[1] ; clk ; clk ; None ; None ; 15.074 ns ;
; N/A ; 63.36 MHz ( period = 15.783 ns ) ; count1[1] ; ram_part_addr[2] ; clk ; clk ; None ; None ; 15.074 ns ;
; N/A ; 63.43 MHz ( period = 15.766 ns ) ; count2[8] ; t_ramsi ; clk ; clk ; None ; None ; 15.057 ns ;
; N/A ; 63.43 MHz ( period = 15.765 ns ) ; count1[12] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 15.056 ns ;
; N/A ; 63.55 MHz ( period = 15.735 ns ) ; count1[12] ; count3[0] ; clk ; clk ; None ; None ; 15.026 ns ;
; N/A ; 63.55 MHz ( period = 15.735 ns ) ; count1[12] ; count3[1] ; clk ; clk ; None ; None ; 15.026 ns ;
; N/A ; 63.57 MHz ( period = 15.731 ns ) ; count1[7] ; t_ramdata[0] ; clk ; clk ; None ; None ; 15.022 ns ;
; N/A ; 63.64 MHz ( period = 15.714 ns ) ; count1[2] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 15.005 ns ;
; N/A ; 63.66 MHz ( period = 15.709 ns ) ; count2[8] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 15.000 ns ;
; N/A ; 63.67 MHz ( period = 15.707 ns ) ; count1[9] ; t_ramsi~en ; clk ; clk ; None ; None ; 14.998 ns ;
; N/A ; 63.79 MHz ( period = 15.676 ns ) ; count2[5] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 14.967 ns ;
; N/A ; 63.80 MHz ( period = 15.675 ns ) ; count1[9] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 14.966 ns ;
; N/A ; 63.80 MHz ( period = 15.674 ns ) ; count1[3] ; t_ramsi ; clk ; clk ; None ; None ; 14.965 ns ;
; N/A ; 63.82 MHz ( period = 15.669 ns ) ; count1[8] ; t_ramdata[5] ; clk ; clk ; None ; None ; 14.960 ns ;
; N/A ; 63.82 MHz ( period = 15.669 ns ) ; count1[8] ; t_ramdata[4] ; clk ; clk ; None ; None ; 14.960 ns ;
; N/A ; 63.82 MHz ( period = 15.669 ns ) ; count1[8] ; t_ramdata[7] ; clk ; clk ; None ; None ; 14.960 ns ;
; N/A ; 63.82 MHz ( period = 15.669 ns ) ; count1[8] ; t_ramdata[3] ; clk ; clk ; None ; None ; 14.960 ns ;
; N/A ; 64.06 MHz ( period = 15.611 ns ) ; time[4] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 14.902 ns ;
; N/A ; 64.12 MHz ( period = 15.596 ns ) ; count1[12] ; ram_part_addr[3] ; clk ; clk ; None ; None ; 14.887 ns ;
; N/A ; 64.14 MHz ( period = 15.592 ns ) ; count1[4] ; t_ramsi ; clk ; clk ; None ; None ; 14.883 ns ;
; N/A ; 64.16 MHz ( period = 15.586 ns ) ; count1[4] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 14.877 ns ;
; N/A ; 64.27 MHz ( period = 15.560 ns ) ; time[8] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 14.851 ns ;
; N/A ; 64.28 MHz ( period = 15.558 ns ) ; count1[7] ; t_ramsi ; clk ; clk ; None ; None ; 14.849 ns ;
; N/A ; 64.36 MHz ( period = 15.538 ns ) ; count2[1] ; t_ramsi ; clk ; clk ; None ; None ; 14.829 ns ;
; N/A ; 64.38 MHz ( period = 15.532 ns ) ; count1[2] ; count3[0] ; clk ; clk ; None ; None ; 14.823 ns ;
; N/A ; 64.38 MHz ( period = 15.532 ns ) ; count1[2] ; count3[1] ; clk ; clk ; None ; None ; 14.823 ns ;
; N/A ; 64.40 MHz ( period = 15.527 ns ) ; count1[12] ; ram_part_addr[2] ; clk ; clk ; None ; None ; 14.818 ns ;
; N/A ; 64.45 MHz ( period = 15.516 ns ) ; count1[12] ; ram_part_addr[1] ; clk ; clk ; None ; None ; 14.807 ns ;
; N/A ; 64.48 MHz ( period = 15.509 ns ) ; count1[4] ; t_ramdata[1] ; clk ; clk ; None ; None ; 14.800 ns ;
; N/A ; 64.48 MHz ( period = 15.509 ns ) ; count1[4] ; t_ramdata[0] ; clk ; clk ; None ; None ; 14.800 ns ;
; N/A ; 64.52 MHz ( period = 15.499 ns ) ; count2[7] ; t_ramsi~en ; clk ; clk ; None ; None ; 14.790 ns ;
; N/A ; 64.60 MHz ( period = 15.481 ns ) ; count2[1] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 14.772 ns ;
; N/A ; 64.63 MHz ( period = 15.473 ns ) ; count1[12] ; t_ramsi~en ; clk ; clk ; None ; None ; 14.764 ns ;
; N/A ; 64.66 MHz ( period = 15.466 ns ) ; count1[4] ; t_ramdata[2] ; clk ; clk ; None ; None ; 14.757 ns ;
; N/A ; 64.69 MHz ( period = 15.458 ns ) ; count1[3] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 14.749 ns ;
; N/A ; 64.75 MHz ( period = 15.444 ns ) ; time[1] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 14.735 ns ;
; N/A ; 64.84 MHz ( period = 15.423 ns ) ; time[6] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 14.714 ns ;
; N/A ; 64.85 MHz ( period = 15.421 ns ) ; time[3] ; ram_part_addr[0] ; clk ; clk ; None ; None ; 14.712 ns ;
; N/A ; 64.88 MHz ( period = 15.412 ns ) ; count2[3] ; t_ramsi ; clk ; clk ; None ; None ; 14.703 ns ;
; N/A ; 64.94 MHz ( period = 15.400 ns ) ; count1[8] ; t_ramcs ; clk ; clk ; None ; None ; 14.691 ns ;
; N/A ; 65.02 MHz ( period = 15.381 ns ) ; count1[3] ; t_ramdata[1] ; clk ; clk ; None ; None ; 14.672 ns ;
; N/A ; 65.02 MHz ( period = 15.381 ns ) ; count1[3] ; t_ramdata[0] ; clk ; clk ; None ; None ; 14.672 ns ;
; N/A ; 65.07 MHz ( period = 15.368 ns ) ; count1[5] ; t_ramdata[0] ; clk ; clk ; None ; None ; 14.659 ns ;
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