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Frequency Analysis Report:
-------------------------
Design Name: WASH
Part Name: ispLSI1016-60LH44/883
This report contains the maximum frequency at which the design
can be operated. It also lists the path that determines the
maximum frequency and the number of GLB levels.
The remaining internal register paths and their frequencies
are also listed, if the source and the registers are driven
by the same reference clock.
Maximum Operating Frequency: 54 MHz
The clock period is 18.60.
Clock period = path delay + clock-to-output delay + setup time
path delay: 14.60
clock-to-output delay: 1.30
setup time: 2.70
The following path determines the frequency:
Startpoint: GLB_N_17/Q0
(edge-triggered flip-flop)
Endpoint: GLB_N_10/D0
(edge-triggered flip-flop)
No. of GLB Levels: 1
Internal Register Paths and Frequencies:
Source Source Destination Destination Clock Frequency # of GLB
Reference Register Reference Register Period [MHz] Levels
Clock Name Clock Name [ns]
==----------------------------------------------------------------------------------------------------------------
CP GLB_N_17/Q0 CP GLB_N_10/D0 18.60 54 1
CP GLB_N_17/Q0 CP GLB_N_13/D0 18.60 54 1
CP GLB_N_17/Q0 CP GLB_N_15/D0 18.60 54 1
CP GLB_N_12/Q0 CP GLB_N_10/D0 18.30 55 1
CP GLB_N_13/Q0 CP GLB_N_10/D0 18.30 55 1
CP GLB_N_14/Q0 CP GLB_N_10/D0 18.30 55 1
CP GLB_N_15/Q0 CP GLB_N_13/D0 18.30 55 1
CP GLB_N_12/Q0 CP GLB_N_14/D0 18.30 55 1
CP GLB_N_13/Q0 CP GLB_N_14/D0 18.30 55 1
CP GLB_N_14/Q0 CP GLB_N_14/D0 18.30 55 1
CP GLB_N_12/Q0 CP GLB_N_15/D0 18.30 55 1
CP GLB_N_13/Q0 CP GLB_N_15/D0 18.30 55 1
CP GLB_N_14/Q0 CP GLB_N_15/D0 18.30 55 1
CP GLB_N_16/Q0 CP GLB_N_10/D0 18.00 56 1
CP GLB_N_16/Q0 CP GLB_N_11/D0 18.00 56 1
CP GLB_N_17/Q0 CP GLB_N_11/D0 18.00 56 1
CP GLB_N_16/Q0 CP GLB_N_12/D0 18.00 56 1
CP GLB_N_17/Q0 CP GLB_N_12/D0 18.00 56 1
CP GLB_N_16/Q0 CP GLB_N_13/D0 18.00 56 1
CP GLB_N_16/Q0 CP GLB_N_14/D0 18.00 56 1
CP GLB_N_17/Q0 CP GLB_N_14/D0 18.00 56 1
CP GLB_N_17/Q0 CP GLB_N_16/D0 18.00 56 1
CP GLB_N_16/Q0 CP GLB_N_17/D0 18.00 56 1
CP GLB_N_17/Q0 CP GLB_N_17/D0 18.00 56 1
CP GLB_N_11/Q0 CP GLB_N_10/D0 17.90 56 1
CP GLB_N_11/Q0 CP GLB_N_12/D0 17.90 56 1
CP GLB_N_11/Q0 CP GLB_N_14/D0 17.90 56 1
CP GLB_N_15/Q0 CP GLB_N_10/D0 17.70 56 1
CP GLB_N_12/Q0 CP GLB_N_11/D0 17.70 56 1
CP GLB_N_13/Q0 CP GLB_N_11/D0 17.70 56 1
CP GLB_N_14/Q0 CP GLB_N_11/D0 17.70 56 1
CP GLB_N_15/Q0 CP GLB_N_12/D0 17.70 56 1
CP GLB_N_15/Q0 CP GLB_N_14/D0 17.70 56 1
CP GLB_N_12/Q0 CP GLB_N_16/D0 17.70 56 1
CP GLB_N_13/Q0 CP GLB_N_16/D0 17.70 56 1
CP GLB_N_14/Q0 CP GLB_N_16/D0 17.70 56 1
CP GLB_N_12/Q0 CP GLB_N_17/D0 17.70 56 1
CP GLB_N_13/Q0 CP GLB_N_17/D0 17.70 56 1
CP GLB_N_14/Q0 CP GLB_N_17/D0 17.70 56 1
CP GLB_N_10/Q0 CP GLB_N_12/D0 17.60 57 1
CP GLB_N_10/Q0 CP GLB_N_15/D0 17.60 57 1
CP GLB_N_11/Q0 CP GLB_N_13/D0 17.30 58 1
CP GLB_N_16/Q0 CP GLB_N_16/D0 17.30 58 1
CP GLB_N_10/Q0 CP GLB_N_11/D0 17.00 59 1
CP GLB_N_10/Q0 CP GLB_N_13/D0 17.00 59 1
CP GLB_N_10/Q0 CP GLB_N_16/D0 17.00 59 1
CP GLB_N_10/Q0 CP GLB_N_17/D0 17.00 59 1
CP GLB_N_12/Q0 CP GLB_N_12/D0 15.30 65 1
CP GLB_N_10/Q0 CP GLB_N_14/D0 15.30 65 1
CP GLB_N_11/Q0 CP GLB_N_15/D0 15.30 65 1
CP GLB_N_10/Q0 CP GLB_N_10/D0 14.70 68 1
CP GLB_N_11/Q0 CP GLB_N_11/D0 14.70 68 1
CP GLB_N_15/Q0 CP GLB_N_11/D0 14.70 68 1
CP GLB_N_12/Q0 CP GLB_N_13/D0 14.70 68 1
CP GLB_N_13/Q0 CP GLB_N_13/D0 14.70 68 1
CP GLB_N_11/Q0 CP GLB_N_16/D0 14.70 68 1
CP GLB_N_15/Q0 CP GLB_N_16/D0 14.70 68 1
CP GLB_N_11/Q0 CP GLB_N_17/D0 14.70 68 1
CP GLB_N_15/Q0 CP GLB_N_17/D0 14.70 68 1
CP GLB_N_15/Q0 CP GLB_N_15/D0 14.00 71 1
==-------------------------------------------------------------------------------------------
Information for flip-flop:
Global reset-to-output delay: 3.30
Clock-to-output delay: 1.30
User reset-to-output delay: 3.30
Data-to-output delay: 0.00
Setup time: 2.70
Hold time: 4.70
Pulse-width time: 6.00
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