📄 fir_top.fit.rpt
字号:
; Option ; Setting ;
+----------------------------------------------+--------------------------+
; Auto-restart configuration after error ; On ;
; Release clears before tri-states ; Off ;
; Enable user-supplied start-up clock (CLKUSR) ; Off ;
; Enable device-wide reset (DEV_CLRn) ; Off ;
; Enable device-wide output enable (DEV_OE) ; Off ;
; Enable INIT_DONE output ; Off ;
; Reserve all unused pins ; As output driving ground ;
; Base pin-out file on sameframe device ; Off ;
+----------------------------------------------+--------------------------+
+-------------------+
; Fitter Equations ;
+-------------------+
The equations can be found in c:/developing_classes/acc_quartusii/sd_edits/adv_qii4_0_test2/logiclock/fir/fir_top.fit.eqn.
+-----------------+
; Floorplan View ;
+-----------------+
Floorplan report data cannot be output to ASCII.
Please use Quartus II to view the floorplan report data.
+---------------+
; Pin-Out File ;
+---------------+
The pin-out file can be found in c:/developing_classes/acc_quartusii/sd_edits/adv_qii4_0_test2/logiclock/fir/fir_top.pin.
+---------------------------------------------------------+
; Fitter Resource Usage Summary ;
+----------------------------------------------------------
; Resource ; Usage ;
+-----------------------------+---------------------------+
; Logic cells ; 662 / 10,570 ( 6 % ) ;
; Registers ; 660 / 12,566 ( 5 % ) ;
; Total LABs ; 67 / 1,057 ( 6 % ) ;
; Logic cells in carry chains ; 62 ;
; User inserted logic cells ; 0 ;
; I/O pins ; 43 / 346 ( 12 % ) ;
; -- Clock pins ; 2 / 16 ( 12 % ) ;
; Global signals ; 2 ;
; M512s ; 0 / 94 ( 0 % ) ;
; M4Ks ; 3 / 60 ( 5 % ) ;
; M-RAMs ; 0 / 1 ( 0 % ) ;
; Total memory bits ; 6,752 / 920,448 ( < 1 % ) ;
; Total RAM block bits ; 13,824 / 920,448 ( 1 % ) ;
; DSP block 9-bit elements ; 0 / 48 ( 0 % ) ;
; Global clocks ; 2 / 16 ( 12 % ) ;
; Regional clocks ; 0 / 16 ( 0 % ) ;
; Fast regional clocks ; 0 / 8 ( 0 % ) ;
; DIFFIOCLKs ; 0 / 16 ( 0 % ) ;
; SERDES transmitters ; 0 / 44 ( 0 % ) ;
; SERDES receivers ; 0 / 44 ( 0 % ) ;
; Maximum fan-out node ; clock ;
; Maximum fan-out ; 663 ;
; Total fan-out ; 1731 ;
; Average fan-out ; 2.44 ;
+-----------------------------+---------------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; LogicLock Region Resource Usage ;
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------
; LogicLock Region ; Origin ; Width ; Height ; Logic Cells ; Registers ; Memory Bits ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; DSP 36x36 ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ;
+------------------+--------+-------+--------+-------------+-----------+-------------+--------------+---------+-----------+-----------+-------+--------------+--------------+-------------------+------------------+-----------------+
; fir_lock ; X3_Y1 ; 13 ; 8 ; 662 (662) ; 660 (660) ; 6752 (6752) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 2 (2) ; 549 (549) ; 111 (111) ; 62 (62) ;
+------------------+--------+-------+--------+-------------+-----------+-------------+--------------+---------+-----------+-----------+-------+--------------+--------------+-------------------+------------------+-----------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; clock ; M24 ; 5 ; 53 ; 19 ; 3 ; 663 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; data_in[0] ; AE10 ; 8 ; 12 ; 0 ; 3 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; data_in[10] ; AD6 ; 8 ; 3 ; 0 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; data_in[11] ; AC7 ; 8 ; 3 ; 0 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; data_in[1] ; AD10 ; 8 ; 12 ; 0 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; data_in[2] ; AD4 ; 8 ; 1 ; 0 ; 4 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; data_in[3] ; AE3 ; 8 ; 3 ; 0 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; data_in[4] ; AD2 ; 8 ; 1 ; 0 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; data_in[5] ; AB5 ; 8 ; 3 ; 0 ; 3 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; data_in[6] ; AE4 ; 8 ; 1 ; 0 ; 5 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; data_in[7] ; AE7 ; 8 ; 3 ; 0 ; 4 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; data_in[8] ; AE2 ; 8 ; 1 ; 0 ; 3 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; data_in[9] ; AC4 ; 1 ; 0 ; 1 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; rst ; M26 ; 5 ; 53 ; 19 ; 1 ; 14 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; Bus Hold ; Weak Pull Up ; Turbo Bit ; I/O Standard ; Current Strength ; Termination ; Location assigned by ;
+----------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+-----------+--------------+------------------+-------------+----------------------+
; done ; AB9 ; 8 ; 12 ; 0 ; 4 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; fir_result[0] ; AA9 ; 8 ; 12 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; fir_result[10] ; AA7 ; 8 ; 5 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; fir_result[11] ; AA3 ; 1 ; 0 ; 3 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; fir_result[12] ; AD3 ; 8 ; 1 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; fir_result[13] ; W10 ; 8 ; 17 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; fir_result[14] ; AF10 ; 8 ; 17 ; 0 ; 4 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; fir_result[15] ; AF9 ; 8 ; 12 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; fir_result[16] ; AB10 ; 8 ; 17 ; 0 ; 5 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; fir_result[17] ; AE6 ; 8 ; 5 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; fir_result[18] ; Y10 ; 8 ; 17 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; fir_result[19] ; AA10 ; 8 ; 17 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; fir_result[1] ; AD9 ; 8 ; 12 ; 0 ; 5 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
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