429_enc_dec.vqm

Quartus开发环境下开发的Arinc 429总线收发器工程

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wire \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|add_sub_u5c:wrusedw_sub|add_sub_cella[2]~COUT ;
wire \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|add_sub_u5c:wrusedw_sub|add_sub_cella[3]~COUT ;
wire \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|add_sub_u5c:wrusedw_sub|result[4] ;
wire \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|a_gray2bin_8cb:ws_dgrp_gray2bin|xor3 ;
wire \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|dffpipe_er2:ws_brp|dffe4a[3] ;
wire \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|add_sub_u5c:wrusedw_sub|result[3] ;
wire \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|add_sub_u5c:wrusedw_sub|result[2] ;
wire \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|dffpipe_er2:ws_brp|dffe4a[0]~13 ;
wire \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|a_gray2bin_8cb:ws_dgrp_gray2bin|xor1 ;
wire \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|add_sub_u5c:wrusedw_sub|result[1] ;
wire \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|a_gray2bin_8cb:wrptr_g_gray2bin|xor0 ;
wire \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|add_sub_u5c:wrusedw_sub|result[0] ;
wire [4:0] \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|dffpipe_er2:ws_bwp|dffe4a ;
wire [4:0] \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|a_graycounter_aq5:rdptr_g1p|power_modified_counter_values ;
wire [4:0] \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|wrptr_g ;
wire [4:0] \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|dffpipe_er2:ws_brp|dffe4a ;
wire [9:0] \null1sfr:inst3|null1_sfr ;
wire [31:0] \data_sfr:inst8|data_lath:data_lath1|data ;
wire [4:0] \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|alt_synch_pipe_h62:rs_dgwp|dffpipe_h62:dffpipe2|dffe3a ;
wire [4:0] \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|rdptr_g ;
wire [9:0] \zerossfr:inst4|zeros_sfr ;
wire [9:0] \onessfr:inst2|ones_sfr ;
wire [31:0] \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|altsyncram_2hp:fifo_ram|q_b ;
wire [4:0] \bit_cnt:inst7|lpm_counter:bit_counter_rtl_0|cntr_vo7:auto_generated|pre_hazard ;
wire [4:0] \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|add_sub_u5c:wrusedw_sub|result ;
wire [4:0] \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|delayed_wrptr_g ;
wire [1:0] \word_gap_timer:inst5|wg_cnt ;
wire [4:0] \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|alt_synch_pipe_h62:ws_dgrp|dffpipe_h62:dffpipe2|dffe3a ;
wire [6:0] \clk_div:inst1|cnt ;
wire [31:0] \data_sfr:inst8|data_out ;
wire [1:0] \clk_div:inst1|bclk_gen:b1|bcnt ;
wire [4:0] \lpm_fifo0:inst9|dcfifo:dcfifo_component|dcfifo_vos:auto_generated|a_graycounter_5j6:wrptr_g1p|power_modified_counter_values ;

wire \clk_div:inst1|__ALT_INV__clk_in ;