cycle_test2.m

实现了信道编码

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%%  内编译码模块的自环模二加测试   %%
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clear all;
close all;
sequence=round(rand(1,224));          % 随机产生Fire码编码后的得到的224bits码字序列
input=[sequence,zeros(1,4)];          % 加尾比特0000
viterbi_enc=SDC_IN_EN(input);         % 内编码（卷积码，编码后输出序列长度456bits）
viterbi_out=SDC_IN_DE(viterbi_enc);   % 内解码（Viterbi译码,输出序列长度228bits）
viterbi_dec=viterbi_out(1:224);       % 去掉四位尾比特

% 自环模二加为零则显示正确，否则显示错误
if rem((sequence+viterbi_dec),2)==0
    display "Correct!"
else
    display "Error!"
end