📄 data_bus_buf.fit.rpt
字号:
; 30 ; GND* ; ;
; 31 ; d_outbuf[6] ; LVTTL/LVCMOS ;
; 32 ; GND* ; ;
; 33 ; GND* ; ;
; 34 ; #TMS ; ;
; 35 ; ^nSTATUS ; ;
; 36 ; GND* ; ;
; 37 ; GND* ; ;
; 38 ; GND* ; ;
; 39 ; GND* ; ;
; 40 ; GND_INT ; ;
; 41 ; GND* ; ;
; 42 ; GND* ; ;
; 43 ; GND* ; ;
; 44 ; GND* ; ;
; 45 ; VCC_IO ; ;
; 46 ; GND* ; ;
; 47 ; GND* ; ;
; 48 ; GND* ; ;
; 49 ; GND* ; ;
; 50 ; VCC_INT ; ;
; 51 ; GND* ; ;
; 52 ; GND_INT ; ;
; 53 ; VCC_CKLK ; ;
; 54 ; d_outbuf[1] ; LVTTL/LVCMOS ;
; 55 ; d_outbuf[4] ; LVTTL/LVCMOS ;
; 56 ; d_outbuf[2] ; LVTTL/LVCMOS ;
; 57 ; GND_CKLK ; ;
; 58 ; GND_INT ; ;
; 59 ; GND* ; ;
; 60 ; GND* ; ;
; 61 ; VCC_IO ; ;
; 62 ; GND* ; ;
; 63 ; GND* ; ;
; 64 ; GND* ; ;
; 65 ; GND* ; ;
; 66 ; GND_INT ; ;
; 67 ; GND* ; ;
; 68 ; GND* ; ;
; 69 ; GND* ; ;
; 70 ; GND* ; ;
; 71 ; VCC_IO ; ;
; 72 ; d_inbuf[7] ; LVTTL/LVCMOS ;
; 73 ; GND* ; ;
; 74 ; ^nCONFIG ; ;
; 75 ; VCC_INT ; ;
; 76 ; ^MSEL1 ; ;
; 77 ; ^MSEL0 ; ;
; 78 ; GND* ; ;
; 79 ; GND* ; ;
; 80 ; data_bus[6] ; LVTTL/LVCMOS ;
; 81 ; GND* ; ;
; 82 ; GND* ; ;
; 83 ; GND* ; ;
; 84 ; GND_INT ; ;
; 85 ; VCC_INT ; ;
; 86 ; GND* ; ;
; 87 ; GND* ; ;
; 88 ; d_inbuf[0] ; LVTTL/LVCMOS ;
; 89 ; d_inbuf[1] ; LVTTL/LVCMOS ;
; 90 ; d_inbuf[2] ; LVTTL/LVCMOS ;
; 91 ; d_inbuf[3] ; LVTTL/LVCMOS ;
; 92 ; data_bus[0] ; LVTTL/LVCMOS ;
; 93 ; GND_INT ; ;
; 94 ; VCC_IO ; ;
; 95 ; data_bus[1] ; LVTTL/LVCMOS ;
; 96 ; data_bus[5] ; LVTTL/LVCMOS ;
; 97 ; GND* ; ;
; 98 ; GND* ; ;
; 99 ; GND* ; ;
; 100 ; d_outbuf[7] ; LVTTL/LVCMOS ;
; 101 ; data_bus[7] ; LVTTL/LVCMOS ;
; 102 ; GND* ; ;
; 103 ; VCC_INT ; ;
; 104 ; GND_INT ; ;
; 105 ; #TDI ; ;
; 106 ; ^nCE ; ;
; 107 ; ^DCLK ; ;
; 108 ; ^DATA0 ; ;
; 109 ; GND* ; ;
; 110 ; GND* ; ;
; 111 ; GND* ; ;
; 112 ; d_inbuf[4] ; LVTTL/LVCMOS ;
; 113 ; GND* ; ;
; 114 ; GND* ; ;
; 115 ; VCC_IO ; ;
; 116 ; GND* ; ;
; 117 ; GND* ; ;
; 118 ; GND* ; ;
; 119 ; GND* ; ;
; 120 ; GND* ; ;
; 121 ; GND* ; ;
; 122 ; GND* ; ;
; 123 ; GND_INT ; ;
; 124 ; d_outbuf[0] ; LVTTL/LVCMOS ;
; 125 ; d_outbuf[3] ; LVTTL/LVCMOS ;
; 126 ; lk_bus ; LVTTL/LVCMOS ;
; 127 ; VCC_INT ; ;
; 128 ; GND* ; ;
; 129 ; GND_INT ; ;
; 130 ; GND* ; ;
; 131 ; GND* ; ;
; 132 ; GND* ; ;
; 133 ; GND* ; ;
; 134 ; VCC_IO ; ;
; 135 ; GND* ; ;
; 136 ; GND* ; ;
; 137 ; GND* ; ;
; 138 ; GND* ; ;
; 139 ; GND_INT ; ;
; 140 ; GND* ; ;
; 141 ; GND* ; ;
; 142 ; GND* ; ;
; 143 ; GND* ; ;
; 144 ; GND* ; ;
+-------+-------------+--------------+
+---------------------------------------------------------+
; Control Signals ;
+--------+-------+---------+---------------+--------------+
; Name ; Pin # ; Fan-Out ; Usage ; Global Usage ;
+--------+-------+---------+---------------+--------------+
; lk_bus ; 126 ; 16 ; Output enable ; Pin ;
+--------+-------+---------+---------------+--------------+
+----------------------------------------+
; Global & Other Fast Signals ;
+-------------+-------+---------+--------+
; Name ; Pin # ; Fan-Out ; Global ;
+-------------+-------+---------+--------+
; lk_bus ; 126 ; 16 ; yes ;
; d_outbuf[0] ; 124 ; 1 ; no ;
; d_outbuf[1] ; 54 ; 1 ; no ;
; d_outbuf[2] ; 56 ; 1 ; no ;
; d_outbuf[3] ; 125 ; 1 ; no ;
; d_outbuf[4] ; 55 ; 1 ; no ;
+-------------+-------+---------+--------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+--------------------+------------+
; Name ; Fan-Out ;
+--------------------+------------+
; d_inbuf[0]$latch~3 ; 2 ;
; d_inbuf[2]$latch~3 ; 2 ;
; d_inbuf[6]$latch~3 ; 2 ;
; d_inbuf[5]$latch~3 ; 2 ;
; d_inbuf[1]$latch~3 ; 2 ;
; d_inbuf[4]$latch~3 ; 2 ;
; d_inbuf[3]$latch~3 ; 2 ;
; d_inbuf[7]$latch~3 ; 2 ;
; data_bus[5] ; 1 ;
; d_outbuf[6] ; 1 ;
; d_outbuf[5] ; 1 ;
; d_outbuf[0] ; 1 ;
; data_bus[7]~31 ; 1 ;
; d_outbuf[1] ; 1 ;
; data_bus[5]~29 ; 1 ;
; data_bus[4]~28 ; 1 ;
; data_bus[3]~27 ; 1 ;
; d_outbuf[7] ; 1 ;
; data_bus[1]~25 ; 1 ;
; d_outbuf[3] ; 1 ;
; data_bus[3] ; 1 ;
; data_bus[1] ; 1 ;
; d_outbuf[2] ; 1 ;
; data_bus[2] ; 1 ;
; d_outbuf[4] ; 1 ;
; data_bus[0]~24 ; 1 ;
; data_bus[2]~26 ; 1 ;
; data_bus[4] ; 1 ;
; data_bus[7] ; 1 ;
; data_bus[6]~30 ; 1 ;
; data_bus[6] ; 1 ;
; data_bus[0] ; 1 ;
+--------------------+------------+
+-----------------------------------------------------------------------------------------------------+
; Peripheral Signals ;
+-------------------+--------+---------------+-----------------+---------------------------+----------+
; Peripheral Signal ; Source ; Usage ; Dedicated Clock ; Peripheral Control Signal ; Polarity ;
+-------------------+--------+---------------+-----------------+---------------------------+----------+
; lk_bus ; 126 ; Output enable ; no ; yes ; +ve ;
+-------------------+--------+---------------+-----------------+---------------------------+----------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 203 ;
; 1 ; 12 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 1 ;
+--------------------------+----------------+
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