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📄 top_8255.fit.rpt

📁 用Verilog实现8255芯片功能
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📖 第 1 页 / 共 3 页
字号:
; 49    ; GND*        ;              ;
; 50    ; VCC_INT     ;              ;
; 51    ; GND*        ;              ;
; 52    ; GND_INT     ;              ;
; 53    ; VCC_CKLK    ;              ;
; 54    ; rd_n        ; LVTTL/LVCMOS ;
; 55    ; a0          ; LVTTL/LVCMOS ;
; 56    ; a1          ; LVTTL/LVCMOS ;
; 57    ; GND_CKLK    ;              ;
; 58    ; GND_INT     ;              ;
; 59    ; GND*        ;              ;
; 60    ; GND*        ;              ;
; 61    ; VCC_IO      ;              ;
; 62    ; GND*        ;              ;
; 63    ; GND*        ;              ;
; 64    ; GND*        ;              ;
; 65    ; GND*        ;              ;
; 66    ; GND_INT     ;              ;
; 67    ; GND*        ;              ;
; 68    ; GND*        ;              ;
; 69    ; GND*        ;              ;
; 70    ; GND*        ;              ;
; 71    ; VCC_IO      ;              ;
; 72    ; GND*        ;              ;
; 73    ; a_bus[5]    ; LVTTL/LVCMOS ;
; 74    ; ^nCONFIG    ;              ;
; 75    ; VCC_INT     ;              ;
; 76    ; ^MSEL1      ;              ;
; 77    ; ^MSEL0      ;              ;
; 78    ; data_bus[5] ; LVTTL/LVCMOS ;
; 79    ; c_bus[5]    ; LVTTL/LVCMOS ;
; 80    ; a_bus[6]    ; LVTTL/LVCMOS ;
; 81    ; b_bus[6]    ; LVTTL/LVCMOS ;
; 82    ; NC          ;              ;
; 83    ; data_bus[6] ; LVTTL/LVCMOS ;
; 84    ; GND_INT     ;              ;
; 85    ; VCC_INT     ;              ;
; 86    ; a_bus[3]    ; LVTTL/LVCMOS ;
; 87    ; a_bus[1]    ; LVTTL/LVCMOS ;
; 88    ; data_bus[1] ; LVTTL/LVCMOS ;
; 89    ; NC          ;              ;
; 90    ; data_bus[3] ; LVTTL/LVCMOS ;
; 91    ; data_bus[7] ; LVTTL/LVCMOS ;
; 92    ; b_bus[3]    ; LVTTL/LVCMOS ;
; 93    ; GND_INT     ;              ;
; 94    ; VCC_IO      ;              ;
; 95    ; b_bus[4]    ; LVTTL/LVCMOS ;
; 96    ; b_bus[0]    ; LVTTL/LVCMOS ;
; 97    ; a_bus[0]    ; LVTTL/LVCMOS ;
; 98    ; c_bus[4]    ; LVTTL/LVCMOS ;
; 99    ; NC          ;              ;
; 100   ; GND*        ;              ;
; 101   ; NC          ;              ;
; 102   ; data_bus[4] ; LVTTL/LVCMOS ;
; 103   ; VCC_INT     ;              ;
; 104   ; NC          ;              ;
; 105   ; #TDI        ;              ;
; 106   ; ^nCE        ;              ;
; 107   ; ^DCLK       ;              ;
; 108   ; ^DATA0      ;              ;
; 109   ; GND*        ;              ;
; 110   ; GND*        ;              ;
; 111   ; GND*        ;              ;
; 112   ; GND*        ;              ;
; 113   ; GND*        ;              ;
; 114   ; a_bus[7]    ; LVTTL/LVCMOS ;
; 115   ; VCC_IO      ;              ;
; 116   ; data_bus[2] ; LVTTL/LVCMOS ;
; 117   ; GND*        ;              ;
; 118   ; GND*        ;              ;
; 119   ; GND*        ;              ;
; 120   ; b_bus[7]    ; LVTTL/LVCMOS ;
; 121   ; GND*        ;              ;
; 122   ; GND*        ;              ;
; 123   ; GND_INT     ;              ;
; 124   ; wr_n        ; LVTTL/LVCMOS ;
; 125   ; cs_n        ; LVTTL/LVCMOS ;
; 126   ; rst_n       ; LVTTL/LVCMOS ;
; 127   ; VCC_INT     ;              ;
; 128   ; GND*        ;              ;
; 129   ; GND_INT     ;              ;
; 130   ; GND*        ;              ;
; 131   ; GND*        ;              ;
; 132   ; GND*        ;              ;
; 133   ; GND*        ;              ;
; 134   ; VCC_IO      ;              ;
; 135   ; GND*        ;              ;
; 136   ; GND*        ;              ;
; 137   ; GND*        ;              ;
; 138   ; GND*        ;              ;
; 139   ; GND_INT     ;              ;
; 140   ; GND*        ;              ;
; 141   ; GND*        ;              ;
; 142   ; GND*        ;              ;
; 143   ; GND*        ;              ;
; 144   ; GND*        ;              ;
+-------+-------------+--------------+


+--------------------------------------------------------------------------------+
; Control Signals                                                                ;
+-----------------------------+---------+---------+---------------+--------------+
; Name                        ; Pin #   ; Fan-Out ; Usage         ; Global Usage ;
+-----------------------------+---------+---------+---------------+--------------+
; r_w_con:r_w_con1|lk_bus     ; LC1_A4  ; 44      ; Output enable ; Non-global   ;
; r_w_con:r_w_con1|a_mode_io  ; LC1_B3  ; 18      ; Output enable ; Non-global   ;
; r_w_con:r_w_con1|b_mode_io  ; LC1_B11 ; 18      ; Output enable ; Non-global   ;
; r_w_con:r_w_con1|c_lower_io ; LC1_C10 ; 9       ; Output enable ; Non-global   ;
; r_w_con:r_w_con1|c_upper_io ; LC1_C12 ; 9       ; Output enable ; Non-global   ;
+-----------------------------+---------+---------+---------------+--------------+


+----------------------------------+
; Global & Other Fast Signals      ;
+-------+-------+---------+--------+
; Name  ; Pin # ; Fan-Out ; Global ;
+-------+-------+---------+--------+
; wr_n  ; 124   ; 11      ; no     ;
; rd_n  ; 54    ; 11      ; no     ;
; a1    ; 56    ; 7       ; no     ;
; cs_n  ; 125   ; 7       ; no     ;
; a0    ; 55    ; 7       ; no     ;
; rst_n ; 126   ; 26      ; no     ;
+-------+-------+---------+--------+


+------------------------------------------------------------------+
; Non-Global High Fan-Out Signals                                  ;
+--------------------------------------------------------+---------+
; Name                                                   ; Fan-Out ;
+--------------------------------------------------------+---------+
; r_w_con:r_w_con1|lk_bus~84                             ; 44      ;
; rst_n                                                  ; 26      ;
; r_w_con:r_w_con1|bus_con[2]~498                        ; 24      ;
; r_w_con:r_w_con1|bus_con[0]~499                        ; 24      ;
; r_w_con:r_w_con1|bus_con[2]~496                        ; 20      ;
; r_w_con:r_w_con1|a_mode_io~8                           ; 18      ;
; r_w_con:r_w_con1|b_mode_io~1                           ; 18      ;
; r_w_con:r_w_con1|bus_con[1]~497                        ; 16      ;
; r_w_con:r_w_con1|c_set_rst[4]~10                       ; 14      ;
; r_w_con:r_w_con1|bus_con[0]~495                        ; 12      ;
; bb_port:bb_port1|always0~13                            ; 12      ;
; wr_n                                                   ; 11      ;
; rd_n                                                   ; 11      ;
; r_w_con:r_w_con1|con_word[0]~9                         ; 10      ;
; r_w_con:r_w_con1|c_upper_io~1                          ; 9       ;
; r_w_con:r_w_con1|c_lower_io~1                          ; 9       ;
; r_w_con:r_w_con1|con_word[2]~11                        ; 9       ;
; aa_port:aa_port1|always0~1                             ; 8       ;
; inter_bus:inter_bus1|data_bus_buf:c_bus1|data_bus~3286 ; 8       ;
; r_w_con:r_w_con1|con_word[3]~10                        ; 8       ;
; r_w_con:r_w_con1|con_word[1]~8                         ; 8       ;
; bb_port:bb_port1|always0~14                            ; 8       ;
; inter_bus:inter_bus1|data_bus_buf:c_bus1|data_bus~3320 ; 8       ;
; inter_bus:inter_bus1|data_bus_buf:c_bus1|data_bus~3336 ; 8       ;
; inter_bus:inter_bus1|data_bus_buf:c_bus1|data_bus~3303 ; 8       ;
; cs_n                                                   ; 7       ;
; a0                                                     ; 7       ;
; a1                                                     ; 7       ;
; r_w_con:r_w_con1|con_word[7]~7                         ; 6       ;
; r_w_con:r_w_con1|con~10                                ; 6       ;
; aa_port:aa_port1|a_inbuf[6]~126                        ; 4       ;
; aa_port:aa_port1|a_inbuf[7]~127                        ; 4       ;
; aa_port:aa_port1|a_inbuf[2]~122                        ; 4       ;
; aa_port:aa_port1|a_inbuf[5]~125                        ; 4       ;
; aa_port:aa_port1|a_inbuf[1]~121                        ; 4       ;
; aa_port:aa_port1|a_inbuf[3]~123                        ; 4       ;
; cc_port:cc_port1|c_inbuf[5]~117                        ; 4       ;
; cc_port:cc_port1|c_inbuf[6]~118                        ; 4       ;
; cc_port:cc_port1|c_inbuf[7]~119                        ; 4       ;
; data_bus_buf:data_buf1|d_inbuf[1]~67                   ; 4       ;
; cc_port:cc_port1|c_inbuf[3]~115                        ; 4       ;
; cc_port:cc_port1|c_inbuf[4]~116                        ; 4       ;
; cc_port:cc_port1|c_inbuf[1]~113                        ; 4       ;
; cc_port:cc_port1|c_inbuf[2]~114                        ; 4       ;
; data_bus_buf:data_buf1|d_inbuf[2]~68                   ; 4       ;
; cc_port:cc_port1|c_inbuf[0]~112                        ; 4       ;
; data_bus_buf:data_buf1|d_inbuf[4]~65                   ; 4       ;
; aa_port:aa_port1|a_inbuf[0]~120                        ; 4       ;
; data_bus_buf:data_buf1|d_inbuf[3]~69                   ; 4       ;
; data_bus_buf:data_buf1|d_inbuf[7]~66                   ; 4       ;
+--------------------------------------------------------+---------+


+----------------------------------------------------------------------------------------------------------------+
; Peripheral Signals                                                                                             ;
+-----------------------------+---------+---------------+-----------------+---------------------------+----------+
; Peripheral Signal           ; Source  ; Usage         ; Dedicated Clock ; Peripheral Control Signal ; Polarity ;
+-----------------------------+---------+---------------+-----------------+---------------------------+----------+
; r_w_con:r_w_con1|lk_bus     ; LC1_A4  ; Output enable ; no              ; yes                       ; +ve      ;
; r_w_con:r_w_con1|a_mode_io  ; LC1_B3  ; Output enable ; no              ; yes                       ; -ve      ;
; r_w_con:r_w_con1|b_mode_io  ; LC1_B11 ; Output enable ; no              ; yes                       ; -ve      ;
; r_w_con:r_w_con1|c_lower_io ; LC1_C10 ; Output enable ; no              ; yes                       ; -ve      ;
; r_w_con:r_w_con1|c_upper_io ; LC1_C12 ; Output enable ; no              ; yes                       ; -ve      ;
+-----------------------------+---------+---------------+-----------------+---------------------------+----------+


+-------------------------------------------+
; LAB                                       ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0                        ; 41             ;
; 1                        ; 6              ;
; 2                        ; 0              ;
; 3                        ; 0              ;
; 4                        ; 1              ;
; 5                        ; 2              ;
; 6                        ; 0              ;
; 7                        ; 5              ;
; 8                        ; 17             ;
+--------------------------+----------------+


+----------------------------------------------+
; Local Routing Interconnect                   ;
+-----------------------------+----------------+
; Local Routing Interconnects ; Number of LABs ;
+-----------------------------+----------------+

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