📄 cc_port.fit.rpt
字号:
; 34 ; #TMS ; ;
; 35 ; ^nSTATUS ; ;
; 36 ; r_w ; LVTTL/LVCMOS ;
; 37 ; GND* ; ;
; 38 ; GND* ; ;
; 39 ; GND* ; ;
; 40 ; GND_INT ; ;
; 41 ; GND* ; ;
; 42 ; GND* ; ;
; 43 ; GND* ; ;
; 44 ; GND* ; ;
; 45 ; VCC_IO ; ;
; 46 ; GND* ; ;
; 47 ; c_port ; LVTTL/LVCMOS ;
; 48 ; GND* ; ;
; 49 ; c_inbuf[2] ; LVTTL/LVCMOS ;
; 50 ; VCC_INT ; ;
; 51 ; c_inbuf[1] ; LVTTL/LVCMOS ;
; 52 ; GND_INT ; ;
; 53 ; VCC_CKLK ; ;
; 54 ; c_set_rst[4] ; LVTTL/LVCMOS ;
; 55 ; c_set_rst[1] ; LVTTL/LVCMOS ;
; 56 ; rst_n ; LVTTL/LVCMOS ;
; 57 ; GND_CKLK ; ;
; 58 ; GND_INT ; ;
; 59 ; GND* ; ;
; 60 ; GND* ; ;
; 61 ; VCC_IO ; ;
; 62 ; GND* ; ;
; 63 ; GND* ; ;
; 64 ; GND* ; ;
; 65 ; GND* ; ;
; 66 ; GND_INT ; ;
; 67 ; GND* ; ;
; 68 ; GND* ; ;
; 69 ; GND* ; ;
; 70 ; GND* ; ;
; 71 ; VCC_IO ; ;
; 72 ; GND* ; ;
; 73 ; GND* ; ;
; 74 ; ^nCONFIG ; ;
; 75 ; VCC_INT ; ;
; 76 ; ^MSEL1 ; ;
; 77 ; ^MSEL0 ; ;
; 78 ; c_inbuf[5] ; LVTTL/LVCMOS ;
; 79 ; c_inbuf[0] ; LVTTL/LVCMOS ;
; 80 ; c_outbuf[7] ; LVTTL/LVCMOS ;
; 81 ; c_outbuf[6] ; LVTTL/LVCMOS ;
; 82 ; NC ; ;
; 83 ; c_outbuf[4] ; LVTTL/LVCMOS ;
; 84 ; GND_INT ; ;
; 85 ; VCC_INT ; ;
; 86 ; select[0] ; LVTTL/LVCMOS ;
; 87 ; c_outbuf[0] ; LVTTL/LVCMOS ;
; 88 ; select[5] ; LVTTL/LVCMOS ;
; 89 ; NC ; ;
; 90 ; select[1] ; LVTTL/LVCMOS ;
; 91 ; c_outbuf[1] ; LVTTL/LVCMOS ;
; 92 ; select[6] ; LVTTL/LVCMOS ;
; 93 ; GND_INT ; ;
; 94 ; VCC_IO ; ;
; 95 ; GND* ; ;
; 96 ; GND* ; ;
; 97 ; c_outbuf[2] ; LVTTL/LVCMOS ;
; 98 ; GND* ; ;
; 99 ; NC ; ;
; 100 ; GND* ; ;
; 101 ; NC ; ;
; 102 ; GND* ; ;
; 103 ; VCC_INT ; ;
; 104 ; NC ; ;
; 105 ; #TDI ; ;
; 106 ; ^nCE ; ;
; 107 ; ^DCLK ; ;
; 108 ; ^DATA0 ; ;
; 109 ; GND* ; ;
; 110 ; GND* ; ;
; 111 ; GND* ; ;
; 112 ; GND* ; ;
; 113 ; GND* ; ;
; 114 ; GND* ; ;
; 115 ; VCC_IO ; ;
; 116 ; GND* ; ;
; 117 ; GND* ; ;
; 118 ; GND* ; ;
; 119 ; GND* ; ;
; 120 ; GND* ; ;
; 121 ; GND* ; ;
; 122 ; GND* ; ;
; 123 ; GND_INT ; ;
; 124 ; c_upper_io ; LVTTL/LVCMOS ;
; 125 ; c_set_rst[3] ; LVTTL/LVCMOS ;
; 126 ; c_lower_io ; LVTTL/LVCMOS ;
; 127 ; VCC_INT ; ;
; 128 ; c_inbuf[7] ; LVTTL/LVCMOS ;
; 129 ; GND_INT ; ;
; 130 ; c_inbuf[3] ; LVTTL/LVCMOS ;
; 131 ; GND* ; ;
; 132 ; c_set_rst[0] ; LVTTL/LVCMOS ;
; 133 ; GND* ; ;
; 134 ; VCC_IO ; ;
; 135 ; GND* ; ;
; 136 ; GND* ; ;
; 137 ; GND* ; ;
; 138 ; GND* ; ;
; 139 ; GND_INT ; ;
; 140 ; GND* ; ;
; 141 ; GND* ; ;
; 142 ; GND* ; ;
; 143 ; c_set_rst[2] ; LVTTL/LVCMOS ;
; 144 ; c_outbuf[5] ; LVTTL/LVCMOS ;
+-------+--------------+--------------+
+-------------------------------------------------------------+
; Control Signals ;
+------------+-------+---------+---------------+--------------+
; Name ; Pin # ; Fan-Out ; Usage ; Global Usage ;
+------------+-------+---------+---------------+--------------+
; c_lower_io ; 126 ; 8 ; Output enable ; Pin ;
; c_upper_io ; 124 ; 8 ; Output enable ; Pin ;
+------------+-------+---------+---------------+--------------+
+-----------------------------------------+
; Global & Other Fast Signals ;
+--------------+-------+---------+--------+
; Name ; Pin # ; Fan-Out ; Global ;
+--------------+-------+---------+--------+
; c_lower_io ; 126 ; 8 ; yes ;
; c_upper_io ; 124 ; 8 ; yes ;
; c_set_rst[3] ; 125 ; 13 ; no ;
; c_set_rst[1] ; 55 ; 13 ; no ;
; rst_n ; 56 ; 20 ; no ;
; c_set_rst[4] ; 54 ; 25 ; no ;
+--------------+-------+---------+--------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+--------------------+------------+
; Name ; Fan-Out ;
+--------------------+------------+
; c_set_rst[4] ; 25 ;
; rst_n ; 20 ;
; c_set_rst[3] ; 13 ;
; c_set_rst[1] ; 13 ;
; c_set_rst[2] ; 13 ;
; c_set_rst[0] ; 8 ;
; r_w ; 8 ;
; c_port ; 8 ;
; select~198 ; 5 ;
; c_inbuf[2]$latch~1 ; 2 ;
; c_inbuf[6]$latch~1 ; 2 ;
; c_out[5]~13 ; 2 ;
; c_out[6]~14 ; 2 ;
; c_inbuf[5]$latch~1 ; 2 ;
; c_out[4]~12 ; 2 ;
; c_out[3]~11 ; 2 ;
; c_out[2]~10 ; 2 ;
; c_out[1]~9 ; 2 ;
; c_inbuf[0]$latch~1 ; 2 ;
; c_inbuf[4]$latch~1 ; 2 ;
; Decoder0~340 ; 2 ;
; c_out[0]~8 ; 2 ;
; Decoder0~341 ; 2 ;
; Decoder0~339 ; 2 ;
; c_inbuf[1]$latch~1 ; 2 ;
; c_inbuf[3]$latch~1 ; 2 ;
; c_out[7]~15 ; 2 ;
; c_inbuf[7]$latch~1 ; 2 ;
; c_outbuf[3] ; 1 ;
; select~204 ; 1 ;
; Selector9~8 ; 1 ;
; Selector10~11 ; 1 ;
; Selector11~8 ; 1 ;
; c_outbuf[1] ; 1 ;
; select~199 ; 1 ;
; Selector15~93 ; 1 ;
; c_bus[2] ; 1 ;
; Decoder0~342 ; 1 ;
; c_bus[3] ; 1 ;
; Selector5~8 ; 1 ;
; c_bus[1] ; 1 ;
; Decoder0~346 ; 1 ;
; Decoder0~343 ; 1 ;
; Selector2~11 ; 1 ;
; Decoder0~344 ; 1 ;
; Selector3~8 ; 1 ;
; select~203 ; 1 ;
; Selector8~11 ; 1 ;
; c_bus[7] ; 1 ;
; c_bus[5] ; 1 ;
+--------------------+------------+
+-----------------------------------------------------------------------------------------------------+
; Peripheral Signals ;
+-------------------+--------+---------------+-----------------+---------------------------+----------+
; Peripheral Signal ; Source ; Usage ; Dedicated Clock ; Peripheral Control Signal ; Polarity ;
+-------------------+--------+---------------+-----------------+---------------------------+----------+
; c_lower_io ; 126 ; Output enable ; no ; yes ; -ve ;
; c_upper_io ; 124 ; Output enable ; no ; yes ; -ve ;
+-------------------+--------+---------------+-----------------+---------------------------+----------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 59 ;
; 1 ; 7 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 1 ;
; 5 ; 0 ;
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