📄 pd.fit.rpt
字号:
The pin-out file can be found in E:/emtl/vgactr/pd.pin.
+-------------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+---------------------------+
; Resource ; Usage ;
+---------------------------------------------+---------------------------+
; Total logic elements ; 252 / 8,256 ( 3 % ) ;
; -- Combinational with no register ; 87 ;
; -- Register only ; 26 ;
; -- Combinational with a register ; 139 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 51 ;
; -- 3 input functions ; 76 ;
; -- <=2 input functions ; 99 ;
; -- Register only ; 26 ;
; -- Combinational cells for routing ; 14 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 74 ;
; -- arithmetic mode ; 152 ;
; ; ;
; Total registers ; 165 / 8,256 ( 2 % ) ;
; Total LABs ; 29 / 516 ( 6 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 33 / 85 ( 39 % ) ;
; -- Clock pins ; 1 / 4 ( 25 % ) ;
; Global signals ; 1 ;
; M4Ks ; 0 / 36 ( 0 % ) ;
; Total memory bits ; 0 / 165,888 ( 0 % ) ;
; Total RAM block bits ; 0 / 165,888 ( 0 % ) ;
; Embedded Multiplier 9-bit elements ; 4 / 36 ( 11 % ) ;
; PLLs ; 0 / 2 ( 0 % ) ;
; Global clocks ; 1 / 8 ( 13 % ) ;
; Maximum fan-out node ; Iiclk~clkctrl ;
; Maximum fan-out ; 168 ;
; Highest non-global fan-out signal ; vgactr:inst|LessThan~1936 ;
; Highest non-global fan-out ; 72 ;
; Total fan-out ; 1131 ;
; Average fan-out ; 2.54 ;
+---------------------------------------------+---------------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Iiclk ; 91 ; 3 ; 34 ; 10 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[0] ; 93 ; 3 ; 34 ; 11 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[10] ; 120 ; 2 ; 28 ; 19 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[11] ; 119 ; 2 ; 28 ; 19 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[12] ; 118 ; 2 ; 28 ; 19 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[13] ; 115 ; 2 ; 30 ; 19 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[1] ; 94 ; 3 ; 34 ; 11 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[2] ; 96 ; 3 ; 34 ; 11 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[3] ; 97 ; 3 ; 34 ; 12 ; 3 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[4] ; 99 ; 3 ; 34 ; 14 ; 4 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[5] ; 100 ; 3 ; 34 ; 15 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[6] ; 101 ; 3 ; 34 ; 15 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[7] ; 112 ; 2 ; 32 ; 19 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[8] ; 113 ; 2 ; 32 ; 19 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Iin[9] ; 114 ; 2 ; 32 ; 19 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[0] ; 121 ; 2 ; 28 ; 19 ; 3 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[10] ; 137 ; 2 ; 3 ; 19 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[11] ; 139 ; 2 ; 3 ; 19 ; 3 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[12] ; 141 ; 2 ; 1 ; 19 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[13] ; 143 ; 2 ; 1 ; 19 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[1] ; 122 ; 2 ; 25 ; 19 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[2] ; 125 ; 2 ; 18 ; 19 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[3] ; 126 ; 2 ; 18 ; 19 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[4] ; 129 ; 2 ; 14 ; 19 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[5] ; 132 ; 2 ; 9 ; 19 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[6] ; 133 ; 2 ; 9 ; 19 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[7] ; 134 ; 2 ; 9 ; 19 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[8] ; 135 ; 2 ; 3 ; 19 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
; Qin[9] ; 136 ; 2 ; 3 ; 19 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVCMOS ; Off ; User ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; avgDown ; 70 ; 4 ; 32 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVCMOS ; 24mA ; Off ; User ; 0 pF ;
; avgUp ; 71 ; 4 ; 32 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVCMOS ; 24mA ; Off ; User ; 0 pF ;
; oclk ; 31 ; 1 ; 0 ; 2 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVCMOS ; 12mA ; Off ; User ; 0 pF ;
; sUp ; 72 ; 4 ; 32 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVCMOS ; 24mA ; Off ; User ; 0 pF ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 3 / 17 ( 18 % ) ; 3.3V ; -- ;
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