2400verilog.map.summary

来自「我刚完成的基于Quartus Two 开发环境全部用Verilog硬件描述语言编」· SUMMARY 代码 · 共 6 行

SUMMARY
6 行
字号 
Analysis & Synthesis Status : Failed - Sun Dec 31 23:53:15 2006
Quartus II Version : 5.1 Build 176 10/26/2005 SJ Full Version
Revision Name : 2400verilog
Top-level Entity Name : 2400verilog
Family : MAX7000S

2400verilog.map.summary - 源码说明

本页面展示了「我刚完成的基于Quartus Two 开发环境全部用Verilog硬件描述语言编译无误的MSK调制解调器」中的 2400verilog.map.summary 源码文件，采用 SUMMARY 编程语言编写，共 6 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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