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__REG32 PassRuntFrame : 1;
__REG32 PassRxFilter : 1;
__REG32 TxFlowControl : 1;
__REG32 RMII : 1;
__REG32 FullDuplex : 1;
__REG32 :21;
}__command_bits;
/* Status Register */
typedef struct{
__REG32 RxStatus : 1;
__REG32 TxStatus : 1;
__REG32 :30;
}__status_bits;
/* Receive Descriptor Base Address Register */
typedef struct{
__REG32 : 2;
__REG32 RxDescriptor :30;
}__rxdescr_bits;
/* Receive Status Base Address Register */
typedef struct{
__REG32 : 2;
__REG32 RxStatus :30;
}__rxstat_bits;
/* Receive Number of Descriptors Register */
typedef struct{
__REG32 RxDescriptorNumber :16;
__REG32 :16;
}__rxdescrn_bits;
/* Receive Produce Index Register */
typedef struct{
__REG32 RxProducdIndex :16;
__REG32 :16;
}__rxprodind_bits;
/* Receive Consume Index Register */
typedef struct{
__REG32 RxConsumeIndex :16;
__REG32 :16;
}__rxcomind_bits;
/* Transmit Descriptor Base Address Register */
typedef struct{
__REG32 : 2;
__REG32 TxDescriptor :30;
}__txdescr_bits;
/* Transmit Status Base Address Register */
typedef struct{
__REG32 : 2;
__REG32 TxStatus :30;
}__txstat_bits;
/* Transmit Number of Descriptors Register */
typedef struct{
__REG32 TxDescriptorNumber :16;
__REG32 :16;
}__txdescrn_bits;
/* Transmit Produce Index Register */
typedef struct{
__REG32 TxProducdIndex :16;
__REG32 :16;
}__txprodind_bits;
/* Transmit Consume Index Register */
typedef struct{
__REG32 TxConsumeIndex :16;
__REG32 :16;
}__txcomind_bits;
/* Transmit Status Vector 0 Register */
typedef struct{
__REG32 CCR_ERR : 1;
__REG32 LCERR : 1;
__REG32 LOOR : 1;
__REG32 DONE : 1;
__REG32 MULTICAST : 1;
__REG32 BROADCAST : 1;
__REG32 PD : 1;
__REG32 ED : 1;
__REG32 EC : 1;
__REG32 LC : 1;
__REG32 GIANT : 1;
__REG32 UNDERRUN : 1;
__REG32 TB :16;
__REG32 CF : 1;
__REG32 PAUSE : 1;
__REG32 BACKPRESSURE : 1;
__REG32 VLAN : 1;
}__tsv0_bits;
/* Transmit Status Vector 1 Register */
typedef struct{
__REG32 TBC :16;
__REG32 TCC : 4;
__REG32 :12;
}__tsv1_bits;
/* Receive Status Vector Register */
typedef struct{
__REG32 RBC :16;
__REG32 PPI : 1;
__REG32 RXDVEPS : 1;
__REG32 CEPS : 1;
__REG32 RCV : 1;
__REG32 CRC_ERR : 1;
__REG32 LCE : 1;
__REG32 LOOR : 1;
__REG32 R_OK : 1;
__REG32 MULTICAST : 1;
__REG32 BROADCAST : 1;
__REG32 DN : 1;
__REG32 CF : 1;
__REG32 PAUSE : 1;
__REG32 UO : 1;
__REG32 VLAN : 1;
__REG32 : 1;
}__rsv_bits;
/* Flow Control Counter Register */
typedef struct{
__REG32 MC :16;
__REG32 PT :16;
}__fwctrlcnt_bits;
/* Flow Control Status Register */
typedef struct{
__REG32 MCC :16;
__REG32 :16;
}__fwctrlstat_bits;
/* Receive Filter Control Register */
typedef struct{
__REG32 AUE : 1;
__REG32 ABE : 1;
__REG32 AME : 1;
__REG32 AUHE : 1;
__REG32 AMHE : 1;
__REG32 APE : 1;
__REG32 : 6;
__REG32 MPEWoL : 1;
__REG32 RxFEWoL : 1;
__REG32 :18;
}__rxflctrl_bits;
/* Receive Filter WoL Status Register */
typedef struct{
__REG32 AUWoL : 1;
__REG32 ABWoL : 1;
__REG32 AMWoL : 1;
__REG32 AUHWoL : 1;
__REG32 AMHWoL : 1;
__REG32 APWoL : 1;
__REG32 : 1;
__REG32 RxFWoL : 1;
__REG32 MPWoL : 1;
__REG32 :23;
}__rxflwolstat_bits;
/* Receive Filter WoL Clear Register */
typedef struct{
__REG32 AUWoLC : 1;
__REG32 ABWoLC : 1;
__REG32 AMWoLC : 1;
__REG32 AUHWoLC : 1;
__REG32 AMHWoLC : 1;
__REG32 APWoLC : 1;
__REG32 : 1;
__REG32 RxFWoLC : 1;
__REG32 MPWoLC : 1;
__REG32 :23;
}__rxflwolclr_bits;
/* Interrupt Status Register */
typedef struct{
__REG32 RxOverrunInt : 1;
__REG32 RxErrorInt : 1;
__REG32 RxFinishedInt : 1;
__REG32 RxDoneInt : 1;
__REG32 TxUnderrunInt : 1;
__REG32 TxErrorInt : 1;
__REG32 TxFinishedInt : 1;
__REG32 TxDoneInt : 1;
__REG32 : 4;
__REG32 SoftInt : 1;
__REG32 WakeupInt : 1;
__REG32 :18;
}__intstat_bits;
/* Interrupt Enable Register */
typedef struct{
__REG32 RxOverrunIntEn : 1;
__REG32 RxErrorIntEn : 1;
__REG32 RxFinishedIntEn : 1;
__REG32 RxDoneIntEn : 1;
__REG32 TxUnderrunIntEn : 1;
__REG32 TxErrorIntEn : 1;
__REG32 TxFinishedIntEn : 1;
__REG32 TxDoneIntEn : 1;
__REG32 : 4;
__REG32 SoftIntEn : 1;
__REG32 WakeupIntEn : 1;
__REG32 :18;
}__intena_bits;
/* Interrupt Clear Register */
typedef struct{
__REG32 RxOverrunIntClr : 1;
__REG32 RxErrorIntClr : 1;
__REG32 RxFinishedIntClr: 1;
__REG32 RxDoneIntClr : 1;
__REG32 TxUnderrunIntClr: 1;
__REG32 TxErrorIntClr : 1;
__REG32 TxFinishedIntClr: 1;
__REG32 TxDoneIntClr : 1;
__REG32 : 4;
__REG32 SoftIntClr : 1;
__REG32 WakeupIntClr : 1;
__REG32 :18;
}__intclr_bits;
/* Interrupt Set Register */
typedef struct{
__REG32 RxOverrunIntSet : 1;
__REG32 RxErrorIntSet : 1;
__REG32 RxFinishedIntSet: 1;
__REG32 RxDoneIntSet : 1;
__REG32 TxUnderrunIntSet: 1;
__REG32 TxErrorIntSet : 1;
__REG32 TxFinishedIntSet: 1;
__REG32 TxDoneIntSet : 1;
__REG32 : 4;
__REG32 SoftIntSet : 1;
__REG32 WakeupIntSet : 1;
__REG32 :18;
}__intset_bits;
/* Power Down Register */
typedef struct{
__REG32 :31;
__REG32 PowerDown : 1;
}__pwrdn_bits;
/* USB - Device Interrupt Status Register */
typedef struct {
__REG32 USB_INT_REQ_LP : 1;
__REG32 USB_INT_REQ_HP : 1;
__REG32 USB_INT_REQ_DMA : 1;
__REG32 USB_HOST_INT : 1;
__REG32 USB_ATX_INT : 1;
__REG32 USB_OTG_TIMER_INT : 1;
__REG32 USB_I2C_INT : 1;
__REG32 : 1;
__REG32 USB_NEED_CLOCK : 1;
__REG32 :22;
__REG32 EN_USB_INTS : 1;
} __usbints_bits;
/* USB - Device Interrupt Status Register */
/* USB - Device Interrupt Enable Register */
/* USB - Device Interrupt Clear Register */
/* USB - Device Interrupt Set Register */
typedef struct {
__REG32 FRAME : 1;
__REG32 EP_FAST : 1;
__REG32 EP_SLOW : 1;
__REG32 DEV_STAT : 1;
__REG32 CCEMTY : 1;
__REG32 CDFULL : 1;
__REG32 RxENDPKT : 1;
__REG32 TxENDPKT : 1;
__REG32 EP_RLZED : 1;
__REG32 ERR_INT : 1;
__REG32 :22;
} __devints_bits;
/* USB - Device Interrupt Priority Register */
typedef struct {
__REG8 FRAME : 1;
__REG8 EP_FAST : 1;
__REG8 : 6;
} __devintpri_bits;
/* USB - Endpoint Interrupt Status Register */
/* USB - Endpoint Interrupt Enable Register */
/* USB - Endpoint Interrupt Clear Register */
/* USB - Endpoint Interrupt Set Register */
/* USB - Endpoint Interrupt Priority Register */
typedef struct {
__REG32 EP_0RX : 1;
__REG32 EP_0TX : 1;
__REG32 EP_1RX : 1;
__REG32 EP_1TX : 1;
__REG32 EP_2RX : 1;
__REG32 EP_2TX : 1;
__REG32 EP_3RX : 1;
__REG32 EP_3TX : 1;
__REG32 EP_4RX : 1;
__REG32 EP_4TX : 1;
__REG32 EP_5RX : 1;
__REG32 EP_5TX : 1;
__REG32 EP_6RX : 1;
__REG32 EP_6TX : 1;
__REG32 EP_7RX : 1;
__REG32 EP_7TX : 1;
__REG32 EP_8RX : 1;
__REG32 EP_8TX : 1;
__REG32 EP_9RX : 1;
__REG32 EP_9TX : 1;
__REG32 EP_10RX : 1;
__REG32 EP_10TX : 1;
__REG32 EP_11RX : 1;
__REG32 EP_11TX : 1;
__REG32 EP_12RX : 1;
__REG32 EP_12TX : 1;
__REG32 EP_13RX : 1;
__REG32 EP_13TX : 1;
__REG32 EP_14RX : 1;
__REG32 EP_14TX : 1;
__REG32 EP_15RX : 1;
__REG32 EP_15TX : 1;
} __endpints_bits;
/* USB - Realize Enpoint Register */
typedef struct {
__REG32 EP0 : 1;
__REG32 EP1 : 1;
__REG32 EP2 : 1;
__REG32 EP3 : 1;
__REG32 EP4 : 1;
__REG32 EP5 : 1;
__REG32 EP6 : 1;
__REG32 EP7 : 1;
__REG32 EP8 : 1;
__REG32 EP9 : 1;
__REG32 EP10 : 1;
__REG32 EP11 : 1;
__REG32 EP12 : 1;
__REG32 EP13 : 1;
__REG32 EP14 : 1;
__REG32 EP15 : 1;
__REG32 EP16 : 1;
__REG32 EP17 : 1;
__REG32 EP18 : 1;
__REG32 EP19 : 1;
__REG32 EP20 : 1;
__REG32 EP21 : 1;
__REG32 EP22 : 1;
__REG32 EP23 : 1;
__REG32 EP24 : 1;
__REG32 EP25 : 1;
__REG32 EP26 : 1;
__REG32 EP27 : 1;
__REG32 EP28 : 1;
__REG32 EP29 : 1;
__REG32 EP30 : 1;
__REG32 EP31 : 1;
} __realizeendp_bits;
/* USB - Endpoint Index Register */
typedef struct {
__REG32 PHY_ENDP : 5;
__REG32 :27;
} __endpind_bits;
/* USB - MaxPacketSize Register */
typedef struct {
__REG32 MaxPacketSize :10;
__REG32 :22;
} __maxpacksize_bits;
/* USB - Receive Packet Length Register */
typedef struct {
__REG32 PKT_LNGTH :10;
__REG32 DV : 1;
__REG32 PKT_RDY : 1;
__REG32 :20;
} __rcvepktlen_bits;
/* USB - Transmit Packet Length Register */
typedef struct {
__REG32 PKT_LNGHT :10;
__REG32 :22;
} __transmitpktlen_bits;
/* USB - Control Register */
typedef struct {
__REG32 RD_EN : 1;
__REG32 WR_EN : 1;
__REG32 LOG_ENDPOINT : 4;
__REG32 :26;
} __usbctrl_bits;
/* USB - Command Code Register */
typedef struct {
__REG32 : 8;
__REG32 CMD_PHASE : 8;
__REG32 CMD_CODE : 8;
__REG32 : 8;
} __cmdcode_bits;
/* USB - Command Data Register */
typedef struct {
__REG32 CMD_DATA : 8;
__REG32 :24;
} __cmddata_bits;
/* USB - DMA Request Status Register */
/* USB - DMA Request Clear Register */
/* USB - DMA Request Set Regiser */
typedef struct {
__REG32 EP0 : 1;
__REG32 EP1 : 1;
__REG32 EP2 : 1;
__REG32 EP3 : 1;
__REG32 EP4 : 1;
__REG32 EP5 : 1;
__REG32 EP6 : 1;
__REG32 EP7 : 1;
__REG32 EP8 : 1;
__REG32 EP9 : 1;
__REG32 EP10 : 1;
__REG32 EP11 : 1;
__REG32 EP12 : 1;
__REG32 EP13 : 1;
__REG32 EP14 : 1;
__REG32 EP15 : 1;
__REG32 EP16 : 1;
__REG32 EP17 : 1;
__REG32 EP18 : 1;
__REG32 EP19 : 1;
__REG32 EP20 : 1;
__REG32 EP21 : 1;
__REG32 EP22 : 1;
__REG32 EP23 : 1;
__REG32 EP24 : 1;
__REG32 EP25 : 1;
__REG32 EP26 : 1;
__REG32 EP27 : 1;
__REG32 EP28 : 1;
__REG32 EP29 : 1;
__REG32 EP30 : 1;
__REG32 EP31 : 1;
} __dmarqstdiv_bits;
/* USB - UDCA Head Register */
typedef struct {
__REG32 : 7;
__REG32 UDCA_Header :25;
} __udcahead_bits;
/* USB - EP DMA Status Register */
/* USB - EP DMA Enable Register */
/* USB - EP DMA Disable Register */
typedef struct {
__REG32 EP0 : 1;
__REG32 EP1 : 1;
__REG32 EP2 : 1;
__REG32 EP3 : 1;
__REG32 EP4 : 1;
__REG32 EP5 : 1;
__REG32 EP6 : 1;
__REG32 EP7 : 1;
__REG32 EP8 : 1;
__REG32 EP9 : 1;
__REG32 EP10 : 1;
__REG32 EP11 : 1;
__REG32 EP12 : 1;
__REG32 EP13 : 1;
__REG32 EP14 : 1;
__REG32 EP15 : 1;
__REG32 EP16 : 1;
__REG32 EP17 : 1;
__REG32 EP18 : 1;
__REG32 EP19 : 1;
__REG32 EP20 : 1;
__REG32 EP21 : 1;
__REG32 EP22 : 1;
__REG32 EP23 : 1;
__REG32 EP24 : 1;
__REG32 EP25 : 1;
__REG32 EP26 : 1;
__REG32 EP27 : 1;
__REG32 EP28 : 1;
__REG32 EP29 : 1;
__REG32 EP30 : 1;
__REG32 EP31 : 1;
} __epdmadiv_bits;
/* USB - DMA Interrupt Status Register */
/* USB - DMA Interrupt Enable Register */
typedef struct {
__REG32 End_of_Transfer_Interrupt : 1;
__REG32 New_DD_Request_Interrupt : 1;
__REG32 System_Error_Interrupt : 1;
__REG32 :29;
} __dmaintstat_bits;
/* USB - New DD Request Interrupt Status Register */
/* USB - New DD Request Interrupt Clear Register */
/* USB - New DD Request Interrupt Set Register */
/* USB - End Of Transfer Interrupt Status Register */
/* USB - End Of Transfer Interrupt Clear Register */
/* USB - End Of Transfer Interrupt Set Register */
/* USB - System Error Interrupt Status Register */
/* USB - System Error Interrupt Clear Register */
/* USB - System Error Interrupt Set Register */
typedef struct {
__REG32 EP0 : 1;
__REG32 EP1 : 1;
__REG32 EP2 : 1;
__REG32 EP3 : 1;
__REG32 EP4 : 1;
__REG32 EP5 : 1;
__REG32 EP6 : 1;
__REG32 EP7 : 1;
__REG32 EP8 : 1;
__REG32 EP9 : 1;
__REG32 EP10 : 1;
__REG32 EP11 : 1;
__REG32 EP12 : 1;
__REG32 EP13 : 1;
__REG32 EP14 : 1;
__REG32 EP15 : 1;
__REG32 EP16 : 1;
__REG32 EP17 : 1;
__REG32 EP18 : 1;
__REG32 EP19 : 1;
__REG32 EP20 : 1;
__REG32 EP21 : 1;
__REG32 EP22 : 1;
__REG32 EP23 : 1;
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