📄 dds.pin
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-- This is a Quartus II output file. It is for reporting purposes only, and is
-- not intended for use as a Quartus II input file. This file cannot be used
-- to make Quartus II pin assignments - for instructions on how to make pin
-- assignments, please see Quartus II help.
------------------------------------------------------------------------------
------------------------------------------------------------------------------
-- NC : No Connect. This pin has no internal connection to the device.
-- VCC_INT : Dedicated power pin, which MUST be connected to VCC (5.0V).
-- VCC_IO : Dedicated power pin, which MUST be connected to VCC (Refer to
-- the table below for voltage).
-- GND : Dedicated ground pin, which MUST be connected to GND.
-- GND+ : Unused input. This pin should be connected to GND. It may also
-- be connected to a valid signal on the board (low, high, or
-- toggling) if that signal is required for a different revision
-- of the design.
-- GND* : Unused I/O pin. This pin can either be left unconnected or
-- connected to GND. Connecting this pin to GND will improve the
-- device's immunity to noise.
------------------------------------------------------------------------------
Quartus II Version 5.1 Build 176 10/26/2005 SJ Full Version
CHIP "dds" ASSIGNED TO AN: EPF10K10LC84-4
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
-------------------------------------------------------------------------------------------------------------
GND+ : 1 : : : : :
start : 2 : input : TTL : : : Y
freq[6] : 3 : input : TTL : : : Y
VCC_INT : 4 : power : : 5.0V : :
freq[7] : 5 : input : TTL : : : Y
GND* : 6 : : : : :
bo_select[1] : 7 : input : TTL : : : Y
bo_select[0] : 8 : input : TTL : : : Y
data[3] : 9 : output : TTL : : : Y
data[2] : 10 : output : TTL : : : Y
data[1] : 11 : output : TTL : : : Y
DATA0 : 12 : input : : : :
DCLK : 13 : bidir : : : :
nCE : 14 : input : : : :
TDI : 15 : input : : : :
data[0] : 16 : output : TTL : : : Y
int0 : 17 : output : TTL : : : Y
GND* : 18 : : : : :
clk : 19 : input : TTL : : : Y
VCC_INT : 20 : power : : 5.0V : :
GND* : 21 : : : : :
GND* : 22 : : : : :
GND* : 23 : : : : :
GND* : 24 : : : : :
GND* : 25 : : : : :
GND_INT : 26 : gnd : : : :
GND* : 27 : : : : :
GND* : 28 : : : : :
GND* : 29 : : : : :
GND* : 30 : : : : :
MSEL0 : 31 : input : : : :
MSEL1 : 32 : input : : : :
VCC_INT : 33 : power : : 5.0V : :
nCONFIG : 34 : input : : : :
GND* : 35 : : : : :
GND* : 36 : : : : :
GND* : 37 : : : : :
GND* : 38 : : : : :
GND* : 39 : : : : :
VCC_INT : 40 : power : : 5.0V : :
GND_INT : 41 : gnd : : : :
GND+ : 42 : : : : :
GND+ : 43 : : : : :
GND+ : 44 : : : : :
VCC_INT : 45 : power : : 5.0V : :
GND_INT : 46 : gnd : : : :
GND* : 47 : : : : :
bo_xing[7] : 48 : output : TTL : : : Y
bo_xing[6] : 49 : output : TTL : : : Y
bo_xing[5] : 50 : output : TTL : : : Y
bo_xing[4] : 51 : output : TTL : : : Y
bo_xing[3] : 52 : output : TTL : : : Y
bo_xing[2] : 53 : output : TTL : : : Y
bo_xing[1] : 54 : output : TTL : : : Y
nSTATUS : 55 : bidir : : : :
TRST : 56 : input : : : :
TMS : 57 : input : : : :
bo_xing[0] : 58 : output : TTL : : : Y
row[3] : 59 : input : TTL : : : Y
row[2] : 60 : input : TTL : : : Y
row[1] : 61 : input : TTL : : : Y
row[0] : 62 : input : TTL : : : Y
VCC_INT : 63 : power : : 5.0V : :
col[3] : 64 : output : TTL : : : Y
col[2] : 65 : output : TTL : : : Y
col[1] : 66 : output : TTL : : : Y
col[0] : 67 : output : TTL : : : Y
GND_INT : 68 : gnd : : : :
cs4 : 69 : output : TTL : : : Y
GND* : 70 : : : : :
GND* : 71 : : : : :
GND* : 72 : : : : :
freq[0] : 73 : input : TTL : : : Y
TDO : 74 : output : : : :
nCEO : 75 : output : : : :
CONF_DONE : 76 : bidir : : : :
TCK : 77 : input : : : :
freq[1] : 78 : input : TTL : : : Y
freq[2] : 79 : input : TTL : : : Y
freq[3] : 80 : input : TTL : : : Y
freq[4] : 81 : input : TTL : : : Y
GND_INT : 82 : gnd : : : :
freq[5] : 83 : input : TTL : : : Y
GND+ : 84 : : : : :
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