📄 digtalclk.fit.rpt
字号:
; 195 ; 211 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 196 ; 212 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 197 ; 213 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 198 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 199 ; ; ; GND ; gnd ; ; ; -- ; ;
; 200 ; 222 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 201 ; 223 ; 2 ; seg7[1] ; output ; LVTTL ; ; Column I/O ; N ;
; 202 ; 224 ; 2 ; seg7[2] ; output ; LVTTL ; ; Column I/O ; N ;
; 203 ; 225 ; 2 ; seg7[4] ; output ; LVTTL ; ; Column I/O ; N ;
; 204 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 205 ; ; ; GND ; gnd ; ; ; -- ; ;
; 206 ; 227 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 207 ; 228 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 208 ; 231 ; 2 ; ink1 ; input ; LVTTL ; ; Column I/O ; N ;
; 209 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ;
; 210 ; ; ; GND ; gnd ; ; ; -- ; ;
; 211 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 212 ; ; ; GND ; gnd ; ; ; -- ; ;
; 213 ; 239 ; 2 ; ink2 ; input ; LVTTL ; ; Column I/O ; N ;
; 214 ; 240 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 215 ; 241 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 216 ; 242 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 217 ; 243 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 218 ; 244 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 219 ; 245 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 220 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 221 ; ; ; GND ; gnd ; ; ; -- ; ;
; 222 ; 247 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 223 ; 248 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 224 ; 249 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 225 ; 250 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 226 ; 251 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 227 ; 252 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 228 ; 253 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 229 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 230 ; ; ; GND ; gnd ; ; ; -- ; ;
; 231 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ;
; 232 ; ; ; GND ; gnd ; ; ; -- ; ;
; 233 ; 254 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 234 ; 255 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 235 ; 256 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 236 ; 257 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 237 ; 258 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 238 ; 259 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 239 ; 260 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 240 ; 261 ; 2 ; GND* ; ; ; ; Column I/O ; ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
+------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+---------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+---------------------+-------+------------------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; 2.5 V ; 10 pF ; Not Available ;
; 1.8 V ; 10 pF ; Not Available ;
; 1.5 V ; 10 pF ; Not Available ;
; SSTL-3 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-3 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; Differential SSTL-2 ; 30 pF ; (See SSTL-2) ;
; 3.3-V PCI ; 10 pF ; 25 Ohm (Parallel) ;
; LVDS ; 4 pF ; 100 Ohm (Differential) ;
; RSDS ; 0 pF ; 100 Ohm (Differential) ;
+---------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+--------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+-----------------------------------------------------------------------------------------------------------------------------------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+--------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+-----------------------------------------------------------------------------------------------------------------------------------------------------+
; |digtalclk ; 1519 (8) ; 124 ; 0 ; 17 ; 0 ; 1395 (8) ; 18 (0) ; 106 (0) ; 701 (0) ; |digtalclk ;
; |bin2seg:inst9| ; 7 (7) ; 0 ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 0 (0) ; 0 (0) ; |digtalclk|bin2seg:inst9 ;
; |clock:inst1| ; 1442 (369) ; 81 ; 0 ; 0 ; 0 ; 1361 (288) ; 2 (2) ; 79 (79) ; 681 (106) ; |digtalclk|clock:inst1 ;
; |lpm_divide:div_rtl_11| ; 32 (0) ; 0 ; 0 ; 0 ; 0 ; 32 (0) ; 0 (0) ; 0 (0) ; 18 (0) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_11 ;
; |lpm_divide_ilf:auto_generated| ; 32 (0) ; 0 ; 0 ; 0 ; 0 ; 32 (0) ; 0 (0) ; 0 (0) ; 18 (0) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_11|lpm_divide_ilf:auto_generated ;
; |sign_div_unsign_khg:divider| ; 32 (0) ; 0 ; 0 ; 0 ; 0 ; 32 (0) ; 0 (0) ; 0 (0) ; 18 (0) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_11|lpm_divide_ilf:auto_generated|sign_div_unsign_khg:divider ;
; |alt_u_div_dld:divider| ; 32 (14) ; 0 ; 0 ; 0 ; 0 ; 32 (14) ; 0 (0) ; 0 (0) ; 18 (0) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_11|lpm_divide_ilf:auto_generated|sign_div_unsign_khg:divider|alt_u_div_dld:divider ;
; |add_sub_ne8:add_sub_3| ; 6 (6) ; 0 ; 0 ; 0 ; 0 ; 6 (6) ; 0 (0) ; 0 (0) ; 6 (6) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_11|lpm_divide_ilf:auto_generated|sign_div_unsign_khg:divider|alt_u_div_dld:divider|add_sub_ne8:add_sub_3 ;
; |add_sub_oe8:add_sub_4| ; 7 (7) ; 0 ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 0 (0) ; 7 (7) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_11|lpm_divide_ilf:auto_generated|sign_div_unsign_khg:divider|alt_u_div_dld:divider|add_sub_oe8:add_sub_4 ;
; |add_sub_oe8:add_sub_5| ; 5 (5) ; 0 ; 0 ; 0 ; 0 ; 5 (5) ; 0 (0) ; 0 (0) ; 5 (5) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_11|lpm_divide_ilf:auto_generated|sign_div_unsign_khg:divider|alt_u_div_dld:divider|add_sub_oe8:add_sub_5 ;
; |lpm_divide:div_rtl_12| ; 19 (0) ; 0 ; 0 ; 0 ; 0 ; 19 (0) ; 0 (0) ; 0 (0) ; 11 (0) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_12 ;
; |lpm_divide_hlf:auto_generated| ; 19 (0) ; 0 ; 0 ; 0 ; 0 ; 19 (0) ; 0 (0) ; 0 (0) ; 11 (0) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_12|lpm_divide_hlf:auto_generated ;
; |sign_div_unsign_jhg:divider| ; 19 (0) ; 0 ; 0 ; 0 ; 0 ; 19 (0) ; 0 (0) ; 0 (0) ; 11 (0) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_12|lpm_divide_hlf:auto_generated|sign_div_unsign_jhg:divider ;
; |alt_u_div_bld:divider| ; 19 (8) ; 0 ; 0 ; 0 ; 0 ; 19 (8) ; 0 (0) ; 0 (0) ; 11 (0) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_12|lpm_divide_hlf:auto_generated|sign_div_unsign_jhg:divider|alt_u_div_bld:divider ;
; |add_sub_ne8:add_sub_3| ; 6 (6) ; 0 ; 0 ; 0 ; 0 ; 6 (6) ; 0 (0) ; 0 (0) ; 6 (6) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_12|lpm_divide_hlf:auto_generated|sign_div_unsign_jhg:divider|alt_u_div_bld:divider|add_sub_ne8:add_sub_3 ;
; |add_sub_oe8:add_sub_4| ; 5 (5) ; 0 ; 0 ; 0 ; 0 ; 5 (5) ; 0 (0) ; 0 (0) ; 5 (5) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_12|lpm_divide_hlf:auto_generated|sign_div_unsign_jhg:divider|alt_u_div_bld:divider|add_sub_oe8:add_sub_4 ;
; |lpm_divide:div_rtl_13| ; 32 (0) ; 0 ; 0 ; 0 ; 0 ; 32 (0) ; 0 (0) ; 0 (0) ; 18 (0) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_13 ;
; |lpm_divide_ilf:auto_generated| ; 32 (0) ; 0 ; 0 ; 0 ; 0 ; 32 (0) ; 0 (0) ; 0 (0) ; 18 (0) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_13|lpm_divide_ilf:auto_generated ;
; |sign_div_unsign_khg:divider| ; 32 (0) ; 0 ; 0 ; 0 ; 0 ; 32 (0) ; 0 (0) ; 0 (0) ; 18 (0) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_13|lpm_divide_ilf:auto_generated|sign_div_unsign_khg:divider ;
; |alt_u_div_dld:divider| ; 32 (14) ; 0 ; 0 ; 0 ; 0 ; 32 (14) ; 0 (0) ; 0 (0) ; 18 (0) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_13|lpm_divide_ilf:auto_generated|sign_div_unsign_khg:divider|alt_u_div_dld:divider ;
; |add_sub_ne8:add_sub_3| ; 6 (6) ; 0 ; 0 ; 0 ; 0 ; 6 (6) ; 0 (0) ; 0 (0) ; 6 (6) ; |digtalclk|clock:inst1|lpm_divide:div_rtl_13|lpm_divide_ilf:auto_generated|sign_div_unsign_khg:divider|alt_u_div_dld:divider|add_sub_ne8:add_sub_3 ;
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; |add_sub_5g8:add_sub_10| ; 11 (11) ; 0 ; 0 ⌨️ 快捷键说明
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