clock.fit.summary

来自「运用vhdl语言编程,是数字逻辑中的电子钟!各模块及源代码都有,适合电信同学使用」· SUMMARY 代码 · 共 12 行

SUMMARY
12
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Flow Status : Successful - Sun Nov 28 10:30:05 2004
Quartus II Version : 4.2 Build 157 12/07/2004 SJ Full Version
Revision Name : clock
Top-level Entity Name : clock
Family : FLEX10K
Device : EPF10K10TC144-4
Timing Models : Final
Met timing requirements : N/A
Total logic elements : 137 / 576 ( 23 % )
Total pins : 15 / 102 ( 14 % )
Total memory bits : 0 / 6,144 ( 0 % )

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