📄 clock.fit.rpt
字号:
+--------------------------+----------------+
; 0 ; 49 ;
; 1 ; 3 ;
; 2 ; 2 ;
; 3 ; 1 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 4 ;
; 7 ; 1 ;
; 8 ; 12 ;
+--------------------------+----------------+
+----------------------------------------------+
; Local Routing Interconnect ;
+-----------------------------+----------------+
; Local Routing Interconnects ; Number of LABs ;
+-----------------------------+----------------+
; 0 ; 51 ;
; 1 ; 3 ;
; 2 ; 2 ;
; 3 ; 0 ;
; 4 ; 2 ;
; 5 ; 4 ;
; 6 ; 3 ;
; 7 ; 4 ;
; 8 ; 3 ;
+-----------------------------+----------------+
+---------------------------------------------+
; LAB External Interconnect ;
+----------------------------+----------------+
; LAB External Interconnects ; Number of LABs ;
+----------------------------+----------------+
; 0 - 1 ; 53 ;
; 2 - 3 ; 7 ;
; 4 - 5 ; 4 ;
; 6 - 7 ; 3 ;
; 8 - 9 ; 1 ;
; 10 - 11 ; 2 ;
; 12 - 13 ; 0 ;
; 14 - 15 ; 1 ;
; 16 - 17 ; 0 ;
; 18 - 19 ; 1 ;
+----------------------------+----------------+
+----------------------------------------------------------------------------------------+
; Row Interconnect ;
+-------+-------------------+-----------------------------+------------------------------+
; Row ; Interconnect Used ; Left Half Interconnect Used ; Right Half Interconnect Used ;
+-------+-------------------+-----------------------------+------------------------------+
; A ; 0 / 96 ( 0 % ) ; 0 / 48 ( 0 % ) ; 0 / 48 ( 0 % ) ;
; B ; 24 / 96 ( 25 % ) ; 34 / 48 ( 70 % ) ; 5 / 48 ( 10 % ) ;
; C ; 1 / 96 ( 1 % ) ; 7 / 48 ( 14 % ) ; 7 / 48 ( 14 % ) ;
; Total ; 25 / 288 ( 8 % ) ; 41 / 144 ( 28 % ) ; 12 / 144 ( 8 % ) ;
+-------+-------------------+-----------------------------+------------------------------+
+---------------------------+
; LAB Column Interconnect ;
+-------+-------------------+
; Col. ; Interconnect Used ;
+-------+-------------------+
; 1 ; 0 / 24 ( 0 % ) ;
; 2 ; 1 / 24 ( 4 % ) ;
; 3 ; 0 / 24 ( 0 % ) ;
; 4 ; 0 / 24 ( 0 % ) ;
; 5 ; 0 / 24 ( 0 % ) ;
; 6 ; 0 / 24 ( 0 % ) ;
; 7 ; 0 / 24 ( 0 % ) ;
; 8 ; 0 / 24 ( 0 % ) ;
; 9 ; 0 / 24 ( 0 % ) ;
; 10 ; 0 / 24 ( 0 % ) ;
; 11 ; 0 / 24 ( 0 % ) ;
; 12 ; 0 / 24 ( 0 % ) ;
; 13 ; 0 / 24 ( 0 % ) ;
; 14 ; 0 / 24 ( 0 % ) ;
; 15 ; 6 / 24 ( 25 % ) ;
; 16 ; 0 / 24 ( 0 % ) ;
; 17 ; 1 / 24 ( 4 % ) ;
; 18 ; 0 / 24 ( 0 % ) ;
; 19 ; 0 / 24 ( 0 % ) ;
; 20 ; 1 / 24 ( 4 % ) ;
; 21 ; 0 / 24 ( 0 % ) ;
; 22 ; 1 / 24 ( 4 % ) ;
; 23 ; 1 / 24 ( 4 % ) ;
; 24 ; 1 / 24 ( 4 % ) ;
; Total ; 12 / 576 ( 2 % ) ;
+-------+-------------------+
+---------------------------+
; LAB Column Interconnect ;
+-------+-------------------+
; Col. ; Interconnect Used ;
+-------+-------------------+
; 1 ; 0 / 24 ( 0 % ) ;
; Total ; 0 / 24 ( 0 % ) ;
+-------+-------------------+
+----------------------------------------------------+
; Fitter Resource Usage Summary ;
+--------------------------------+-------------------+
; Resource ; Usage ;
+--------------------------------+-------------------+
; Registers ; 60 / 576 ( 10 % ) ;
; Total LABs ; 0 / 72 ( 0 % ) ;
; Logic elements in carry chains ; 41 ;
; User inserted logic elements ; 0 ;
; I/O pins ; 15 / 102 ( 14 % ) ;
; -- Clock pins ; 1 ;
; -- Dedicated input pins ; 3 / 4 ( 75 % ) ;
; Global signals ; 3 ;
; EABs ; 0 / 3 ( 0 % ) ;
; Total memory bits ; 0 / 6,144 ( 0 % ) ;
; Total RAM block bits ; 0 / 6,144 ( 0 % ) ;
; Maximum fan-out node ; inst3 ;
; Maximum fan-out ; 17 ;
; Total fan-out ; 491 ;
; Average fan-out ; 3.23 ;
+--------------------------------+-------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------+
; |clock ; 137 (7) ; 60 ; 0 ; 15 ; 77 (7) ; 7 (0) ; 53 (0) ; 41 (0) ; |clock ;
; |bbb:inst17| ; 22 (22) ; 0 ; 0 ; 0 ; 22 (22) ; 0 (0) ; 0 (0) ; 0 (0) ; |clock|bbb:inst17 ;
; |ccc:inst22| ; 20 (7) ; 15 ; 0 ; 0 ; 5 (5) ; 2 (2) ; 13 (0) ; 13 (0) ; |clock|ccc:inst22 ;
; |lpm_counter:cnt_rtl_0| ; 13 (0) ; 13 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 13 (0) ; 13 (0) ; |clock|ccc:inst22|lpm_counter:cnt_rtl_0 ;
; |alt_counter_f10ke:wysi_counter| ; 13 (13) ; 13 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 13 (13) ; 13 (13) ; |clock|ccc:inst22|lpm_counter:cnt_rtl_0|alt_counter_f10ke:wysi_counter ;
; |disp:inst18| ; 7 (7) ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 0 (0) ; 0 (0) ; |clock|disp:inst18 ;
; |fen10:inst24| ; 6 (2) ; 5 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 5 (1) ; 4 (0) ; |clock|fen10:inst24 ;
; |lpm_counter:cnt_rtl_6| ; 4 (0) ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |clock|fen10:inst24|lpm_counter:cnt_rtl_6 ;
; |alt_counter_f10ke:wysi_counter| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (4) ; 4 (4) ; |clock|fen10:inst24|lpm_counter:cnt_rtl_6|alt_counter_f10ke:wysi_counter ;
; |fen10:inst25| ; 6 (2) ; 5 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 5 (1) ; 4 (0) ; |clock|fen10:inst25 ;
; |lpm_counter:cnt_rtl_5| ; 4 (0) ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |clock|fen10:inst25|lpm_counter:cnt_rtl_5 ;
; |alt_counter_f10ke:wysi_counter| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (4) ; 4 (4) ; |clock|fen10:inst25|lpm_counter:cnt_rtl_5|alt_counter_f10ke:wysi_counter ;
; |fen10:inst28| ; 6 (2) ; 5 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 5 (1) ; 4 (0) ; |clock|fen10:inst28 ;
; |lpm_counter:cnt_rtl_4| ; 4 (0) ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |clock|fen10:inst28|lpm_counter:cnt_rtl_4 ;
; |alt_counter_f10ke:wysi_counter| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (4) ; 4 (4) ; |clock|fen10:inst28|lpm_counter:cnt_rtl_4|alt_counter_f10ke:wysi_counter ;
; |hour:inst19| ; 16 (7) ; 8 ; 0 ; 0 ; 8 (3) ; 3 (3) ; 5 (1) ; 8 (0) ; |clock|hour:inst19 ;
; |lpm_add_sub:add_rtl_7| ; 4 (0) ; 0 ; 0 ; 0 ; 4 (0) ; 0 (0) ; 0 (0) ; 4 (0) ; |clock|hour:inst19|lpm_add_sub:add_rtl_7 ;
; |addcore:adder| ; 4 (1) ; 0 ; 0 ; 0 ; 4 (1) ; 0 (0) ; 0 (0) ; 4 (1) ; |clock|hour:inst19|lpm_add_sub:add_rtl_7|addcore:adder ;
; |a_csnbuffer:result_node| ; 3 (3) ; 0 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 0 (0) ; 3 (3) ; |clock|hour:inst19|lpm_add_sub:add_rtl_7|addcore:adder|a_csnbuffer:result_node ;
; |lpm_counter:cnt0_rtl_3| ; 5 (0) ; 4 ; 0 ; 0 ; 1 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |clock|hour:inst19|lpm_counter:cnt0_rtl_3 ;
; |alt_counter_f10ke:wysi_counter| ; 5 (5) ; 4 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 4 (4) ; 4 (4) ; |clock|hour:inst19|lpm_counter:cnt0_rtl_3|alt_counter_f10ke:wysi_counter ;
; |mian:inst1| ; 15 (10) ; 9 ; 0 ; 0 ; 6 (5) ; 0 (0) ; 9 (5) ; 4 (0) ; |clock|mian:inst1 ;
; |lpm_counter:cnt1_rtl_2| ; 5 (0) ; 4 ; 0 ; 0 ; 1 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |clock|mian:inst1|lpm_counter:cnt1_rtl_2 ;
; |alt_counter_f10ke:wysi_counter| ; 5 (5) ; 4 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 4 (4) ; 4 (4) ; |clock|mian:inst1|lpm_counter:cnt1_rtl_2|alt_counter_f10ke:wysi_counter ;
; |mina:inst8| ; 19 (14) ; 9 ; 0 ; 0 ; 10 (9) ; 2 (2) ; 7 (3) ; 4 (0) ; |clock|mina:inst8 ;
; |lpm_counter:cnt1_rtl_1| ; 5 (0) ; 4 ; 0 ; 0 ; 1 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |clock|mina:inst8|lpm_counter:cnt1_rtl_1 ;
; |alt_counter_f10ke:wysi_counter| ; 5 (5) ; 4 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 4 (4) ; 4 (4) ; |clock|mina:inst8|lpm_counter:cnt1_rtl_1|alt_counter_f10ke:wysi_counter ;
; |sel:inst23| ; 2 (2) ; 2 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 2 (2) ; 0 (0) ; |clock|sel:inst23 ;
; |sst:inst4| ; 11 (11) ; 2 ; 0 ; 0 ; 9 (9) ; 0 (0) ; 2 (2) ; 0 (0) ; |clock|sst:inst4 ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------+
+--------------------------------+
; Delay Chain Summary ;
+-------+----------+-------------+
; Name ; Pin Type ; Pad to Core ;
+-------+----------+-------------+
; sb ; Input ; OFF ;
; clk4m ; Input ; OFF ;
; sa ; Input ; OFF ;
; sc ; Input ; OFF ;
; sound ; Output ; OFF ;
; t[6] ; Output ; OFF ;
; t[5] ; Output ; OFF ;
; t[4] ; Output ; OFF ;
; t[3] ; Output ; OFF ;
; t[2] ; Output ; OFF ;
; t[1] ; Output ; OFF ;
; t[0] ; Output ; OFF ;
; y[2] ; Output ; OFF ;
; y[1] ; Output ; OFF ;
; y[0] ; Output ; OFF ;
+-------+----------+-------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in D:/tty/tty/clock.pin.
+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
Info: Version 4.2 Build 157 12/07/2004 SJ Full Version
Info: Processing started: Sun Nov 28 10:30:02 2004
Info: Command: quartus_fit --import_settings_files=off --export_settings_files=off clock -c clock
Info: Selected device EPF10K10TC144-4 for design "clock"
Info: Timing requirements not specified -- optimizing circuit to achieve the following default global requirements
Info: Assuming a global fmax requirement of 1000 MHz
Info: Not setting a global tsu requirement
Info: Not setting a global tco requirement
Info: Not setting a global tpd requirement
Info: Inserted 0 logic cells in first fitting attempt
Info: Started fitting attempt 1 on Sun Nov 28 2004 at 10:30:03
Info: Fitter placement preparation operations beginning
Info: Fitter placement preparation operations ending: elapsed time = 0 seconds
Info: Fitter placement operations beginning
Info: Fitter placement operations ending: elapsed time = 1 seconds
Info: Fitter routing operations beginning
Info: Fitter routing operations ending: elapsed time = 0 seconds
Info: Quartus II Fitter was successful. 0 errors, 0 warnings
Info: Processing ended: Sun Nov 28 10:30:05 2004
Info: Elapsed time: 00:00:04
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