📄 clock.map.rpt
字号:
|-- hour:inst19
|-- lpm_add_sub:add_rtl_7
|-- addcore:adder
|-- a_csnbuffer:cout_node
|-- a_csnbuffer:oflow_node
|-- a_csnbuffer:result_node
|-- altshift:carry_ext_latency_ffs
|-- altshift:oflow_ext_latency_ffs
|-- altshift:result_ext_latency_ffs
|-- lpm_counter:cnt0_rtl_3
|-- alt_counter_f10ke:wysi_counter
|-- ccc:inst22
|-- lpm_counter:cnt_rtl_0
|-- alt_counter_f10ke:wysi_counter
|-- sel:inst23
|-- fen10:inst24
|-- lpm_counter:cnt_rtl_6
|-- alt_counter_f10ke:wysi_counter
|-- fen10:inst25
|-- lpm_counter:cnt_rtl_5
|-- alt_counter_f10ke:wysi_counter
|-- fen10:inst28
|-- lpm_counter:cnt_rtl_4
|-- alt_counter_f10ke:wysi_counter
+---------------------------------------------------+
; User-Specified and Inferred Latches ;
+-----------------------------------------------+---+
; Latch Name ; ;
+-----------------------------------------------+---+
; bbb:inst17|q[0] ; ;
; bbb:inst17|q[1] ; ;
; bbb:inst17|q[2] ; ;
; bbb:inst17|q[3] ; ;
; Number of user-specified and inferred latches ; 4 ;
+-----------------------------------------------+---+
+------------------------------------------------------+
; General Register Statistics ;
+----------------------------------------------+-------+
; Statistic ; Value ;
+----------------------------------------------+-------+
; Total registers ; 60 ;
; Number of registers using Synchronous Clear ; 37 ;
; Number of registers using Synchronous Load ; 0 ;
; Number of registers using Asynchronous Clear ; 8 ;
; Number of registers using Asynchronous Load ; 0 ;
; Number of registers using Clock Enable ; 24 ;
; Number of registers using Output Enable ; 0 ;
; Number of registers using Preset ; 0 ;
+----------------------------------------------+-------+
+----------------------------------------------------------------+
; WYSIWYG Cells ;
+--------------------------------------------------------+-------+
; Statistic ; Value ;
+--------------------------------------------------------+-------+
; Number of WYSIWYG cells ; 37 ;
; Number of synthesis-generated cells ; 100 ;
; Number of WYSIWYG LUTs ; 37 ;
; Number of synthesis-generated LUTs ; 93 ;
; Number of WYSIWYG registers ; 37 ;
; Number of synthesis-generated registers ; 23 ;
; Number of cells with combinational logic only ; 77 ;
; Number of cells with registers only ; 7 ;
; Number of cells with combinational logic and registers ; 53 ;
+--------------------------------------------------------+-------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Resource Utilization by Entity ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------+
; |clock ; 137 (7) ; 60 ; 0 ; 15 ; 77 (7) ; 7 (0) ; 53 (0) ; 41 (0) ; |clock ;
; |bbb:inst17| ; 22 (22) ; 0 ; 0 ; 0 ; 22 (22) ; 0 (0) ; 0 (0) ; 0 (0) ; |clock|bbb:inst17 ;
; |ccc:inst22| ; 20 (7) ; 15 ; 0 ; 0 ; 5 (5) ; 2 (2) ; 13 (0) ; 13 (0) ; |clock|ccc:inst22 ;
; |lpm_counter:cnt_rtl_0| ; 13 (0) ; 13 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 13 (0) ; 13 (0) ; |clock|ccc:inst22|lpm_counter:cnt_rtl_0 ;
; |alt_counter_f10ke:wysi_counter| ; 13 (13) ; 13 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 13 (13) ; 13 (13) ; |clock|ccc:inst22|lpm_counter:cnt_rtl_0|alt_counter_f10ke:wysi_counter ;
; |disp:inst18| ; 7 (7) ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 0 (0) ; 0 (0) ; |clock|disp:inst18 ;
; |fen10:inst24| ; 6 (2) ; 5 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 5 (1) ; 4 (0) ; |clock|fen10:inst24 ;
; |lpm_counter:cnt_rtl_6| ; 4 (0) ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |clock|fen10:inst24|lpm_counter:cnt_rtl_6 ;
; |alt_counter_f10ke:wysi_counter| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (4) ; 4 (4) ; |clock|fen10:inst24|lpm_counter:cnt_rtl_6|alt_counter_f10ke:wysi_counter ;
; |fen10:inst25| ; 6 (2) ; 5 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 5 (1) ; 4 (0) ; |clock|fen10:inst25 ;
; |lpm_counter:cnt_rtl_5| ; 4 (0) ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |clock|fen10:inst25|lpm_counter:cnt_rtl_5 ;
; |alt_counter_f10ke:wysi_counter| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (4) ; 4 (4) ; |clock|fen10:inst25|lpm_counter:cnt_rtl_5|alt_counter_f10ke:wysi_counter ;
; |fen10:inst28| ; 6 (2) ; 5 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 5 (1) ; 4 (0) ; |clock|fen10:inst28 ;
; |lpm_counter:cnt_rtl_4| ; 4 (0) ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |clock|fen10:inst28|lpm_counter:cnt_rtl_4 ;
; |alt_counter_f10ke:wysi_counter| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (4) ; 4 (4) ; |clock|fen10:inst28|lpm_counter:cnt_rtl_4|alt_counter_f10ke:wysi_counter ;
; |hour:inst19| ; 16 (7) ; 8 ; 0 ; 0 ; 8 (3) ; 3 (3) ; 5 (1) ; 8 (0) ; |clock|hour:inst19 ;
; |lpm_add_sub:add_rtl_7| ; 4 (0) ; 0 ; 0 ; 0 ; 4 (0) ; 0 (0) ; 0 (0) ; 4 (0) ; |clock|hour:inst19|lpm_add_sub:add_rtl_7 ;
; |addcore:adder| ; 4 (1) ; 0 ; 0 ; 0 ; 4 (1) ; 0 (0) ; 0 (0) ; 4 (1) ; |clock|hour:inst19|lpm_add_sub:add_rtl_7|addcore:adder ;
; |a_csnbuffer:result_node| ; 3 (3) ; 0 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 0 (0) ; 3 (3) ; |clock|hour:inst19|lpm_add_sub:add_rtl_7|addcore:adder|a_csnbuffer:result_node ;
; |lpm_counter:cnt0_rtl_3| ; 5 (0) ; 4 ; 0 ; 0 ; 1 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |clock|hour:inst19|lpm_counter:cnt0_rtl_3 ;
; |alt_counter_f10ke:wysi_counter| ; 5 (5) ; 4 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 4 (4) ; 4 (4) ; |clock|hour:inst19|lpm_counter:cnt0_rtl_3|alt_counter_f10ke:wysi_counter ;
; |mian:inst1| ; 15 (10) ; 9 ; 0 ; 0 ; 6 (5) ; 0 (0) ; 9 (5) ; 4 (0) ; |clock|mian:inst1 ;
; |lpm_counter:cnt1_rtl_2| ; 5 (0) ; 4 ; 0 ; 0 ; 1 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |clock|mian:inst1|lpm_counter:cnt1_rtl_2 ;
; |alt_counter_f10ke:wysi_counter| ; 5 (5) ; 4 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 4 (4) ; 4 (4) ; |clock|mian:inst1|lpm_counter:cnt1_rtl_2|alt_counter_f10ke:wysi_counter ;
; |mina:inst8| ; 19 (14) ; 9 ; 0 ; 0 ; 10 (9) ; 2 (2) ; 7 (3) ; 4 (0) ; |clock|mina:inst8 ;
; |lpm_counter:cnt1_rtl_1| ; 5 (0) ; 4 ; 0 ; 0 ; 1 (0) ; 0 (0) ; 4 (0) ; 4 (0) ; |clock|mina:inst8|lpm_counter:cnt1_rtl_1 ;
; |alt_counter_f10ke:wysi_counter| ; 5 (5) ; 4 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 4 (4) ; 4 (4) ; |clock|mina:inst8|lpm_counter:cnt1_rtl_1|alt_counter_f10ke:wysi_counter ;
; |sel:inst23| ; 2 (2) ; 2 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 2 (2) ; 0 (0) ; |clock|sel:inst23 ;
; |sst:inst4| ; 11 (11) ; 2 ; 0 ; 0 ; 9 (9) ; 0 (0) ; 2 (2) ; 0 (0) ; |clock|sst:inst4 ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------+
+--------------------------------+
; Analysis & Synthesis Equations ;
+--------------------------------+
The equations can be found in D:/tty/tty/clock.map.eqn.
+--------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Source Files Read ;
+----------------------------------+-----------------+---------------------------------------------------------------------+
; File Name with User-Entered Path ; Used in Netlist ; File Name with Absolute Path ;
+----------------------------------+-----------------+---------------------------------------------------------------------+
; ../../szz/clock.bdf ; yes ; D:/szz/clock.bdf ;
; sst.vhd ; yes ; D:/tty/tty/sst.vhd ;
; mina.vhd ; yes ; D:/tty/tty/mina.vhd ;
; mian.vhd ; yes ; D:/tty/tty/mian.vhd ;
; fen10.vhd ; yes ; D:/tty/tty/fen10.vhd ;
; ccc.vhd ; yes ; D:/tty/tty/ccc.vhd ;
; disp.vhd ; yes ; D:/tty/tty/disp.vhd ;
; bbb.vhd ; yes ; D:/tty/tty/bbb.vhd ;
; hour.vhd ; yes ; D:/tty/tty/hour.vhd ;
; sel.vhd ; yes ; D:/tty/tty/sel.vhd ;
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